- 芯原股份（芯原）近日宣布嘉楠科技（嘉楠）全球首款支持RISC-V Vector 1.0標準的商用量產端側AIoT芯片K230集成了芯原的圖像信號處理器（ISP）IP ISP8000、畸變矯正（DeWarp）處理器IP DW200，以及2.5D圖形處理器（GPU）IP GCNanoV。該合作極大地優化了高精度、低延遲的端側AIoT解決方案，可廣泛適用于各類智能產品及場景，如邊緣側大模型多模態接入終端、3D結構光深度感知模組、交互型機器人、開源硬件，以及智能制造、智能家居和智能教育相關硬件設備等。芯原的ISP
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嘉楠 RISC-V AIoT SoC 芯原 ISP IP GPU IP
- 預計到2028年，物聯網設備的數量將增加一倍以上，處理能力需求也將同步增長。設備數量的激增會推動產生對于更高數量I/O的需求、對更通用I/O的需求，以及對于邊緣端安全解決方案的需求；處理能力需求的提升則需要更強且更有效率的處理器，這些需求的驅動下，經濟型FPGA迎來了全新的市場發展機遇。 作為經濟型FPGA的經典系列，從1998年Spartan FPGA首發以來持續推動著包括日常所使用技術的進步以及醫療機器人和宇航探索等很多突破性的進展，特別是最近這些年在諸多邊緣互聯應用中收獲了廣泛的應用場景。在總結Sp
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Spartan FPGA 智能邊緣
- 全球領先的高性能現場可編程門陣列（FPGA）和嵌入式FPGA（eFPGA）半導體知識產權（IP）提供商Achronix Semiconductor公司宣布，該公司參加了由私募股權和風險投資公司Baird Capital舉辦的“Baird車技術與出行大會（Baird Vehicle Technology & Mobility Conference）”。Achronix此舉是為了聯絡更多的創新者和投資者，共同推動更加先進的FPGA技術更廣泛地應用于智能汽車、自動駕駛、ADAS和其他先進出行方式。Bai
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Achronix FPGA 智能汽車
- 3月1日，英特爾宣布，成立全新的FPGA（現場可編程門陣列）半導體公司Altera，并計劃在未來兩到三年內為Altera進行股票發行。據了解，2015年，英特爾斥資167億美元收購Altera，也是迄今為止該公司最大額的并購交易。Altera將致力于提供端到端的FPGA解決方案、易于使用的AI以及軟件工具，同時也加強了供應鏈的韌性，以在FPGA市場繼續保持領先地位。英特爾表示，Altera的產品組合將更加多元化，包含業界唯一內置AI能力的FPGA。Altera FPGA在云端運算、數據中心、工業自動化、通
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英特爾 FPGA
- 2024年3月4日，中國上?！驹煞荩ㄐ驹?，股票代碼：688521.SH）今日宣布先楫半導體（簡稱“先楫”）的HPM6800系列新一代數字儀表顯示及人機界面系統應用平臺采用了芯原的高性能2.5D圖形處理器（GPU）IP。HPM6800系列產品基于RISC-V CPU內核，具備高算力、低功耗、高集成度和出色的多媒體功能，適用于汽車儀表、人機交互界面（HMI），以及電子后視鏡（CMS）等需要復雜圖形處理、高分辨率顯示和高性能多媒體用戶界面的應用。 芯原支持OpenVG的2.5D GPU IP能夠
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芯原 GPU IP 先楫 RISC-V MCU
- 今天，英特爾宣布成立全新獨立運營的FPGA公司——Altera。在FPGA Vision線上研討會期間，首席執行官Sandra Rivera和首席運營官Shannon Poulin進行了分享，展示其在超過550億美元的市場中保持領先性的戰略規劃，強調將通過打造集成AI功能的FPGA等舉措，進一步豐富公司的產品組合，同時亦表明將持續助力客戶應對不斷增加的挑戰。會上，Altera也作為新公司的品牌正式對外公布。Altera首席執行官Sandra Rivera表示，“現階段，客戶正面臨日益復雜的技術挑戰，而我們
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英特爾 FPGA Altera
- 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀70年代，是在專用集成電路（ASIC）的基礎上發展起來的一種新型邏輯器件，是當今數字系統設計的主要硬件平臺，其主要特點就是完全由用戶通過軟件進行配置和編程，從而完成某種特定的功能，且可以反復擦寫。在修改和升級PLD時，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設計工作成為軟件開發工作，縮短了系統設計的周期，提高了實現的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產業規模
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FPGA CPLD
- 芯原股份近日宣布集成了芯原神經網絡處理器（NPU）IP的人工智能（AI）類芯片已在全球范圍內出貨超過1億顆，主要應用于物聯網、可穿戴設備、智慧電視、智慧家居、安防監控、服務器、汽車電子、智能手機、平板電腦、智慧醫療等10個市場領域。在過去七年里，芯原在嵌入式AI/NPU領域全球領先，其NPU IP已被72家客戶用于上述市場領域的128款AI芯片中。芯原的NPU IP是一款高性能的AI處理器IP，采用了低功耗、可編程和可擴展的架構設計。它可以靈活配置，以滿足客戶對芯片尺寸和功耗的不同要求，使之成為具有成本效
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芯原 NPU IP AI芯片
- 前言半導體產品老化是一個自然現象，在電子應用中，基于環境、自然等因素，半導體在經過一段時間連續工作之后，其功能會逐漸喪失，這被稱為功能失效。半導體功能失效主要包括：腐蝕、載流子注入、電遷移等。其中，電遷移引發的失效機理最為突出。技術型授權代理商Excelpoint世健的工程師Wolfe Yu在此對這一現象進行了分析。?1、?背景從20世紀初期第一個電子管誕生以來，電子產品與人類的聯系越來越緊密，特別是進入21世紀以來，隨著集成電路的飛速發展，人們對電子產品的需求也變得愈加豐富。隨著電子
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電遷移 半導體失效 世健 Microchip Flash FPGA
- 隨著新一年的到來，科技界有一個話題似乎難以避開：人工智能。事實上，各家公司對于人工智能談論得如此之多，沒有熱度才不正常！在半導體領域，大部分對于AI的關注都集中在GPU或專用AI加速器芯片（如NPU和TPU）上。但事實證明，有相當多的組件可以直接影響甚至運行AI工作負載。FPGA就是其中之一。對于那些了解FPGA靈活性和可編程性的人來說，這并不令人驚訝，但對許多其他人來說，這兩者之間的聯系可能并不明顯。問題的關鍵在于通過軟件讓一些經典的AI開發工具（如卷積神經網絡（CNN））針對FPGA支持的可定制電路設
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FPGA AI 萊迪思
- 2.Verilog HDL 代碼規范 模板示例//********************************************************
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// All rights reserved
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// File name
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FPGA verilog HDL 代碼規范
- 1.RTL CODE 規范1.1標準的文件頭在每一個版塊的開頭一定要使用統一的文件頭，其中包括作者名，模塊名，創建日期，概要，更改記錄，版權等必要信息。 統一使用以下的文件頭：其中*為必需的項目//********************************************************
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// Copyright(c)2016, ECBC
// All rights&nbs
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FPGA verilog HDL 代碼規范
- 可編程邏輯器件（Programmable Logic Device，PLD）起源于20世紀70年代，是在專用集成電路（ASIC）的基礎上發展起來的一種新型邏輯器件，是當今數字系統設計的主要硬件平臺，其主要特點就是完全由用戶通過軟件進行配置和編程，從而完成某種特定的功能，且可以反復擦寫。在修改和升級PLD時，不需額外地改變PCB電路板，只是在計算機上修改和更新程序，使硬件設計工作成為軟件開發工作，縮短了系統設計的周期，提高了實現的靈活性并降低了成本，因此獲得了廣大硬件工程師的青睞，形成了巨大的PLD產業規模
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CPLD FPGA 架構
- 可綜合語句1.要保證Verilog HDL賦值語句的可綜合性，在建模時應注意以下要點：2.不使用initial。3.不使用#10。4.不使用循環次數不確定的循環語句，如forever、while等。5.不使用用戶自定義原語（UDP元件）。6.盡量使用同步方式設計電路。7.除非是關鍵路徑的設計，一般不采用調用門級元件來描述設計的方法，建議采用行為語句來完成設計。8.用always過程塊描述組合邏輯，應在敏感信號列表中列出所有的輸入信號。9.所有的內部寄存器都應該能夠被復位，在使用FPGA實現設計時，應盡量使
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FPGA verilog HDL 綜合語句
- 嵌入式行業對基于RISC-V?的開源處理器架構的需求日益增長，但在商用芯片或硬件方面的選擇仍然有限。為了填補這一空白并推動創新，Microchip Technology Inc.（微芯科技公司）宣布推出PolarFire? SoC Discovery工具包。通過為嵌入式處理和計算加速提供用戶友好、功能豐富的開發工具包，Microchip可幫助各種水平的工程師采用新興技術。新發布的開源開發工具包具有支持Linux?和實時應用的四核 RISC-V 應用級處理器、豐富的外設和95K低功耗高性能FPGA邏輯元件。
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Microchip PolarFire 嵌入式系統工程師 RISC-V FPGA
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