- 隨著高速數據采集設備傳輸帶寬的日益提高，開發者需要采用新的計算機總線進行數據傳輸。這里敘述了使用EP2SGX90系列FPGA完成PCI-Express協議轉換，多種DMA工作方式及相關寄存器的作用。以鏈式DMA傳輸方式為例，詳細介紹該傳輸方式下的寄存器設置及在驅動程序中的實現范例。實驗表明，用FPGA實現協議轉換，總線持續傳輸速率最高可以達到1．2 Gb／s，滿足大多數高速數據采集設備的要求。在此摒棄了采用專用總線接口芯片的傳統方法，將開發者的邏輯設計和總線協議轉換放到同一個FPGA芯片中，不但節省了硬件
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Express FPGA PCI 總線接口
- 在現代EDA外圍電子器件的接口中存在多種標準，已知的一些接口協議存在速度慢、協議復雜等問題。SPI總線是能夠克服上述缺點的一種外圍串行總線，其能很好地滿足要求。通過使用Lattice公司的FPGA芯片以及工程開發軟件，特別是在線邏輯分析儀這一先進的EDA工具，實現了基于FPGA的SPI接口的連接。將FPGA編程的靈活性和SPI總線的易用性結合，實現了FLASH的存取功能。同時也為同類型接口的芯片應用提供了一個原型，為進一步的工程設計提供了支持。
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FPGA SPI 總線接口
- 愛特公司(Actel Corporation)宣布提供面向馬達控制應用的SmartFusion™智能混合信號FPGA參考設計。這些靠單一SmartFusion器件中實現的參考設計詮釋了使用多種反饋方法的磁場定向控制(FOC)，用于永磁同步馬達(permanent magnet synchronous motors, PMSM)。SmartFusion器件集成了一個FPGA、一個硬核ARM® Cortex™-M3微控制器和可編程模擬模塊，具有適合馬達控制應用的獨特性能，可
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愛特 FPGA 馬達控制
- 可程序邏輯閘陣列芯片(FPGA)雙雄賽靈思(Xilinx)與阿爾特拉(Altera)先后推出28納米FPGA產品，不僅使FPGA市場戰火升溫，也讓晶圓代工市場激烈角逐，在Xilinx首度與臺積電攜手合作后，Altera在28納米產品的布局上亦相當積極，近期亦展示在28納米 FPGA平臺上的25-Gbps收發器，FPGA雙雄的激烈競賽，預料臺積電將成為最大受惠者。
Altera指出，在28納米FPGA中展示25-Gbps收發器，是收發器產品的里程碑，該芯片是Altera用于在28納米FPGA上，成
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臺積電 FPGA 28納米
- 闡述了兩種DDS的原理，頻率合成方式(DDFS)和直讀方式(DDWS)，給出了FPGA實現方式，分析了DDS的幾個關鍵的技術指標，并通過Matlab仿真。頻率合成方式是比較常用的DDS產生方式，對它做了詳細的原理性介紹和實現說明，重點通過仿真詳細對比了兩種實現方式在性能指標上的優劣，為后人的選擇提供技術參考。
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FPGA DDS
- SoC設計之組態性處理器IP,由于半導體工藝進步，相同芯片面積中可以放入愈來愈多的晶體管，致使這10多年來業界開始積極發展所謂的系統單芯片SoC，而可組態性處理器IP概念就像自助餐式的自組拼盤，提供嵌入式系統更寬廣的應用空間hellip;
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IP 處理器 組態 設計 SoC
- 在簡要介紹地日運行規律的基礎上，確定了視日運動跟蹤法的計算模型及跟蹤裝置的機械結構。采用FPGA芯片XC3S1500為處理器，以步進電機為執行機構，采用Verilog語言設計實現了高度角一方位角太陽跟蹤系統。根據系統的要求建立了計時模塊、太陽高度角方位角計算模塊、日出日落時間計算模塊和步進電機脈沖控制模塊。通過實驗測試該系統能夠達到預期的性能指標，對提高太陽能的利用率具有重要的現實意義。
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FPGA 跟蹤器
- 基于FPGA的片上系統和嵌入式系統的遠程監控系統,本系統立足于利用Intemet實現核環境信息的遠程采集。在實現上，采用了基于SOPC技術的嵌入式解決方案，通過在FPGA中嵌入NioslI軟核處理器和所需外設的IP Core(硅知識產權核)，然后再配備相應的網絡接口，實現利用互聯
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系統 監控系統 遠程 嵌入式 基于 FPGA
- 本系統立足于利用Intemet實現核環境信息的遠程采集。在實現上，采用了基于SOPC技術的嵌入式解決方案，通過...
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遠程監控 SoC 嵌入式 FPGA
- 一個網絡的頻率特性包括幅頻特性和相頻特性，在系統設計時，各個網絡的頻率特性對該系統的穩定性、工作頻帶...
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掃頻儀 FPGA 單片機 掃頻信號
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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65nm TD-SCDMA FPGA 多模無線基站
- 基于FPGA芯片和頻率合成器ADF4360-4的GPS信號源的設計方案, 頻率合成器是發射系統和接收系統中的核心器件，采用相位負反饋頻率控制技術，具有良好的窄帶載波跟蹤性能和帶寬調制跟蹤性能，為系統上、下變頻提供本振信號，對相位噪聲和雜散具有很好的抑制作用，通過鎖相頻率合
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GPS 信號源 設計 方案 ADF4360-4 合成器 FPGA 芯片 頻率
- FPGA/EPLD的自上而下設計方法,FPGA/EPLD的自上而下(Top-Down)設計方法： 傳統的設計手段是采用原理圖輸入的方式進行的，如圖1所示。通過調用FPGA/EPLD廠商所提供的相應物理元件庫，在電路原理圖中繪制所設計的系統，然后通過網表轉換產生某一特
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方法 設計 自上而下 FPGA/EPLD
- 基于FPGA與SRAM的大容量數據存儲的設計, 1 前言 針對FPGA中內部BlockRAM有限的缺點，提出了將FPGA與外部SRAM相結合來改進設計的方法，并給出了部分VHDL程序。 2 硬件設計 這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61
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存儲 設計 數據 大容量 FPGA SRAM 基于
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