基于FPGA技術的存儲器設計及其應用,復雜可編程邏輯器件—FPGA技術在近幾年的電子設計中應用越來越廣泛。FPGA具有的硬件邏輯可編程性、大容量、高速、內嵌存儲陣列等特點使其特別適合于高速數據采集、復雜控制邏輯、精確時序邏輯等場合的應用。而應
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及其 應用 設計 存儲器 FPGA 技術 基于
基于FPGA的圖像采集模塊設計,1 引言 圖像采集是圖像處理的前提。圖像采集卡是常用的圖像輸入設備，通常占用PC機總線的一個插槽。它主要包括圖像存儲器單元、CCD或CMOS攝像頭接口、PC機總線接口等。傳統的圖像采集卡大多數采用 PCI接口，這種圖
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模塊 設計 采集 圖像 FPGA 基于
全球領先的硅產品知識產權 (SIP) 平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司宣布推出完全可編程的低功耗DSP架構框架CEVA-XC4000，支持用于蜂窩、Wi-Fi、DTV、白色空間 (white space) 等應用的最嚴苛的通信標準。CEVA-XC4000 架構以其大獲成功的上一代產品為基礎，利用創新性指令集以軟件方式實現了通常只能由專用硬件完成的高度復雜的基帶處理，并樹立了新的功耗里程碑。以LTE-A處理為例，CEVA-XC4000的性能相比CEVA-XC323 DSP提
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CEAV DSP LTE-A Wi-Fi 802.11ac DVB-T2
全球領先的硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司及CEVA-XCnet合作伙伴Antcor S.A.宣布，推出一款瞄準多模Wi-Fi 802.11ac移動臺(STA)的基于軟件的新型參考架構。Antcor S.A是通信和連接芯片行業的主要軟件基帶IP供應商。對于尚待批準的802.11ac Wi-Fi新標準，以及包括802.11af、802.11p和Wi-Fi指令在內的其它眾多衍生標準，這種基于軟件的方法能夠提供全面的靈活性，可以通過軟件更新應對標準變化，
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CEVA DSP Wi-Fi 802.11ac
全球領先的硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司推出CEVA-TeakLite-4，這是一款用于高級音頻和語音應用的業界功能最強大的低功耗、可擴展32位DSP架構。CEVA TeakLite 4 針對于智能手機，移動計算和數字家庭設備市場，滿足市場對于語音預處理和音頻后處理算法以及多通道音頻編解碼器(codec)日益復雜的需求。
CEVA-TeakLite-4以業界廣泛使用并經過驗證的CEVA-TeakLite系列功能為基礎，采用創新性智能功耗
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CEVA DSP TeakLite
全球領先的硅產品知識產權(SIP)平臺解決方案和數字信號處理器(DSP)內核授權廠商CEVA公司宣布提供一種基于軟件的新型多模參考架構，用于開發具有成本效益的低功耗LTE- (LTE-A)和傳統蜂窩調制解調器?；谛滦虲EVA-XC4000 DSP架構框架，這款功能強大的可擴展參考架構利用了創新性功率管理和系統分區，能夠實現基于軟件的LTE-A解決方案，而且采用28nm工藝，所需晶片面積和功耗僅分別為3.4 mm2和100mW。該架構集成了CEVA開發的一整套經優化的LTE-A軟件庫，顯著地加快了上市
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CEVA DSP LTE
摘要 基于FPGA、PCI9054、SDRAM和DDS設計了用于某遙測信號模擬源的專用板卡。PCI9054實現與上位機的數據交互，FPGA實現PCI本地接口轉換、數據接收發送控制及DDS芯片的配置。通過WDM驅動程序設計及MFC交互界面設計，最
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數據通信 設計 高速 LVDS FPGA
FPGA的高速多通道數據采集控制器IP核設計,隨著可編程邏輯器件的不斷進步和發展，FPGA在嵌入式系統中發揮著越來越重要的作用。本文介紹的在電能質量監測系統中信號采集模塊控制器的 IP核，是采用硬件描述語言來實現的。首先它是以ADS8364芯片為控制對象，結合
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IP 設計 控制器 數據采集 高速 通道 FPGA
采用FPGA解決通信接口問題,引言
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接口 問題 通信 解決 FPGA 采用
基于FPGA的中文字符顯示的VHDL程序,--文件名：lcd_driver.vhd?！ ?-功能：FGAD驅動LCD顯示中文字符“年”?！ ?-最后修改日期：2004.3.24?！ ibrary IEEE; use IEEE.STD_LOGIC_1164.ALL; use IEEE.STD_LOGIC_ARITH.ALL; use
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VHDL 程序 顯示 字符 FPGA 中文 基于
基于嵌入式DSP系統的低功耗優化設計,無線系統及有線系統設計師均必須重視電源效率問題，盡管雙方的出發點不盡相同：對于移動設備而言，更長的電池使用壽命、更長的通話時間或更長的工作時間都是明顯的優勢，降低電源要求意味著使用體積更小的電池或選擇
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優化 設計 功耗 系統 嵌入式 DSP 基于
用VHDL/VerilogHD語言開發PLD/FPGA的完整流程,用VHDL/VerilogHD語言開發PLD/FPGA的完整流程為： 1.文本編輯：用任何文本編輯器都可以進行，也可以用專用的HDL編輯環境。通常VHDL文件保存為.vhd文件，Verilog文件保存為.v文件 2.功能仿真：將文件調入HDL仿真
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完整 流程 PLD/FPGA 開發 語言 VHDL/VerilogHD
基于FPGA的LED電視動態背光系統設計,本文設計一款基于FPGA(現場可編程門陣列)的液晶電視動態背光系統，采用LED側背光方式，符合當前液晶電視LED背光應用主流?！ ‰娨晞討B背光 以往的電視機主板將圖像信號通過LVDS(LowVoltageDifferentialSignal，低
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背光 系統 設計 動態 電視 FPGA LED 基于
基于FPGA的IPV6數字包的分離與封裝的實現,筆者在參加國家“863”重大專題項目“高速密碼芯片及驗證平臺系統”的過程中，遇到了將IPV6數據包的包頭和數據部分拆開，然后在數據部分送密碼芯片進行加/解密處理，最后再將處理后的數據部分與
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封裝 實現 分離 數字 FPGA IPV6 基于
基于DSP／BIOS大空間網絡型火災探測系統設計,摘要 針對傳統圖像型火災探測系統以PC作為處理終端，且不能對CCD攝像機進行有效控制等缺點，提出了以TMS320DM642為平臺開發基于DSP／BIOS的大空間網絡型火災探測系統。該系統在DSP／BIOS與RF5參考框架的基礎上，利用
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探測 系統 設計 火災 網絡型 DSP BIOS 空間 基于
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