- Tensilica日前宣布與Renesas Electronics簽署協議，授權該公司使用HiFi音頻/語音DSP(數字信號處理器)。Renesas Electronics將使用HiFi DSP開發一系列SOC(片上系統)，這些SOC將用于手機、平板電腦、汽車和其他多媒體設備上。
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Tensilica Renesas DSP
- Altera公司(NASDAQ: ALTR)今天發布其面向FPGA的OpenCL (開放計算語言)早期使用計劃(EAP)，支持客戶提前了解Altera面向FPGA的OpenCL解決方案。采用這一開放標準，設計團隊可以在高級C語言框架中面向FPGA設計他們自己的系統和算法，大大簡化了FPGA的開發。作為EAP計劃的一部分，客戶能夠預先了解Altera的OpenCL解決方案，參加面向FPGA的OpenCL培訓課程，獲得相關資料，觀看其技術演示。
OpenCL是一種開放編程標準，能夠跨CPU、GPU和
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Altera FPGA OpenCL
- 摘 要： 結合FPGA嵌入式系統具有硬件電路高并行度和軟件編程控制簡單的特點，設計了一套基于FPGA嵌入式系統的雷達信號模擬器，能夠完成雷達中頻和視頻信號、雜波和干擾信號的模擬，實現雷達系統在不具備實際接收前端
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FPGA 嵌入式系統 雷達 信號模擬器
- 引言信息處理機(圖1)用于完成導彈上多路遙測信息的采集、處理、組包發送。主要功能包括高速1553B總線的數據收發 、422接口設備的數據加載與檢測、多路數據融合和數據接收、處理、組包發送的功能。其中，總線數據和其
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FPGA 信息處理 中的應用
- 引言視頻采集的主流實現方案有兩種：一是基于ASIC，該方案一般采用意法、AMD等公司的專用視頻處理芯片；二是基于DSP，主要采用TI、ADI等公司的DSP信號處理器。它們作為輔處理器，可在主CPU控制下進行視頻信號的采集壓
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Spartan FPGA 視頻采集 系統設計
- 眾所周知，匯編語言具有更高的性能優勢，而用C語言編碼則能更容易和快速地實現。DSP處理器功能的不斷增強以及編譯器優化技術的提高，使得傳統的用匯編語言編寫DSP應用程序的做法逐漸被淘汰。現在的DSP應用程序幾乎都
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DSP 匯編語言 混合編程 軟件設計
- 基于DSP／BIOS的多信號并行處理軟件架構設計,摘要 利用DSP芯片設計出能夠支持多類信號多路并行處理的軟件，可減少外圍專用算法芯片的使用，降低設計成本、縮小印制板尺寸、縮短開發周期。文中介紹了一種利用DSP／BIOS操作系統進行快速開發設計的軟件架構，不僅滿
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軟件 架構 設計 處理 并行 DSP BIOS 信號 基于
- .NISingle-BoardRIO通用逆變器控制器(GeneralPurposeInverterController,GPIC)提供個了一個革命性...
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FPGA NI 智能電網電力電子
- 高速DSP系統的電路板級電磁兼容性分析與設計,隨著高速DSP技術的廣泛應用，相應的高速DSP的PCB設計就顯得十分重要。由于DSP是一個相當復雜、種類繁多并有許多分系統的數、模混合系統，所以來自外部的電磁輻射以及內部元器件之間、分系統之間和各傳輸通道間的串擾
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分析 設計 電磁兼容 電路板 DSP 系統 高速
- 我國靶場測量、工業控制、電力系統測量與保護、計算、通信、氣象等測試設備均采用國際標準IRIG-B格式的時間碼(簡稱B碼)作為時間同步標準。B碼是一種串行的時間格式，分為直流碼(DC碼)和交流碼(AC碼)兩種，其格式和碼
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IRIG-B FPGA 編碼器
- 大容量無線傳輸技術中DSP的啟動方法,1 引言
在極低譜密度，高頻譜利用率的大容量
如果DSP 的程序小于1K 字節，那么上述ROM 啟動機制已經可以完成程序的加載。然而事實上大部分DSP 的程序會大于1K 字節，這時就需要創建一個特定啟動程序來完成更多
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啟動 方法 DSP 技術 無線 傳輸 大容量
- 摘要：集成電路設計越來越向系統級的方向發展，解決模塊間的接口問題顯得尤為重要。 SPI 串行總線是一種常用的標準接口，其使用簡單方便而且占用系統資源少，應用相當廣泛。 本文將介紹一種新的通用的SPI 總線的FPGA
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FPGA 可復用 接口設計 通信
- 摘要 介紹一種數字中頻恢復系統，該系統分為光纖接收單元、FPGA核心單元和QDUC單元。光纖接收單元采用高速串行器／解串器TLK1501，完成高速串行數據的串行轉換。FPGA核心單元對數據進行解碼、檢驗、配置TLK1501和AD9
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FPGA 數字中頻 恢復系統
- 摘要 IBERT即集成式比特誤碼率測試儀，是Xilinx專門用于具有高速串行接口的FPGA芯片的調試和交互式配置工具。文中介紹了IBTERT基本功能、實現原理，并結合實例闡述用IBTERT調試FPGA時的具體方法和調試步驟。
關鍵詞
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IBERT FPGA 中的應用
- 摘要 介紹了以FPGA為核心的邏輯控制模塊的數據采集系統的設計可以滿足實時性要求，設計中采用自頂向下的設計方法，根據不同的功能將整個系統劃分為若干模塊進行設計，并介紹了每個模塊的功能和實現方法。在設計中采用
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FPGA 數據 嵌入式 圖像采集系統
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