- 提高DSP代碼運行性能的研究,1 引言
隨著微控制器技術的發展，以TI公司TMS320C2000系列為代表的DCS型數字信號處理器DSP應用廣泛。該類型DSP內部集成Flash存儲器，可將二進制代碼同化到其內部的Flash存儲器直接運行。這種運行方式在傳統嵌入
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DSP 代碼 運行 性能
- 基于DSP的太陽光線自動跟蹤系統設計與實現,1 引言
精確捕捉太陽光線可提高太陽能裝置，尤其是聚光類太陽能裝置的太陽能利用率。現有的聚光類太陽能發電系統主要采用程序控制、傳感器控制、程序與傳感器聯合控制的方法。程序控制方法是計算出太陽在一天中
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DSP 光線 自動跟蹤 系統設計
- 要CORDIC(COordination Rotation DIgital Computer)算法實現正交數字混頻器中的數控振蕩器的方法。首先推導了算法產生正余弦信號的實現過程,然后給出了
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FPGA 正交數字 混頻器 數控振蕩器
- 本文提出了多級CIC抽取濾波器結構不僅能夠實現更寬輸入信號的任意速率的抽取，并且對帶外信號的衰減也更大。
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FPGA 積分 梳狀濾波器
- FPGA工作原理與簡介 如前所述，FPGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎上進一步發展的產物。它是作為ASIC領域中的一種半定制電路而出現的，即解決了定制電路的不足，又克服了原有可編程器件門電路有限的缺點。 由于FPGA需要被反復燒寫，它實現組合邏輯的基本結構不可能像ASIC那樣通過固定的與非門來完成，而只能采用一種易于反復配置的結構。查找表可以很好地滿足這一要求，目前主流FPGA都采用了基于SRAM工藝的查找表結構，也有一些軍品和宇航級FPGA采用Flash或者熔絲與反熔
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FPGA Xilinx Altera
- 常用FPGA/CPLD四種設計技巧,FPGA/CPLD的設計思想與技巧是一個非常大的話題，本文僅介紹一些常用的設計思想與技巧，包括乒乓球操作、串并轉換、流水線操作和數據接口的同步方法。希望本文能引起工程師們的注意，如果能有意識地利用這些原則指導日
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FPGA CPLD 設計技巧
- FPGA/EPLD的自上而下設計方法,FPGA/EPLD的自上而下(Top-Down)設計方法： 傳統的設計手段是采用原理圖輸入的方式進行的，如圖1所示。通過調用FPGA/EPLD廠商所提供的相應物理元件庫，在電路原理圖中繪制所設計的系統，然后通過網表轉換產生某一特
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FPGA EPLD 自上而下 設計方法
- FPGA技術、低成本光學器件以及無源架構都為無源光網絡(PON)以及這些網絡的演進做出了巨大貢獻。系統級OEM廠商不斷發現，FPGA能夠提供技術性設計和經濟
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FPGA PON 無源光網絡
- DSP芯片TMS320C30與A/D轉換器MAX153和D/A轉換器MX7545接口的設計,MAX153和MX7545是美國MAXIM公司近幾年推出的8位A/D轉換器和12位D/A轉換器。MAX153具有高達1MSPS的采樣率,MX7545具有4MSPS的數/模轉換速度。MAX153和MX7545可以很容易地與一般微處理器接口,而不需要過多地考慮時序問題
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320C 7545 DSP 320
- 傳說中有一對美麗的紅舞鞋，穿上它，你將舞出最美麗的舞步…… 正式從事電子硬件設計工作有十幾年時光了，回憶起剛接觸電子，感觸很多……雖然經歷了很多酸甜苦辣，但也給我的生活增添了很多色彩…… 第一次真正意義上的接觸電子應當算是高中的時候。當時很喜歡學校圖書館里的一份雜志，雜志名字不記得了，只記得雜志里有兩頁是關于電子制作的，當時那兩頁一直是我的最愛……慢慢的積累了一些電子方面的知識，也逐漸有了自己要做一塊電路板的想法…… 那時我對電子的感情用“癡迷”兩個字來形容絕不為過――因這家境不好，我每月只有不
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ARM FPGA
- NI LabVIEW FPGA模塊可以幫助您利用LabVIEW程序框圖對一個FPGA進行編程。在其底層，該模塊采用代碼生成技術實現圖形化開發環境與FPGA硬件的整合。這種
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FPGA LabVIEW FlexRIO 模塊
- FPGA 解決方案和標準控制器內核比較, MicroBlaze處理器是賽靈思(Xilinx)在嵌入式開發套件 (EDK) 中提供的兩款32位內核之一，是實現硬件加速的靈活工具。圖1是MicroBlaze的典型設計。該內核含有一個32位乘法器，但不含浮點單元(FPU)、桶式移位器或專用硬
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FPGA 方案 標準 比較
- 燃料電池車是以氫氣為燃料，氫氣與大氣中的氧氣發生化學反應，通過電極將化學能轉化為電能，以電能作為動力驅動汽車前進。燃料電池汽車具有高效率、無
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DSP 控制系統 離散 模型參考
- 正交相干檢波方法及FPGA的實現,引言
現代雷達普遍采用相參信號來進行處理，而如何獲得高精度基帶數字正交(I，Q)信號是整個系統信號處理成敗的關鍵。傳統的做法是采用模擬相位檢波器來得到I、Q信號，其正交性能一般為：幅度平衡在2％左右，相位
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FPGA 相干檢波 方法
- 要FPGA與的數字信號采集系統。可以提供大容量的存儲空間。提供優秀的系統適應能力。該方案通過計算機并口實現與計算機的通信 ,但是高性能的邏輯分析儀
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SDRAM FPGA 數字電視信號 采集系統
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