- 引言 超聲在人體內傳播，由于人體各種組織有聲學的特性差異，超聲波在兩種不同組織界面處會產生反射、折射、散射、繞射、衰減以及聲源與接收器相對運動產生多普勒頻移等物理特性。應用不同類型的超聲診斷儀，采用各
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工裝 設計 檢測 CPLD 單片機 基于
- 摘要：介紹一種基于復雜可編程邏輯器件(CPLD)的數據采集系統，并給出詳細的設計方案。計算機通過ISA總線實現與數據采集系統的指令和數據傳輸。通過VHDL編程實現CPLD對12位串行模數轉換器ADS7816的控制。最后，給出該
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CPLD ISA 總線 數據采集
- 摘要：利用壓控振蕩器CD4046和可編程邏輯器件EPM7128構成控制系統，通過調節(jié)逆變輸出脈沖的占空比和頻率，實現臭氧電源輸出電壓和頻率的調節(jié)，從而達到對臭氧電源輸出功率的調節(jié)。調試結果表明該系統滿足實時性和功耗
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CPLD 臭氧電源 中的應用
- 摘要：介紹基于TMS320F2812和CPLD的數字視頻采集系統的接口設計。該系統采用同步分離電路、TMS320F2812、EPM7128、TMS320C6416、IDE硬盤存儲器以及顯示器接口等芯片，利用TMs320F2812中的ADC采樣速度和轉換精度高的優(yōu)
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接口 設計 系統 采集 CPLD 視頻 TMS320F2812
- 摘要：根據某測試系統的需要，設計基于PCl04總線和CPLD的高精度測頻模件，采用多周期同步測頻法實現對所測頻段的等精度測量。設計了該測頻模件的硬件電路，并給出用CPLD實現數字頻率計的詳細VHDL源代碼。采用原理圖的
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CPLD 104 PC 總線
- 采用CPLD/FPGA的VHDL語言電路優(yōu)化原理設計,VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標準硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)展起來的。它是一種面向設計、多層次的硬件描述語言，是集行為描述、RTL
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優(yōu)化 原理 設計 電路 語言 CPLD/FPGA VHDL 采用
- 本文在對異步串行通信協議進行分析的基礎上，根據實際工程的需要，對異步串行通信控制器進行了詳細設計，并結合CPLD器件，采用VHDL語言，對設計方案進行了實現和驗證，通過最后時序仿真的波形圖得出了設計方案的正確，而且加載了該設計程序的CPLD在實際工程中能夠很好地與處理器進行連接來收發(fā)數據，從而為那些沒有串行異步接口的處理器提供一個比較理想的設計方案。
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CPLD 異步串行 通訊 控制器
- VHDL(VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage)是IEEE工業(yè)標準硬件描述語言...
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CPLD FPGA VHDL 電路優(yōu)化設計
- 摘要：針對傳統信號源精度低的特點，提出一種新的函數信號發(fā)生器設計方案。這里介紹的函數信號發(fā)生器由CPLD、單片機控制模塊、鍵盤、LED顯示、D／A轉換模塊組成。采用直接數字頻率合成(DDFS)技術，用單片機控制CPLD的
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CPLD 函數信號發(fā)生器
- 摘要：常規(guī)數據采集與顯示方法是應用CPU或DSP通過軟件控制數據采集的模／數轉換，這樣將會頻繁中斷系統的運行，從而降低系統的運算速度，數據采集的速度也將受到限制。通過CPLD實現由硬件控制模／數轉換和數據顯示，
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CPLD 數據采集 電路 仿真設計
- 摘要：提出一種基于CPLD的多次重觸發(fā)存儲測試系統設計方案，詳細介紹系統硬件設計以及CPLD內部控制原理，并對CPLD控制電路仿真。該系統體積小、功耗低，能夠實時記錄多次重觸發(fā)信號，每次信號記錄均有負延遲，讀取出
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CPLD 觸發(fā) 存儲測試 系統設計
- 基于ARM和CPLD的開放式數控系統設計,針對新一代開放式數控系統的特征要求，提出一種基于ARM和CPLD、以Windows CE為操作系統的開放式數控系統方案。介紹了系統的軟硬件平臺開發(fā)，重點討論了系統核心部分中斷控制的實現方案，包括Windows CE系統中斷服務、應用程序中斷響應和CPLD程序。
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數控系統 設計 開放式 CPLD ARM 基于 通信協議
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