- 2009年3月31號，北京——Altera公司(NASDAQ: ALTR)今天宣布，Altera公司于2009年3月10日在天津大學成立EDA/SOPC聯合實驗室。這是Altera自2004年3月在中國電子科技大學成立首個EDA/SOPC聯合實驗室以來的國內第60所聯合實驗室和培訓中心。該實驗室將為數字邏輯電路、硬件描述語言、微機原理、電視原理、現代數字系統設計等本科或研究生課程的實驗教學以及電子類課程設計提供支持，Altera®公司的FPGA開發環境將成為貫穿天津大學
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Altera FPGA SOPC
- 1.引言
隨著電子技術的發展，復雜可編程邏輯器件CPLD（Complex Programmable Logic Device）以其高速、高可靠以及開發便捷、規范、能完成任何數字器件功能的優點[1]， 越來越廣泛地應用于電子儀器中。線纜的安裝質
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CPLD 線纜 測試技術 中的應用
- 0 引言
信息技術的發展，特別是各種數字處理器件處理速度的提高，實時處理大量的數據已經成為現實。但是，在一些惡劣環境和數據無法進行實時傳輸的情況下，還必須用到存儲測試的方法。存儲測試是指在對被測對象
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FPGA 高速數據 采集 存儲系統
- O 引言
現場可編程門陣列(FPGA，Field Programmable Gate Array)的出現是超大規模集成電路(VISI)技術和計算機輔助設計(CAD)技術發展的結果。FPGA器件集成度高、體積小，具有通過用戶編程實現專門應用的的功能。
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144C T144 FPGA 144
- 1 Fir濾波器原理
有限沖激響應(FIR)數字濾波器和無限沖激響應(IIR)數字濾波器廣泛應用于數字信號處理系統中。IIR數字濾波器方便簡單，但它相位的非線性，要求采用全通網絡進行相位校正，且穩定性難以保障。FIR濾
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FPGA FIR 并行 流水線
- 摘要：設計并實現了基于PCI總線和CPLD技術，通過用戶軟件控制多種類型、參數信號生成的信號發生器，詳細介紹了設計中主要軟、硬件的設計實現方法。本系統可以方便地實現各種常見的電磁信號的生成，并可以在本系統的基
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CPLD PCI 總線 信號發生器
- 摘要：基于FIR數字濾波器的原理和層次化、模塊化設計思想，結合Altera公司的CycloneII系列FPGA芯片，提出了FIR數字濾波器的實現硬件方案，給出了采用Matlab、QuartusⅡ設計及實現32階低通FIR濾波器的方法步驟，仿真及
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Matlab FPGA FIR 數字
- Altera公司今天宣布，Altera公司于2009年3月10日在天津大學成立EDA/SOPC聯合實驗室。這是Altera自2004年3月在中國電子科技大學成立首個EDA/SOPC聯合實驗室以來的國內第60所聯合實驗室和培訓中心。該實驗室將為數字邏輯電路、硬件描述語言、微機原理、電視原理、現代數字系統設計等本科或研究生課程的實驗教學以及電子類課程設計提供支持，Altera®公司的FPGA開發環境將成為貫穿天津大學電子工程類專業本科和研究生教育階段的實驗平臺。
作為全球領先的可編程邏輯器件
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Altera FPGA SOPC
- 在高速圖像采集系統中，CPU時鐘資源、I／O端口資源、傳輸單元等都成為系統的瓶頸。本系統采用FPGA+RAM+USB的設計：FPGA硬件采樣模塊，有效降低采樣時延和CPU時鐘資源；獨特的RAM時序控制與讀寫控制分離設計，增加了模塊之間的獨立性，降低了控制的復雜度；USB設計在實現高速率數據傳輸的同時又具有低成本、易安裝等優點。
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FPGA 高速圖像采集 系統設計
- 實現信號源常用的方法是頻率合成法，其中直接數字頻率合成法是繼直接頻率合成法和間接頻率合成法之后，隨著電子技術迅速發展的第三代頻率合成技術。DDS是一種全數字技術，它從相位概念出發直接合成所需頻率，它具有頻
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Builder FPGA DSP 正弦
- 為了實現USB設備之間的直接通信，介紹一款USB 0TG IP核的設計與FPGA驗證。在分析OTG補充規范的基礎上，重點描述了USB OTG IP核的設計原理、模塊劃分以及每個模塊的功能，然后對USBOTG的部分特性進行詳細的闡述，最后給出該IP核在ModelSim中的功能仿真及FPGA驗證結果。結果表明，該IP核具備主機功能和設備功能，可作為一個獨立的IP模塊應用到SoC系統中。
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FPGA 驗證 設計 Core OTG IP USB
- 1引言隨著ATM機普及，人們對流通貨幣質量要求越來越高，鈔票清分工作對銀行業來說就顯得格外重要。清分機是一種高端金融機具產品，能夠一次性完成鈔票的清分工作，包括鈔票點算、幣種識別、真偽鑒別、面額清分、版本
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采集 系統 圖像 紙幣 CPLD 分機 基于 轉換器
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