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基于FPGA的等精度頻率計(jì)的設(shè)計(jì)與實(shí)現(xiàn)
- 現(xiàn)場(chǎng)可編程門陣列FPGA(Field Programmable GateArray)屬于ASIC產(chǎn)品，通過(guò)軟件編程對(duì)目標(biāo)器件的結(jié)構(gòu)和工作方式進(jìn)行重構(gòu)，能隨時(shí)對(duì)設(shè)計(jì)進(jìn)行調(diào)整，具有集成度高、結(jié)構(gòu)靈活、開(kāi)發(fā)周期短、快速可靠性高等特點(diǎn)，數(shù)字設(shè)計(jì)在
- 關(guān)鍵字： FPGA 等精度頻率計(jì)
基于CPLD多通道編碼器數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)
- 本文提出了采用Xilinx公司生產(chǎn)的CPLD來(lái)對(duì)多通道旋轉(zhuǎn)編碼器進(jìn)行數(shù)據(jù)采集的方法，著重介紹了系統(tǒng)的軟硬件設(shè)計(jì)和驅(qū)動(dòng)程序開(kāi)發(fā)，以及實(shí)際應(yīng)用情況，得出了用CPLD技術(shù)為多通道編碼器進(jìn)行數(shù)據(jù)采集這樣一種切實(shí)可行的方法。
- 關(guān)鍵字： CPLD 多通道 編碼器 數(shù)據(jù)采集
基于FPGA的數(shù)字存儲(chǔ)示波器的顯示技術(shù)
- 1引言由于液晶顯示器(LCD)功耗低，體積小，超薄，重量輕，而且車身沒(méi)有畫(huà)面幾何圖形的失真及收斂性誤差，也...
- 關(guān)鍵字： FPGA 數(shù)字存儲(chǔ) 示波器
嵌入式系統(tǒng)聯(lián)誼會(huì)“FPGA在嵌入式系統(tǒng)中的應(yīng)用”主題討論會(huì)圓滿結(jié)束
- 隨著微電子技術(shù)和軟件技術(shù)的發(fā)展，嵌入式處理器、專用數(shù)字器件、外設(shè)和DSP算法正在以IP核的方式嵌入到FGPA中，以單芯片可編程FPGA完成整個(gè)嵌入式系統(tǒng)設(shè)計(jì)已成為現(xiàn)實(shí)。國(guó)際和國(guó)內(nèi)的眾多FPGA公司都具有這樣的芯片產(chǎn)品，并在通信、工業(yè)控制等領(lǐng)域具有廣泛的應(yīng)用。
- 關(guān)鍵字： 嵌入式系統(tǒng) FPGA SoC
基于FPGA的多功能數(shù)字鐘設(shè)計(jì)
- 文中簡(jiǎn)要介紹了一種基于FPGA的多功能數(shù)字鐘設(shè)計(jì)方案。在實(shí)現(xiàn)數(shù)字鐘計(jì)時(shí)、校時(shí)和整點(diǎn)報(bào)時(shí)等基本功能的基礎(chǔ)上增加世界時(shí)鐘功能，能夠?qū)⒈本r(shí)間快速轉(zhuǎn)換為格林威治標(biāo)準(zhǔn)時(shí)。該方案采用VHDL和原理圖相結(jié)合的設(shè)計(jì)輸入方式，在QuartusⅡ開(kāi)發(fā)環(huán)境下完成設(shè)計(jì)、編譯和仿真，并在FPGA硬件開(kāi)發(fā)板上進(jìn)行測(cè)試，實(shí)驗(yàn)證明該設(shè)計(jì)方案切實(shí)可行，對(duì)FPGA的應(yīng)用和數(shù)字鐘的設(shè)計(jì)具有一定參考價(jià)值。
- 關(guān)鍵字： FPGA 多功能 數(shù)字鐘設(shè)計(jì)
基于FPGA的多通道直流電機(jī)控制器設(shè)計(jì)
- 設(shè)計(jì)了一種基于FPGA的多通道直流電機(jī)控制系統(tǒng)，充分利用FPGA并行控制的特點(diǎn)，采用自項(xiàng)而下的設(shè)計(jì)方法，將系統(tǒng)劃分為轉(zhuǎn)速測(cè)量模塊，并行控制模塊，PWM生成模塊，電機(jī)驅(qū)動(dòng)模塊。采用Verilog HDL語(yǔ)言實(shí)現(xiàn)完成了對(duì)多通道直流電機(jī)的控制。通過(guò)Quartus II自帶仿真功能對(duì)系統(tǒng)進(jìn)行時(shí)序仿真表明系統(tǒng)結(jié)構(gòu)簡(jiǎn)單，且具有良好的功能擴(kuò)展性。
- 關(guān)鍵字： FPGA 多通道 直流電機(jī) 制器設(shè)計(jì)
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