- 日本DRAM大廠爾必達今天宣布，已經成功開發出4Gbit容量DDR3內存顆粒。這是目前市場上DDR3顆粒的最大容量，只需單面8顆即可組成 4GB容量內存條，雙面16顆即可構成單條8GB內存。該顆粒使用40nm CMOS工藝制造，相比同工藝的2Gb顆粒可節能30%。支持x4、x8、x16 bit位寬，其中x4/x8位寬版本采用78-ball FBGA封裝，x16bit產品采用96-ball FBGA封裝。除DDR3標準的1.5V電壓外，還可支持1.35V低壓標準。
爾必達計劃將該顆粒使用在單條32
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爾必達 40nm CMOS DDR3
- 低成本CMOS圖像傳感器對醫學技術的推動作用, 醫學技術一直是CCD(電荷耦合設備)圖像傳感器的重要應用領域之一。現在，CMOS傳感器已進入高速發展時期。究其原因，首先，CMOS圖像質量可與CCS圖像相媲美。其次，利用標準半導體制造工藝，CMOS傳感器在價格方面占據很
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CMOS 圖像傳感器 動作
- 象過去多年來一樣, 在今年的會上臺積電也爆出讓人感到驚奇的新工藝技術。它的新工藝路線圖, 包括CMOS,Analog,MEMS,RF等領域。以下是在一天的會中對于會議的觀察及感受;
1,Morris張去年79歲高令重新執掌臺積電, 那時正值全球IC業混亂時代, 它又重新揚帆啟航。但是在此次會上見到張時仍是如1990年首次見到它時那樣精力充沛而健談。更重要的是在公司經歷40nm的風波后,它似乎為客戶重塑了信心及在它的掌舵下公司又重新采取積極的投資, 研發與招工策略, 張認為至今年底公司將從今日的2
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臺積電 CMOS Analog MEMS RF
- 韓國三星電子宣布提高CMOS傳感器靈敏度的背面照射技術達到了實用化水平，2010年將批量生產產品。至此，三家大型...
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CMOS 傳感器
- 臺積電總裁張忠謀認為,雖然近期IC業的形勢越來越好, 但是產業還是面臨諸多挑戰。
在近期舉行的臺積電技術會上張忠謀表示,摩爾定律正在減緩和芯片制造成本越來越高，因此臺積電將比過去在芯片制造商與代工之間更加加強緊密合作。
它對于大家說,此種合作關系要從芯片設計開始, 并相信未來臺積電會做得更好。
它同時指出，加強合作要依技術為先。從技術層面, 那些老的，包括新的代工競爭者, 如GlobalFoundries,Samsung及UMC,對于臺積電都能構成大的威脅。
非常幸運, 大部分
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臺積電 20nm CMOS
- 提出了減小輸入電容的軌到軌電壓緩沖器。軌到軌操作不僅在電路的輸出端，同樣在電路的輸入端實現。所介紹電路的AB特性導致了低功耗和高的轉換速率，使它很適合驅動大的電容負載。仿真結果已經提供了該電路的操作。
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CMOS 低功耗 轉換速率 模擬
- 摘 要： 基于0.18 μm CMOS工藝，采用共源共柵源極負反饋結構，設計了一種3 GHz低噪聲放大器電路。從阻抗匹配及噪聲優化的角度分析了電路的性能，提出了相應的優化設計方法。仿真結果表明，該放大器具有良好的性能
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3GHz CMOS 低噪聲放大器 優化設計
- 這個電路是使用，CMOS集成電路CD4013雙D正反器，分別接成一個單穩態電路和一個雙穩態電路。單穩態電路的作用是對觸摸信號進行脈波寬度整形，保證每次觸摸動作都可靠。雙穩態電路用來驅動晶體管Q1的開通或關閉，進而控
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開關 觸摸 CD4013 集成 CMOS
- 摘要：分析了一種射頻COMS共源-共柵低噪聲放大器的設計電路，采用TSMC 90nm低功耗工藝實現。仿真結果表明：在5．6GHz工作頻率，電壓增益約為18．5dB；噪聲系數為1．78dB；增益1dB壓縮點為-21．72dBm；輸入參考三階交
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CMOS 5.6 GHz 低噪聲
- 概述：以CMOS探測器為記錄介質的數字化射線檢測技術，檢測精度高、溫度適應性好、結構適應性強。CMOS射線掃描探測器探測單元排成線陣列，需要在檢測時進行相對掃描運動，逐線采集并拼成完整的透照投影圖像。介紹了檢
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設計 應用 檢測 射線 探測器 CMOS
- 引言 近年語音集成電路獲得迅速發展，其應范圍越越廣，自動售貨機、ATM柜員機，部直通電話機以及玩具等方面應量語音合成芯片。該芯片部采脈寬調制，數字信號確還原成模擬信號，從而使得電路輸出端不需接D/A轉換；
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ASIC 設計 合成 語音 晶片 CMOS 基于
- DSP內嵌PLL中的CMOS壓控環形振蕩器設計,本文設計了一種應用于DSP內嵌鎖相環的低功耗、高線性CM0S壓控環形振蕩器。電路采用四級延遲單元能方便的獲得正交輸出時鐘，每級采用RS觸發結構來產生差分輸出信號，在有效降低靜態功耗的同時．具有較好的抗噪聲能力。在延遲單元的設計時。綜合考慮了電壓控制的頻率范圍以及調節線性度，選擇了合適的翻轉點。 仿真結果表明．電路叮實現2MHz至90MHz的頻率調節范圍，在中心頻率附近具有很高的調節線性度，可完全滿足DSP芯片時鐘系統的要求。
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振蕩器 設計 環形 CMOS 內嵌 PLL DSP
- 摘要：基于CSMCO．5μm CMOS工藝設計一種帶滯回功能的高穩定性電壓控制電路，利用遲滯比較器對旁路電壓和基準電壓進行比較并控制電容的充放電，提高了電壓的穩定性。Cadence Spectre仿真結果表明，該電路產生的電壓穩
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CMOS 音頻功率放大器 旁路 電壓控制
- Altera公司和Apical有限公司今天宣布，為視頻監控攝像機提供世界上第一個高清晰寬動態范圍(WDR) CMOS圖像傳感器處理解決方案。在內華達洲拉斯維加斯3月24號到26號舉行的國際安防大會(ISC)西部博覽會上，Altera展示了這一解決方案。Altera和Apical全面的解決方案保證了各種照明條件下優異的視頻圖像質量，而這是前幾代監控攝像機面臨的主要瓶頸問題。結合Altera的 Cyclone® III和Cyclone IV FPGA以及Apical的知識產權(IP)，這一解決方案
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Altera FPGA 視頻監控 CMOS
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