- 要實現能夠將所有重要功能集成在單一器件的設計理由很簡單，因為這樣就能將材料成本、部件庫存及電路板面積減至最低。另外，相較于多芯片解決方案，單芯片方案的功耗也較低，同時也有助于提高對知識產權的保護。如果一項設計功能的精髓能夠深植于單一芯片上，將會大大增加第三方取得這項設計的困難度。
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符合 需求 系統 真正 開發 混合 信號 FPGA 智能型 數字信號
- 除了語音連接之外，數字蜂窩無線網絡(如GSM和增強的GSM-EDGE)現在可以提供更高的數據傳輸速率，理論上可達到384...
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FPGA 4G系統
- 介紹一種面陣CCD傳感器TH7888A的原理和性能，分析其對驅動信號的時序要求，選用FPGA器件作為硬件設計平臺，使用VHDL語言對驅動信號時序進行硬件描述，針對Xilinx公司的Spartan3系列芯片進行仿真及配置；選用LM117提供CCD所需的偏置電壓，EL7212提供驅動。系統測試結果表明，該CCD驅動電路可以滿足CCD的工作要求。
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電路 設計 驅動 CCD FPGA 基于
- Altera公司今天發布宣布，第一季度銷售額達到4.023億美元，比2009年第四季度增長10%，比2009年第一季度增長52%。新產品銷售持續增長29%。今年第一季度凈收入達到1.532億美元，每股攤薄后收益為0.5美元，而2009年第四季度凈收入為1.03億美元，每股攤薄后收益0.34美元，2009年第一季度凈收入為0.44億美元，每股攤薄后收益0.15美元。
運營現金流為1.327億美元。Altera本季度末流動資金和短期投入達到17億美元。
Altera董事會宣布，每股0.05美元
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Altera FPGA 65nm 40nm
- 摘要：給出了兩路輸入信號AD轉換器AD7705與FPGA的接口應用方案，利用該方案可對工控領域后臺的溫度和電壓兩路信號進行實時監控。其中溫度信號是利用PT電阻值隨溫度變化的線性關系將溫度信號轉換為電壓信號，來實施采
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監控系統 設計 領域 工控 FPGA 基于
- FPGA協處理技術介紹及進展FPGA的架構使得許多算法得以實現，較之采用四核CPU或通用圖形處理器(GPGPU)，這些算法的持續性能更接近器件的峰值性能。隨著對芯片、算法和庫基礎的集中改進，FPGA加速器的基準測試結果不斷
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FPGA 處理技術
- 準確可靠的電壓測量在大學物理教學中具有重要意義。在研究目前主流電壓表設計方案的基礎上，提出一種基于FPGA技術的新型數字電壓表的設計方法，極大地增強了系統集成度和電路可靠性。以Altera公司高性價比的CycloneⅡ系列EP2C5T144芯片為控制核心，以較高性能的模／數轉換器為信號采集芯片，完成電壓數據的采集、轉換、處理、顯示，并實現了檔位的自動轉換和較寬的測量范圍。詳細討論儀表關鍵電路的設計思路以及關鍵算法的實現步驟。測試結果表明，該儀表測量誤差不大于O．02 V，具有較高的測量精度，滿足教學實驗中
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FPGA 新型數字 電壓表設計
- 愛特公司(Actel Corporation)宣布，Keil 公司旗下的MDK-ARM微控制器開發套件現已支持 SmartFusion™ 智能混合信號FPGA系列。
最新版本的Keil MDK-ARM開發套件支持SmartFusion 器件的ARM® Cortex™-M3 微控制器子系統 (MSS)，并包含設置文件、專用器件視圖和項目樣例。MDK開發套件備有業界標準的ARM 編譯器、Keil µVision4 集成開發環境、全功能RTX RTOS，以及
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Actel FPGA SmartFusion
- 采用Actel FPGA的TFT控制器技術設計方案, 在1970年，Fergason制造了第一臺具有實用性的LCD，從此之后，用戶產品的界面發生了巨大改變，變得更加的美觀、實用，在一定場合下逐漸取代傳統的數碼管、LED的顯示。TFT誕生于80年代末，在1995年之后被廣泛的應用，
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技術 設計 方案 控制器 TFT Actel FPGA 采用
- 基于FPGA的NoC驗證平臺的構建,針對基于軟件仿真片上網絡NoC(Network on Chip)效率低的問題，提出基于FPGA的NoC驗證平臺構建方案。該平臺集成可重用的流量產生器TG(Traffic Generation)，流量接收器TR(Traffic Receiver)以及NoC軟件，用于對NoC原型系統進行功能驗證和性能評估。實際設計一個多核NoC，并用該平臺對其進行FPGA驗證，結果表明該平臺的驗證速度比軟件仿真提高16 000倍以上，并能對多種不同結構、路由算法、流控策略的NoC進行功能驗
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平臺 構建 驗證 NoC FPGA 基于 數字信號
- 為了研究不同結構的FIR數字濾波器FPGA實現對數字多普勒接收機中FPGA器件資源消耗及其實現的濾波器的速度性能，在Xilinx ISE-l0．1開發平臺中，采用Verilog HDL語言分別實現了FIR數字濾波器的改進的串行結構、并行結構以及DA結構，并在ModelSim仿真驗證平臺中仿真了實現設計。結果表明，改進串行結構的實現消耗資源少但濾波速度慢，并行結構的實現濾波速度快但消耗資源多，而DA算法的實現速度僅取決于輸入數據的寬度，所以濾波速度通常較快且消耗的資源較少。
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實現 研究 FPGA 濾波器 數字 FIR 數字信號
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