在高速移動下，OFDM系統載波間正交性被破壞，出現載波間干擾(ICI)，嚴重影響系統性能，必須采用適當的均衡技術以補償ICI。為了保證通信的有效性和實時性要求，使用FPGA實現了一種低復雜度的最小均方誤差(MMSE)OFDM均衡器算法。在ISE軟件平臺上使用Verilog語言編寫程序，并在Xilinx公司Virtex-2實驗板(XC2V930芯片)上對設計進行了驗證。
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OFDM FPGA 移動 均衡器
摘要：基于FPGA的應用技術，采用Altera公司DE2-70開發板的CycloneⅡ系列EP2C70作為核心器件，設計了一種基于FPGA的新型可調信號發生器。通過QuartusⅡ軟件及Vetilog HDL編程語言設計LPM_ROM模塊定制數據ROM，并通過地
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FPGA 信號發生器
隨著數字技術的飛速發展，各種數字顯示屏也隨即涌現出來有led、LCD、DLP等，各種數字大屏幕的控制系統多種多樣，有用ARM+FPGA脫機控制系統，也有用PC+DVI接口解碼芯片+FPGA芯片聯機控制系統，在這里我們講述一種不僅
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圖像 顯示系統 系統 設計 大屏幕 LED FPGA 芯片 控制
摘要：在水下激光成像系統中，由于復雜的水下環境對激光傳輸的影響較大，為了更加有效地實現距離選通功能，該同步控制電路的設計選用高性能的Altera Stratix III系列的FPGA。電路分為距離延遲和門延遲2個模塊，創新地
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控制 電路設計 同步 距離 激光 成像 FPGA
基于NiosⅡ的SD卡驅動程序開發,摘要：提出一種在FPGA NiosⅡ軟核處理器下SD卡驅動設計的方法。采用Altera公司的FPGA可編程邏輯器件，構建了NiosⅡ軟核處理器平臺，并在此之上實現了SD卡的驅動設計。實驗結果表明：設計提高了FPGA系統的設計靈活度，
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程序開發 驅動 SD Nios 基于 FPGA ARM
全球可編程平臺領導廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )今天宣布推出其第四代部分可重配置設計流程，以及智能時鐘門控技術的多項全新強化方案，可針對Virtex™®-6 FPGA設計中BRAM(block-RAM)降低24%的動態功耗。設計人員即日起即可下載ISE12.2設計套件，利用其簡便易用、直觀的部分可重配置設計流程，進一步降低功耗和整體系統成本。同時，最新推出的ISE版本還可提供一項低成本仿真方案， 支持嵌入式設計流程。
賽靈思 ISE
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Xilinx FPGA ISE12.2
引言隨著FPGA技術的發展，出現了一種新概念的嵌入式系統，即SOPC（SystemOnProgrammableChip）。SOPC技...
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FPGA SOPC NOR Flash 嵌入式
美國賽靈思(Xilinx)發布了抗輻射性和性能均高于其原產品的航天領域用FPGA“Virtex-5QV FPGA”。將耐輻射總劑量(TID)提高到了該公司原產品的2倍以上之外，其規模也達到了13萬個邏輯單元，作為航天領域用FPGA中屬業界最高水準。此外，還集成了最高速度為3.125Gbit/秒的高速收發器，并強化了DSP功能。主要面向人造衛星和宇宙飛船上的遙感處理、圖像處理以及導航儀等用途。目前正在樣品供貨，將從2011年1～3月開始65nm工藝的量產。賽靈思表示：&ldquo
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Xilinx Virtex FPGA
帶服務能夠支持三重應用（即支持語音、視頻和數據）至第一英里的客戶，例如持續發展的小商業和住宅。FTTx中的...
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FPGA GPON 低功耗
DDR3存儲器系統可以大大提升各種數據處理應用的性能。然而，和過去幾代（DDR和DDR2）器件相比，DDR3存儲器器件...
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FPGA IP核 DDR3 數據處理
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