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        Synopsys宣布推出用于移動SoC的業界最低功耗PCI Express 3.1 IP解決方案

        作者: 時間:2015-06-12 來源:電子產品世界 收藏

          新思科技(,Inc)日前宣布:推出業界功耗最低的、兼容PCI Express®(PCIe®)3.1規范的控制器和PHY知識產權(IP)解決方案,它們可以同時極大地降低移動系統級芯片()的工作和待機功耗。經硅驗證的 DesignWare® PCIe 3.1 IP支持L1低功耗狀態,并采用電源開關、分段電源層以及低待機功耗等電源門控技術,使待機功耗低于10 uW/lane。此外,正常供電時,這種新型發送器設計和均衡旁路方案使工作功耗低于5mW/Gb/lane,同時還滿足了PCIe 3.1電氣規范。通過提供一種專為提供最低功耗而優化的PCIe控制器和PHY IP解決方案,使設計人員能夠把主要的功能集成到其之中,同時延長移動設備的電池續航時間。

        本文引用地址:http://www.104case.com/article/275638.htm

          “作為一家加入PCI-SIG已超過十年的成員,Synopsys一直在致力于PCIe技術的發展,”PCI-SIG主席兼總裁Al Yanes表示。“帶有低功耗PCIe架構的IP解決方案的產品,支持了移動領域的應用。”

          支持PCIe 3.1技術的DesignWare PHY IP超越了必需的PCIe通道性能,它采用了多鎖相環(MPLL)、前饋均衡(FFE)、連續時間線性均衡(CTLE)和可編程決策反饋均衡(DFE)等技術來提高高損耗和不穩定通道中的信號完整性。與分離式基準時鐘(Refclk)無關的擴展頻譜時鐘(SRIS)、參考時鐘轉發、PCI Express架構聚集和二分等功能為高速SoC提供了靈活性和可擴展性。PHY支持自動測試設備(ATE)的測試功能、小面積和可選的引線鍵合封裝等功能降低了整體BOM成本。

          作為完整解決方案的一部分,針對PCI Express 3.1規范的DesignWare控制器IP支持L1低功耗狀態、分段電源以及低待機功耗等功能,使待機模式中的漏電功耗降低高達95%,同時,其非常短的退出延遲,支持更短的喚醒時間。為了降低工作功耗,該控制器支持系統級電源管理功能,包括延遲容忍報告(LTR)、優化的緩沖器刷新/填滿(OBFF)和動態功率調整(DPA)。此外,Synopsys用于PCIe架構的驗證IP(VIP)與System Verilog源代碼測試套件結合在一起,可以支持低功耗場景的驗證。該VIP提供控制方式進出和切換低功耗子狀態。它監控低功耗的狀態,同時測試套件提供了一套專用的測試方法來驗證L1低功耗狀態的功能。

          “更多的功能、更快的性能和更長的電池壽命,正在驅動著消費電子市場中移動設備的演進發展,”Synopsys IP和原型營銷副總裁John Koeter表示。“通過為業界提供最低功耗的PCI Express IP解決方案,Synopsys正在幫助設計人員滿足當今移動應用的嚴苛技術要求,并縮短它們的上市時間。”

          供貨

          用于PCIe 3.1技術的低功耗DesignWare控制器和PHY IP現在已可以供貨。用于PCIe 3.1架構的驗證IP以及用于PCIe 3.1根組件和PCIe 3.1端點的DesignWare IP 原型設計套件現在也開始供貨。

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        關鍵詞: Synopsys SoC

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