【從零開始走進FPGA】路在何方——Verilog快速入門

　　一、關于HDL

　　1. HDL簡介

　　HDL ： Hardware Discription Language 硬件描述語言，即描述FPGA/CPLD內部邏輯門的工作狀態，來實現一定電路。

　　隨著EDA技術的發展，使用硬件語言設計PLD/FPGA成為一種趨勢。目前硬件描述語言有VHDL、Verilog、Superlog、System C、Cynlib C++、C Level等。 各種語言有各種優勢，根據業界應用而定。

　　2. VHDL和Verilog區別

　　在業界，VHDL和Verilog是主要的兩種硬件描述語言，主要區別如下：

　　(1)VHDL發展的較早，語法嚴格，而Verilog HDL是在C語言的基礎上發展起來的一種硬件描述語言,語法較自由。

　　(2)VHDL的書寫規則比Verilog煩瑣一些，但verilog自由的語法也容易讓少數初學者出錯。

　　(3)國內電子專業很多會在本科階段教授VHDL,但社會上Verilog應用的較多，這給初學者帶來了一定的苦難。

　　3. 其他

　　目前出現用于CPLD/FPGA設計的硬件C語言編譯軟件，雖然還不成熟，應用極少，但它有可能會成為繼VHDL和Verilog之后，設計大規模CPLD/FPGA的又一種手段如現在的Nios II ，便是HDL與SystemC 結合。等今后ARM嵌入FPGA之后，這種結合將會更加的密切。

　　同樣尚未完全盛行的SystemVerilog-2005，相當于在Verilog-2001語法上的進一步擴展，在語法和功能上的升級。目前更多的人傾向于應用Verilog-2001，尤其是某些老的工程師。

　　二、如何學習HDL

　　FPGA編程語言，淺顯易懂，屬于硬件描述語言。因為VHDL、Verilog屬于類C語言，學過C語言的人會很快。

　　Bingo電子生涯中，當年先學的也是C語言，之后開始開始學FPGA，用的是語法相對比較嚴謹的VHDL(當時沒進行教材改革，學校用的是VHDL)，一年后，因為交流、資料、以及將來工作等方面的需要，在幾天內轉向了Verilog，從此，他踏了不歸路。Bingo在此退學者學習Verilog，如果您是在校大學生，學校依舊安排您學VHDL，那另當別論。初學者可以找一個不錯的書，看一遍，抄幾個例程，玩玩流水燈(或者說看完本書的例程)，便能很快入門O(∩_∩)O~。

　　關于語法，本書中Bingo不想多做累贅的闡述。國內外教科書，知名網站，名人博客中都已經寫的清清楚楚。此處推介在線中文網站：http://www.fpga.com.cn/hdl.htm