Synopsys多協議DesignWare Enterprise 12G PHY IP

　　新思科技公司(Synopsys, Inc)日前宣布：其多協議DesignWare® Enterprise 12G PHY IP正式上市，該物理層知識產權(PHY IP)將使多樣化的高端網絡和計算應用在功耗降低的同時提升了性能。DesignWare Enterprise 12G PHY是專門為應對設計師們所面臨的不斷增長的性能/功耗平衡挑戰而設計，它使設計師能夠輕松地將各種企業級通信協議集成到他們的系統級芯片(SoC)上，包括PCI Express 3.0、SATA 6G、10GBASE-KR、10GBASE-KX4 (XAUI)、1000BASE-KX、CEI-6G/11G、SGMII、QSGMII、SFF-8431、CPRI、OBSAI和JESD204B等，，而使這些SoC具有比競爭性解決方案更高的性能同時功耗降低多達20%。

　　DesignWare Enterprise 12G PHY包括架構性的創新，以明顯地降低企業應用SoC的功耗。這種高性能模擬前端集成了在工作和待機兩種運行模式中的省電功能。該混合發送驅動器支持低功耗電壓模式和高擺幅電流模式，以及其它的可降低功耗的特性，如在驅動和決策反饋均衡(DFE)旁路模式下的L1子狀態、可選的I/ O電源。

　　高性能的DesignWare Enterprise 12G PHY支持從芯片到芯片、背板和端口側接口來確保復雜的系統集成。靈活的時鐘倍增器單元(CMU)包括多個鎖相環(PLL)，以便在包括老式系統這樣要求最嚴苛的應用中，穿過長而有損耗的背板傳輸從1.25 Gbps到12.5 Gbps的高質量數據。該模擬前端包括5級DFE(5-tap DFE)、連續時間線性均衡(CTLE)和前饋均衡(FFE)，并帶有先進的算法用于啟動和任務模式適應，以在高吞吐量通信通道中提升信號完整性。其帶有諸如參考時鐘轉發和PCI Express聚集及二分等先進功能的多通道架構，為設計師提供了一種用于各種高速SoC的靈活的、可擴展的PHY IP解決方案。

　　“作為一家加入PCI-SIG超過10年的成員，Synopsys在開發PCIe 技術方面已經扮演了一種重要的角色，”PCI-SIG主席兼總裁Al Yanes表示：“其對PCIe 3.0架構的支持有助于使PCI Express生態系統的不斷成功。”

　　“根據數據中心和云處計算的最新趨勢，在諸如軟件定義聯網和低功耗微服務器中，系統架構師正越來越多地在單個SoC中實現多個高帶寬通訊協議，”Synopsys公司IP和系統市場副總裁John Koeter評論道：“通過在我們多樣化的數據中心IP產品組合中增加DesignWare Enterprise 12G PHY IP，我們能夠幫助設計師更好地處理全新云計算架構中的性能和功耗問題。”

　　供貨

　　采用28納米工藝技術的DesignWare Enterprise 12G PHY IP已經開始供貨，采用14/16納米FinFET工藝技術的IP正在開發。Synopsys面向數據中心的DesignWare IP產品組合還包括用于40G/10G/1G以太網、DDR4/3、PCI Express 3.0/2.0、USB 3.0/2.0、SATA 6G和ARM® AMBA® AXI4™和 AMBA 3連接器的解決方案，邏輯庫與嵌入式存儲器;以及Synopsys ARC®處理器，上述所有的產品現在都已可供貨。

　　新思科技(Synopsys)是一家為各種SoC設計提供高質量并經硅驗證IP解決方案的領先供應商，其豐富的DesignWare IP產品系列包括完整的接口IP解決方案，如支持多個廣泛應用的協議的控制器、物理層IP(PHY)和驗證IP，模擬IP，各種嵌入式存儲器，邏輯庫，處理器內核和子系統。為了支持軟件開發及IP的軟硬件集成，Synopsys還為其多種IP產品提供驅動器、事務級模型和原型。Synopsys的 HAPS®基于FPGA的原型解決方案支持在系統環境中驗證IP和SoC。Synopsys的Virtualizer虛擬原型工具箱使開發人員能夠比傳統方法提前很多就開始為IP或者整個SoC開發軟件。憑借一種穩健的IP開發方法學，以及在質量、IP原型、軟件開發及綜合性技術支持等領域內的大力投入，Synopsys使設計師能夠加快產品的上市并減小集成風險。