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        基于FPGA的多路視頻通道控制

        作者: 時間:2010-06-29 來源:網絡 收藏
        其中,clk為13.5 MHz頻率的時鐘信號,clk_cnt為采樣時間間隔計數器,當clk_cnt為135 000時采樣1次,即每隔10 ms采樣1次。寄存器shuru_temp存儲前一次開關信號狀態,shum存儲當前開關信號狀態。如果shuru_temp的值等于shtlm的值,則計數器test_cnt自動加l。如果連續4次采樣值相等,即test_cnt=4時去抖動輸出才隨輸入變化。
        用電平撥動開關信號作為輸入,制作了一個脈沖信號用于識別開關動作,其代碼如下:

        代碼中寄存器level_contrl_TEMP存儲level_contrl延時256個時鐘周期后的信號,然后用level_eontrl_TEMP中存儲的信號與level_co-ntrl的值相異或產生所需要的脈沖信號。
        調試中發現,去抖動后的信號經常混有持續時間很短的高頻脈沖干擾信號,因此設計中使用兩級D觸發器延時來徹底消除高頻脈沖干擾,其程序代碼如下:

        2.2 雙口RAM及開關信號編碼設計
        雙口RAM分為真、假2種雙口。真雙口2個端口都可以讀寫,互不干擾。本次設計根據實際需要,添加的RAM模塊一端只讀,另一端只寫,讀寫互不干擾。根據上述分析可知,開關控制信號只能知道有開關控制動作發生,但是不能識別具體哪個開關發生了動作。因此,設計中首先利用MegaWizardPlug_In Manager中的宏功能塊RAM:2_PORT產生1個雙口RAM存儲塊,然后對這個宏功能模塊的參數進行適當調整,產生一個滿足自己特定要求的模塊,如圖5所示。


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