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        PCI總線從設備接口的CPLD實現

        作者: 時間:2012-02-17 來源:網絡 收藏

        2.1 狀態機
        狀態機是整個接口設計的控制核心,它控制著交易時序和控制信號的產生,文中結合規范的要求,使用Verilog HDL語言、采用One—hot編碼方式設計了全同步狀態機,狀態機由表3所列的8個狀態組成,狀態機狀態轉移圖如圖2所示。

        本文引用地址:http://www.104case.com/article/190766.htm

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        PCI目標狀態機狀態轉移有以下幾種情形:
        (1)Idle→B_busy→Idle,地址譯碼未被選中,則處于B_busy忙狀態等待交易結束,直到FRAME#失效當前總線交易結束才返回Idle。
        (2)Idle→B_busy→Wait→Backoff→Turn_ar→Idle,未能在16個時鐘周期內準備好第一個傳輸數據,超時重試(RETRY)斷開連接,總線停留在Backoff等待總線撤消FRAME#,然后總線釋放返回空閑態。
        (3)Idle→B_busy→Wait→(R_wait)→L_data→(Backoff)→Turn_ar→Idle,從設備同時有效Ready和Term信號,表明從設備不支持突發傳輸或者沒有更多的數據存儲空間進行突發傳輸,只能進行最后一個數據交易。如果是讀交易,則插入讀等待狀態R_wait。
        若訪問為突發訪問,當惟一的數據期完成以后,總線停留在Backoff狀態等待主設備無效FRAME#,然后交易結束。
        (4)Idle→B_busy→Wait→(R_wait)→Data→(L_data)→(Backoff)→Turn_ar→Idle,突發數據交易,讀交易則插入讀等待狀態R_wait。若從設備提出終止,則插入L_data和Backoff狀態與主設備斷開連接;若是主設備提出終止則正常的結束總線交易。
        在設計中,配置訪問不支持突發傳輸,總線時序和情形(3)一致;而內存訪問支持突發傳輸,情形(3)和(4)的時序均會出現。用戶應用可以通過Ready和Term信號不同的輸入組合來控制狀態機的狀態轉移,如表4所示。但是在本設計中的順序要么是先等待,然后正常數據交易、正常結束或者提出斷開連接;要么是先等待,然后重試直接斷開連接,只有這兩種順序,用戶應用不能在正常數據交易期中再插入等待狀態,這是不允許的。

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        關鍵詞: CPLD PCI 總線 設備

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