1 引言
輪式移動機器人是機器人研究領域的一項重要內容.它集機械、電子、檢測技術與智能控制于一體。在各種移動機構中,輪式移動機構最為常見。輪式移動機構之所以得到廣泛的應用。主要是因為容易控制其移動速度和移動方向。因此.有必要研制一套完整的輪式機器人系統。并進行相應的運動規劃和控制算法研究。筆者設計和開發了基于5l型單片機的自動巡線輪式機器人控制系統。
2 控制系統總體設計
機器人控制系統由主控制電路模塊、存儲器模塊、光電檢測模塊、電機及舵機驅動模塊等部分組成,控制系統的框圖如圖1所示
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AT89S52 CPLD
本文提出了一種采用VHDL硬件描述語言設計新型三相正弦脈寬調制(SPWM)波形發生器的方法。該方法以直接數字頻率合成技術(DDS)為核心產生三相SPWM信號。并且利用VHDL設計了死區時間可調的死區時間控制器,解決了傳統的模塊電路等待方法很難產生帶精確死區時間控制的SPWM信號的問題。該方法在Quartus II 9.1環境平臺下進行了仿真驗證,并將設計程序下載到DE2-70實驗板進行實驗測試,用示波器測試得到了死區時間可控制的SPWM波形。
關鍵字:
VHDL SPWM DDS 死區時間 FPGA 201505
導讀:本文系統講解了FPGA是什么及其結構、原理、生產廠家等內容,敬請閱讀~~
一、FPGA是什么- -簡介
FPGA,是Field Programmable Gate Array的簡稱,中文名稱為現場可編程門陣列,是一種可編程器件,是在PAL(可編程邏輯陣列)、GAL(通用陣列邏輯)、CPLD(復雜可編程邏輯器件)等傳統邏輯電路和門陣列的基礎上發展起來的一種半定制電路,主要應用于ASIC(專用集成電路)領域,既解決了半定制電路的不足,又克服了原有可編程器件門電路數有限的缺點。
二、FP
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FPGA CPLD FPGA是什么
隨著現代電子技術的發展,帶有各種微處理的現代電子設備已廣泛應用于國民生產的各行各業中。但隨著設備功能越來越強大,程序結構越來越復雜,指令代碼越來越長,加之現場工作環境的干擾,設備失控,程序“走飛”,各功能模塊“死機”的概率也同樣成倍地增加。對此,常見的解決方法是在電路設計時放置一片硬件看門狗(Watchdog)電路,其目的是在系統“走死”后能強制系統復位并返回初始化程序。隨著CPLD器件被廣泛應用于各種儀器、儀表設備的設計中,而且
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CPLD 看門狗
引言
在以單片機、DSP等處理器為核心的數字系統中,看門狗是不可缺少的一部分,特別是在對可靠性要求極高的系統中,如箭上伺服控制器,由于箭體內強弱電交叉使用,或者地面測試環境復雜多變,會產生諸多干擾和輻射。它們的沖擊會使CPU在執行指令時的地址碼或操作碼發生變化,甚至將操作數作為操作碼執行,導致程序跑飛。為使系統在規定時間內重新正常工作,一種有效的措施是采用硬件看門狗技術。
本設計的最初思路來源:實現高可靠性數字伺服控制器軟、硬件看門狗的雙冗余設計要求,目前缺少軍品級國產化硬件看門狗器件,在
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CPLD DSP
電動車由于具有無廢氣污染、無噪音、輕便美觀等特點,受到眾多使用者的青睞。但使用中也暴露出它的局限性,那就是蓄電池的容量決定了它的使用范圍,而且存在充電時間長的缺點。目前隨著電動自行車的發展,急需解決的問題就是如何實現快速靈活的充電。
隨著電子技術、可編程邏輯器件(FPGA,CPLD)、EDA技術的飛速發展,基于硬件編程語言的自上而下(TOP-TO-DOWN)設計方法給數字系統的開發設計帶來了革命性變革,僅使用單片機來實現系統控制的傳統方法正在被越來越多的以MCU+FPGA/CPLD為核心的最新設
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SPCE061A CPLD
引 言
FPGA 即現場可編程邏輯陣列。是在CPLD 的基礎上發展起來的新型高性能可編程邏輯器件。FPGA的集成度很高,其器件密度從數萬門到數千萬門不等,可以完成極其復雜的時序與組合邏輯電路功能,適用于高速、高密度的高端數字邏輯電路設計領域。新一代的FPGA 甚至集成了中央處理器( CPU ) 或數字處理器( DSP) 內核,在一片FPGA 上進行軟硬件協同設計,為實現片上可編程系統( SOPC) 提供了強大的硬件支持。對微型打印機的驅動,傳統方法是使用單片機是實現對其的時序控制。隨著FPGA
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FPGA VHDL
“數字電視機頂盒”,它是一種將數字電視信號轉換成模擬信號的變換設備,它對經過數字化壓縮的圖像和聲音信號進行解碼還原,產生模擬的視頻和聲音信號,通過電視顯示器和音響設備給觀眾提供高質量的電視節目。它采用了兼容的辦法,在中國一直延續到現在。本文介紹了幾種數字電視機頂盒的設計和使用,供大家參考。
數字電視機頂盒導航式操作系統設計方案
本文對機頂盒各項業務和操作功能進行模塊化細分歸類,借鑒目前主流消費電子產品操作系統的模式,采用導航式操作系統,在主菜單上使用M×
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SDRAM CPLD
VHDL是隨著可編輯邏輯器件(PLD)的發展而發展起來的一種硬件描述語言。它是1980年美國國防部VHSIC(超高速集成電路)計劃的一部分,并于1986年和1987年分別成為美國國防部和IEEE的工業標準。作為一種硬件設計時采用的標準語言,VHDL具有極強的描述能力,能支持系統行為級、寄存器傳輸級和門級三個不同層次的設計,這樣設計師將在TOP-DOWN設計的全過程中均可方便地使用同一種語言。而且,VHDL設計是一種“概念驅動式”的高層設計技術,設計人員毋需通過門級原理圖描述電路
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VHDL
心率監控器是一款用于監測人體心跳速率的器件。心率的單位是bpm(每分鐘心跳數)。人體的心跳速率根據其日常身體活動、睡眠和基本健康狀況的不同而有所差別。本文為大家介紹幾種心率計及心率監測系統的設計,供大家使用參考。
基于EFM32TG840的便攜式心率計的設計方案
在消費電子領域,便攜式電子產品由于體積小、質量輕的特點越來越受到消費者的喜愛,已成為人們生活中不可缺少的部分?;谶@個思路,我們設計了一款便攜式心率計,它可以替代用脈搏聽診器等進行測量的傳統方法,使用非常方便。
一種便攜式單
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FPGA VHDL
ISE是使用XILINX的FPGA的必備的設計工具。它可以完成FPGA開發的全部流程,包括設計輸入、仿真、綜合、布局布線、生成BIT文件、配置以及在線調試等,功能非常強大。本文為您提供有關ISE的相關技術文獻,相信讀完之后一定會使您對ISE有一個更深刻的了解。
FPGA設計開發軟件ISE使用技巧之:ISE軟件簡介
ISE是集成綜合環境的縮寫,它是Xillinx FPGA/CPLD的綜合性集成設計平臺,該平臺集成了設計、輸入、仿真、邏輯綜合、布局布線與實現、時序分板、芯片下載與配置、功率分析
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Xillinx CPLD
現場可編程門陣列(FPGA)作為專用集成電路(ASIC)領域的一種半定制電路,可以根據設計的需要靈活實現各種接口或者總線的輸出,在設備端的通信產品中已得到越來越廣泛的使用。FPGA是基于靜態隨機存儲器(SRAM)結構的,斷電后程序丟失后的每次上電都需要重新加載程序。且隨著FPGA規模的升級,加載程序的容量也越來越大,如Xilinx公司的Spartan - 6系列中的6SLX150T,其加載容量最大可以達到4.125 MB.
1 FPGA常用配置方式
FPGA的配置數據通常存放在系統中的存儲
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CPLD FPGA modelsim
圖像傳感器,或稱感光元件,是一種將光學圖像轉換成電子信號的設備,它被廣泛地應用在數碼相機和其他電子光學設備中。早期的圖像傳感器采用模擬信號,如攝像管(video camera tube)。如今,圖像傳感器主要分為感光耦合元件(charge-coupled device, CCD)和互補式金屬氧化物半導體有源像素傳感器(CMOS Active pixel sensor)兩種。本文介紹基于CMOS或CCD兩種圖像傳感器的應用及技術文獻,供大家參考。
基于USB傳輸及CMOS圖像傳感器的指紋識別儀的實
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Verilog HDL QuartusⅡ VHDL
接觸式圖像傳感器CIS( CONTACT Image SENSOR )是繼CCD之后于20世紀90年代研究和開發的一種新型光電耦合器件[1]。它將光電傳感陣列、LED光源陣列、柱狀透鏡陣列、移位寄存器和模擬開關等集成在一個條狀方形盒內,其工作原理與CCD較為相似,但與CCD相比,CIS具有體積小、價格低、結構簡單、安裝方便等優點,目前在傳真機、掃描儀及條碼*器等領域可完全取代CCD圖像傳感器。
本文介紹一種基于復雜可編程邏輯器件CPLD(Complex Programmable LOGIC DE
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CPLD DSP 圖像傳感器
在當前圖像傳感器市場,CMOS傳感器以其低廉的價格得到越來越多消費者的青睞。在目前的應用中,多數采用軟件進行數據的讀取,但是這樣無疑會浪費指令周期,并且對于高速器件,采用軟件讀取在程序設計上、在時間配合上有一定的難度。因此,為了采集數據量大的圖像信號,本文設計一個以CPLD為核心的圖像采集系統,實現了對OV7110CMOS圖像傳感器的高速讀取,其讀取速率可達8 Mb/s。
1、硬件電路方案
圖1為基于CPLD的OV7110CMOS圖像傳感器的高速數據采集系統原理框圖,他主要由2個部分組成:
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CPLD CMOS OV7110
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