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如何利用FPGA進(jìn)行時序分析設(shè)計(jì)
- FPGA(Field-Programmable Gate Array)，即現(xiàn)場可編程門陣列，它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。對于時序如何用FPGA來分析與設(shè)計(jì)，本文將詳細(xì)介紹。 基本的電子系統(tǒng)如圖 1所示，一般自己的設(shè)計(jì)都需要時序分析，如圖 1所示的Design，上部分為時序組合邏輯，下部分只有組合邏輯。而對其進(jìn)行時序分析時，一般都以時鐘為參考的，因此一般主要分析
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SMIC創(chuàng)始人張汝京離開新昇半導(dǎo)體，去向不明
- 6月10日，上海新昇半導(dǎo)體官方微信發(fā)布消息宣布，張汝京博士決定于2017年6月30曰為止不再擔(dān)任新昇總經(jīng)理職務(wù)，但繼續(xù)擔(dān)任新昇董事。王福祥先生也決定不再出任董事長，但同時還將繼續(xù)擔(dān)任董事職務(wù)。 新昇官方表示，新昇能夠快速發(fā)展到今天的程度，兩位先生功不可沒。當(dāng)年在大硅片項(xiàng)目缺乏投資之時，是王福祥先生挺身而出，成為新昇的創(chuàng)立者之一，并帶領(lǐng)新昇逐步發(fā)展成為一個越來越成 熟的公司，如今新昇的美好前景已經(jīng)吸引眾多投資者紛至沓來。 張汝京博士為新昇作出了偉大的貢獻(xiàn)，他領(lǐng)導(dǎo)新昇團(tuán)隊(duì)在創(chuàng)紀(jì)錄的時間內(nèi)建成了
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如何采用SystemVerilog來改善基于FPGA的ASIC原型
- ASIC在解決高性能復(fù)雜設(shè)計(jì)概念方面提供了一種解決方案,但是ASIC也是高投資風(fēng)險的,如90nm ASIC/SoC設(shè)計(jì)大約需要2000萬美元開發(fā)成本.為了降低成本,現(xiàn)在可采用FPGA來實(shí)現(xiàn)ASIC.但是,但ASIC集成度較大時,需要幾個FPGA來實(shí)現(xiàn),這就需要考慮如何來連接ASIC設(shè)計(jì)中所有的邏輯區(qū)塊.采用SystemVerilog,可以簡化這一問題.
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ASIC中的異步時序設(shè)計(jì)
- 絕大部分的ASIC設(shè)計(jì)工程師在實(shí)際工作中都會遇到異步設(shè)計(jì)的問題，本文針對異步時序產(chǎn)生的問題，介紹了幾種同步的策略，特別是結(jié)繩法和異步FIFO的異步比較法都是比較新穎的方法。
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在選用FPGA進(jìn)行設(shè)計(jì)時如何降低功耗
- 傳統(tǒng)意義上，ASIC和CPLD是低功耗競爭中當(dāng)仁不讓的贏家。但是由于相對成本較高，且用戶對高端性能和額外邏輯的要求也越來越多，在低功耗應(yīng)用中使用CPLD正在失去優(yōu)勢。ASIC也面臨相同的風(fēng)險。而例如FPGA這樣日益增長的可編程半導(dǎo)體器件正逐步成為備受青睞的解決方案。
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中芯國際將進(jìn)入發(fā)展快車道 馬凱副總理再訪SMIC
- 5月18日下午，中共中央政治局委員、國務(wù)院副總理、國家集成電路領(lǐng)導(dǎo)小組組長馬凱，國務(wù)院副秘書長丁學(xué)東，工業(yè)和信息化部部長、黨組書記苗圩等領(lǐng)導(dǎo)一行蒞臨中芯國際北京公司視察指導(dǎo)。北京市委常委、副市長陰和俊陪同調(diào)研。中芯國際董事長周子學(xué)博士、CEO趙海軍博士等公司高層予以熱情接待。 馬凱副總理一行參觀了中芯國際北京公司展廳，并進(jìn)入中芯B2工廠參觀了目前國內(nèi)最先進(jìn)的12英寸全自動化生產(chǎn)線。 董事長周子學(xué)博士做了關(guān)于中國集成電路產(chǎn)業(yè)現(xiàn)狀、中芯國際近年來取得成績、面臨挑戰(zhàn)、未來規(guī)劃的工作匯報(bào)，并代表公
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ASIC設(shè)計(jì)中不可忽視的幾大問題
- ASIC的復(fù)雜性不斷提高，同時工藝在不斷地改進(jìn)，如何在較短的時間內(nèi)開發(fā)一個穩(wěn)定的可重用的ASIC芯片的設(shè)計(jì)，并且一次性流片成功，這需要一個成熟的ASIC的設(shè)計(jì)方法和開發(fā)流程。 本文結(jié)合NCverilog，DesignCompile，Astro等ASIC設(shè)計(jì)所用到的EDA軟件，從工藝獨(dú)立性、系統(tǒng)的穩(wěn)定性、復(fù)雜性的角度對比各種ASIC的設(shè)計(jì)方法，介紹了在編碼設(shè)計(jì)、綜合設(shè)計(jì)、靜態(tài)時序分析和時序仿真等階段經(jīng)常忽視的問題以及避免的辦法，從而使得整個設(shè)計(jì)具有可控性。
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德意志銀行：SMIC 28nm將面臨回報(bào)率、價格及毛利三重考驗(yàn)
- 近期，中國最大晶圓制造商中芯國際(SMIC)積極宣示在 2017 年中將沖刺 28 納米制程，并且進(jìn)一步擴(kuò)張產(chǎn)能。但是，從日前所提出的財(cái)報(bào)顯示，其 2016 年第 4 季的 28 納米制程營收，僅占整體營收的 3.5%，相較晶圓制造龍頭臺積電 2016 年財(cái)報(bào)中所揭露，臺積電 28 納米以下先進(jìn)制程占據(jù)晶圓代工營收的 56%，其中 16/20 納米制程、28 納米制程各占營收的比重為 31%、25% 的情況來說，外資認(rèn)為，中國發(fā)展高階制程還有一段長的路要走。 就全球市場來觀察，根據(jù)統(tǒng)計(jì) 2016
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SMIC采用Synopsys的StarRC作為其寄生參數(shù)提取的標(biāo)準(zhǔn)解決方案
- 中芯國際集成電路制造有限公司(SMIC，紐約證券交易所代碼：SMI，香港聯(lián)合交易所代碼：981)是中國最大、最先進(jìn)的半導(dǎo)體代工廠，也是世界最大的代工廠之一。中芯國際與新思科技(Synopsys, Inc.，納斯達(dá)克股票市場代碼：SNPS)今日宣布，中芯國際已采用新思科技的StarRC™產(chǎn)品作為其28nm工藝技術(shù)的寄生參數(shù)提取的標(biāo)準(zhǔn)解決方案。這一標(biāo)準(zhǔn)化是SMIC和Synopsys不斷加深合作的結(jié)果，可為共同的客戶提供最佳的解決方案，滿足他們不斷增長的對先進(jìn)節(jié)點(diǎn)上的準(zhǔn)確性、性能和效率的要求。S
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便攜式數(shù)據(jù)采集系統(tǒng)中ADC的選用指南
- 真實(shí)世界的應(yīng)用需要真實(shí)世界的物理連接，一般來說，這意味著模擬信號要在系統(tǒng)內(nèi)的某處被數(shù)字化處理，以便于微處理器、ASIC或FPGA采集數(shù)據(jù)并做出決策。基本選用標(biāo)準(zhǔn)當(dāng)選擇一款模擬數(shù)字轉(zhuǎn)換器(ADC)時，大多數(shù)設(shè)計(jì)師似
- 關(guān)鍵字： 模數(shù)轉(zhuǎn)換器 SPI ASIC ADC
SMIC擴(kuò)產(chǎn)利好，DRAM推高2016半導(dǎo)體增長預(yù)測
- 據(jù)ICInsight的最新預(yù)測，2016年全球半導(dǎo)體業(yè)的增長率將是1%，之前的預(yù)測為下降2%。它的最新預(yù)測為2016年增長1%，及2017年增長4%，而2016年IC unit(出貨量)由之前預(yù)測增加4%，上升至6%。 IC Insight修正預(yù)測的原因是DRAM的價格將止跌回升。如DDR3 4Gb的價格由2014.10月的32.75美元，下降到2016.6月的12.5美元，幅度達(dá)62%。如今由于智能手機(jī)及PC對于DRAM的容量需求上升，導(dǎo)致市場缺貨，價格止跌回升。三星等又重新開始擴(kuò)大投資，增加
- 關(guān)鍵字： SMIC DRAM
常見問題解答：賽靈思采用首個ASIC級UltraScale可編程架構(gòu)
- 1. 賽靈思將在2013年7月10日宣布推出什么產(chǎn)品？ 賽靈思宣布20nm兩項(xiàng)新的行業(yè)第一，延續(xù)28nm工藝節(jié)點(diǎn)上一系列業(yè)界創(chuàng)新優(yōu)勢： middot; 賽靈思宣布開始投片半導(dǎo)體行業(yè)首款20nm器件以及投片PLD行業(yè)首款20nm All
- 關(guān)鍵字： UltraScale ASIC 賽靈思 可編程
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