在當今競爭激烈的形勢下，使富含嵌入式軟件的復雜電子設備更快面市，但是同時確保其更便宜更可靠，是一種相當冒險的做法。未經徹底測試的硬件設計不可
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智能硬件 半導體芯片 soc
前言 在過去的幾年里，我們目睹了數據的一系列巨大變化，包括數據如何被生成、處理以及進一步利用以獲取額外的價值和智能，而這些變化都受到以深度學習和神經網絡應用為基礎的新興計算模式所影響。這種深刻的變化始于數據中心，其利用深度學習技術來提供對海量數據的洞察，主要用于分類或識別圖像、支持自然語言處理或語音處理，或者理解、生成或成功學習如何玩復雜的策略游戲。這種變化催生了一批專門針對這些類別的問題而設計的高功效計算設備(基于GP-GPU和FPGA)，后來還產生了可完全定制的ASIC，進一步加速并提高了基于深
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RISC-V FPGA
北京時間7月2日晚間消息，高通公司日前宣布，旗下子公司“高通技術國際有限公司”推出了一款閃存可編程的藍牙音頻系統級芯片(SoC)QCC 3026?！ CC 3026專為無線Qualcomm TrueWireless耳機設計。與前一代入門級閃存SoC相比，新產品能耗最多可降低50%?！ ≡诖酥埃咄ㄔ诮衲甑腃ES展會上發布了低功耗藍牙系統級芯片QCC5100。該產品大幅提高了無線耳塞的處理性能，接收效率，還能大幅降低電池功耗，備受好評?！ 〈舜瓮瞥龅腝CC3026 SoC針對手機廠商而設計，其主要特
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高通，SoC
6月24日-27日，全球芯片設計及半導體知識產權(IP)領域內最負盛名的“設計自動化大會(DAC)”將在舊金山舉行，每年的DAC都吸引了來自全球的EDA工具廠商、IP廠商和芯片設計師參加。作為該項活動的第55屆，組委會公布本屆大會為一些新的技術擴展了展覽面積并新增了研討話題，包括人工智能與機器學習、汽車和物聯網等等。但是值得大家關注的還有一個新的領域：RISC-V開源硬件?！ 」雀琛⒏咄ā⑷?、華為、特斯拉……隨著越來越多的行業巨頭加入RISC-V基金會(RISC-V Foundation)，RISC
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RISC-V EDA
地點：中國上海市楊浦區五角場邯鄲路220號復旦大學邯鄲校區光華樓吳文政報告廳，200433 時間：2018年6月30日(星期六)，上午8點 - 下午6點 活動介紹：RISC-V基金會將于上海舉辦RISC-V Day，介紹其全球會員的最新項目及其實施進展，重點聚焦RISC-V生態系統在亞洲地區的發展。RISC-V基金會的企業成員晶心科技、Codasip、GreenWaves科技、ICT、Microsemi、SiFive和Syntacore將在上海RISC-V Day進行演講?！ ⊙葜v日程： · 面
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RISC-V，AIoT
UltraSoC和Imperas今日宣布：雙方將達成一項廣泛的合作，為多核系統級芯片(SoC)開發人員提供結合了嵌入式分析技術和虛擬平臺技術的強大組合。根據協議條款，UltraSoC將把Imperas開發環境的關鍵元素納入其提供的工具中，從而為設計人員提供一個統一的系統級預處理和后處理芯片開發流程，顯著地縮減了產品開發時間和整體開發成本?！ ⊥ㄟ^結合半導體知識產權(IP)和相關軟件，UltraSoC提供行業領先的獨立片上監測、分析和調試技術。Imperas首創的虛擬平臺方法使得軟件開發人員能盡早啟動S
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UltraSoC RISC-V
美國，加利福利亞州，圣何塞， 2018年6月20日—今日，NetSpeed Systems宣布推出業界首款以人工智能為基礎的SoC芯片內部互連解決方案Orion AI。該方案支持多播與廣播等先進特性，能極大提升人工智能SoC與加速器ASIC的性能與效率，可廣泛應用于數據中心、自動駕駛、AR/VR，以及先進視頻分析。Orion AI由NetSpeed經過硅驗證的Orion IP構建而成，這些Orion IP已經授權給地平線機器人、寒武紀、百度以及Esperanto等領先的人工智能公司。 NetSpee
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NetSpeed SoC
雖然系統級芯片(SoC)的架構師們已了解嵌入式FPGA(eFPGA)內核能如何為他們的ASIC/SoC設計增加價值，甚至是在規劃出一個具體應用之前就了解，但可能還不清楚如何開始進行一次評估。Achronix將該階段稱為準備階段或者Phase Zero——這是一個客戶去規劃其應用概念的評估期，客戶可以通過使用Achronix的工具和模型來對這些概念進行測試?！ ∫韵率且环N非常實用的方法，可以幫助設計人員去決定eFPGA是否是其下一代SoC的正確選擇?！ 槭裁磿紤]使用eFPGA 設計人員通常會遇到各
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eFPGA SoC
移動電源的發展路線，由早期的MCU+電源的方案結構，隨著市場的成熟而慢慢轉變為SoC集成化。與之類似，無線充電行業勢必也會淘汰落后的MCU方案，走上相同的SoC發展路線。
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SoC 無線充電
UltraSoC日前宣布：公司的嵌入式分析知識產權(IP)產品已獲Esperanto Technologies選用，以實現大規模并行多核RISC-V系統級芯片(SoC)的開發。 Esperanto現在正將UltraSoC的嵌入式分析和調試技術整合至其高性能、高能效的“單芯片A.I.超級計算機(A.I. Supercomputer on a Chip)”中，該超級計算機擁有數千個64位RISC-V內核，以支持人工智能(AI)和機器學習(ML)領
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UltraSoC RISC-V
楷登電子(美國Cadence公司)今日宣布，瑞昱半導體股份有限公司(Realtek Semiconductor Corp.)將 Cadence? Innovus? 設計實現系統用于其最新 28nm 數字電視(DTV)系統級芯片的研發并成功流片，同時成功縮小了芯片面積并降低了功耗。除了改善結果質量(QoR)之外，Innovus 設計實現系統容量更高，可支持實現更大的頂層模塊，降低 SoC 頂層設計的分割區
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Cadence SoC
UltraSoC日前宣布：亞洲領先且成熟的中央處理器半導體知識產權(CPU IP)供應商晶心科技(Andes Technology)已采用UltraSoC先進的嵌入式分析技術，來支持其AndesCore系列RISC-V處理器。晶心科技將利用UltraSoC包括業界唯一商用RISC-V處理器追蹤解決方案在內的獨一無二的IP產品系列，來實現其復雜應用嵌入式產品的開發加速和調試增強，這些應用包括人工智能(AI)、計算機視覺、網絡控制器和存儲等?！ 杉夜緦y手在即將舉行的RISC-V大
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UltraSoC RISC-V
引言：2018年4月11日，工業和信息化部、公安部和交通運輸部聯合發布“關于印發《智能網聯汽車道路測試管理規范(試行)》的通知”，為我國智能網聯汽車道路測試提供了相關法律依據。三部委在賦予智能網聯汽車上路資格的同時，也提出了若干嚴格的條件?！ ∑渲?，在第二章“測試主體、測試駕駛人及測試車輛”的第七條第(四)點中，三部委要求：具備車輛狀態記錄、存儲及在線監控功能，能實時回傳下列第1、2、3項信息，并自動記錄和存儲下列各項信息在車輛事故或失效狀況發生前至少90秒的數據，數據存儲時間不少于3年： 1.&n
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eFPGA SoC
Arm宣布推出一套基于PSA規范的全新物聯網解決方案——Arm SDK-700系統設計套件，以用于加速安全SoC的開發。作為一套綜合的SoC系統框架，使用 Arm SDK-700系統設計套件可設計安全的SoC，并應用于豐富多樣的IoT節點、網關設備和嵌入式產品。該解決方案不僅使合作伙伴能夠在通用軟件開發環境中打造安全設備，同時還使其業務的多樣性和差異化可以在新的物聯網應用中蓬勃發展?！ rm是物聯網的首選架構，迄今為止已為1250億芯片提供了計算能力。公司有一個宏大的愿
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