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精確時(shí)鐘同步確保IP網(wǎng)電信級特性

回顧以太網(wǎng)同步技術(shù)的發(fā)展，我們曾在以太網(wǎng)上用過互聯(lián)網(wǎng)網(wǎng)絡(luò)時(shí)間協(xié)議NTP(Network Time Protocol)技術(shù)，簡單網(wǎng)絡(luò)時(shí)間協(xié)議SNTP(Simple Network Time Protocol)技術(shù)，GPS技術(shù)或用T1/E1和以太網(wǎng)組成混合網(wǎng)絡(luò)來增加以太網(wǎng)
關(guān)鍵字：電信特性 IP 確保時(shí)鐘同步精確

集成了FPGA架構(gòu)、硬核CPU子系統(tǒng)以及其他硬核IP的半導(dǎo)體器件SoCFPGA已經(jīng)發(fā)展到了一個(gè)“關(guān)鍵點(diǎn)”，它在今...
關(guān)鍵字： SoC FPGA 硬核 IP 嵌入式系統(tǒng) Altera

近年來，模擬視頻監(jiān)控系統(tǒng)的市場份額在不斷縮水，正如人們所期望的，IP視頻監(jiān)控逐漸深入人心。確實(shí)，IP視頻監(jiān)控解決了傳統(tǒng)監(jiān)控布線繁瑣的問題，可是它也帶來了新的問題。　　模擬攝像機(jī)達(dá)到650線便已是最高水平，然而
關(guān)鍵字：選型指導(dǎo) 存儲設(shè)備監(jiān)控系統(tǒng) 視頻 IP

摘要：介紹了SPI總線控制器IP核的硬件結(jié)構(gòu)與應(yīng)用方法，并著重介紹了該IP核在微投影系統(tǒng)中的使用，以完成微顯示芯片的初始化。實(shí)驗(yàn)表明，該SPI總線接口使用靈活，便于移植，并且穩(wěn)定可靠。
關(guān)鍵詞：SPI總線控制器；N
關(guān)鍵字：系統(tǒng) 應(yīng)用投影及其 IP SPI

摘要：介紹了FreeARM7 IP核的基本概況及其接口特點(diǎn)，以LPC2101為原型對該IP核進(jìn)行了擴(kuò)展。結(jié)合USB 1．1設(shè)備控制器IP核和自定制硬件邏輯，構(gòu)建了一種微控制器功能驗(yàn)證回路。在主機(jī)端開發(fā)了驗(yàn)證程序、驅(qū)動(dòng)和通信軟件。
關(guān)鍵字：擴(kuò)展驗(yàn)證邏輯微處理器 IP FreeARM7

摘要：介紹了一種基于Wishbone總線的UART IP核的設(shè)計(jì)方法。該設(shè)計(jì)采用了自頂向下的模塊化劃分和有限狀態(tài)機(jī)相結(jié)合的方法，由于其應(yīng)用了標(biāo)準(zhǔn)的Wishbone總線接口，從而使微機(jī)系統(tǒng)與串行設(shè)備之間的通信更加靈活方便。驗(yàn)證
關(guān)鍵字： IP 設(shè)計(jì) UART 總線 Wishbone 基于

　　芯片設(shè)計(jì)愈趨復(fù)雜，對已驗(yàn)證IP的需求也愈來愈高，根據(jù)全球半導(dǎo)體協(xié)會(huì)(GSA)統(tǒng)計(jì)，2010年晶圓代工廠提供給IC設(shè)計(jì)業(yè)者的IP數(shù)量，已經(jīng)超過以IP授權(quán)為主要業(yè)務(wù)的第三方IP供貨商。為了縮短芯片設(shè)計(jì)至量產(chǎn)時(shí)間，臺積電旗下創(chuàng)意、聯(lián)電旗下智原等2家設(shè)計(jì)服務(wù)業(yè)者，已經(jīng)成為晶圓雙雄搶食IP授權(quán)市場趨勢下的主要受惠者。　　根據(jù)GSA調(diào)查統(tǒng)計(jì)，IC設(shè)計(jì)業(yè)者的IP來源，雖然因?yàn)樾酒O(shè)計(jì)功能區(qū)塊(design block)仍以自家技術(shù)為主，自有IP比例達(dá)到66%，但是去年一年當(dāng)中，已有愈來愈多的IC設(shè)計(jì)業(yè)者開始依賴
關(guān)鍵字：臺積電 IP

1前言隨著當(dāng)今社會(huì)工作和生活節(jié)奏的加快，人們對許多電器、儀器、設(shè)備的自動(dòng)化要求也越來越高，但現(xiàn)有...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

閱讀本文的人群：熟悉數(shù)字電路基本知識（如加法器、計(jì)數(shù)器、RAM等），熟悉基本的同步電路設(shè)計(jì)方法，熟悉HDL語言，對FPGA...
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阻塞和非阻塞語句作為verilogHDL語言的最大難點(diǎn)之一，一直困擾著FPGA設(shè)計(jì)者，即使是一個(gè)頗富經(jīng)驗(yàn)的設(shè)計(jì)工程師，...
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硬件描述語言HDL（HardwareDescribeLanguage）HDL概述隨著EDA技術(shù)的發(fā)展，使用硬件語言設(shè)計(jì)PLD/FPGA成為一...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

作者：韓俊剛時(shí)間：2006-02-1117:08:15來自：西安郵電學(xué)院ASIC設(shè)計(jì)中心簡介：由于微電子技術(shù)的迅速發(fā)...
關(guān)鍵字： FPGA IP 嵌入式 PLD CPLD SoC 數(shù)字信號處理消費(fèi)電子 FPGA

隨著FPGA(FieldProgrammableGateArray)容量、功能以及可靠性的提高，其在現(xiàn)代數(shù)字通信系統(tǒng)中的應(yīng)用日漸廣...
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