- 摘要：為了緩解能源問題，在完全兼容現有供電系統的基礎上，該系統采用風能和太陽能對電能進行補給的方法，并且附帶快速檢測孤島效應，快速并網和斷網的功能。系統的功率電路部分采用全橋拓撲進行逆變，數字控制系統
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MCU-FPGA 風光 并網 逆變
- 對FPGA這種特殊芯片產品的認識開始于10年前對Altera公司的認識。Altera公司獨特的嚴謹氣質與FPGA這種芯片非常契合。多年來跟蹤報道Altera在FPGA技術上的不斷創新，加之后來有機會結識賽靈思公司，兩家業內翹楚的針鋒相對與惺惺相惜，使我對FPGA整個體系架構的演進過程有了比較全面的理解。前段時間，有機會與Altera公司CTO、資深副總裁Misha Burich先生交流FPGA業界發展趨勢，使得自己對FPGA技術發展的理解愈加清晰和深刻。
FPGA體系架構演進
FPGA興起
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Altera FPGA
- 1 引言DDR2(Double DataRate2)SDRAM是由JEDEC(電子設備工程聯合委員會)制定的新生代內存技術標準，它與上一代DDR內存技術標準最大的不同：雖然采用 時鐘的上升／下降沿同時傳輸數據的基本方式，但DDR2卻擁有2倍的DDR
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Spartan Xilinx FPGA DDR2
- X-fest 2012全球系列研討會北京站于7月10日舉辦，創下了單場活動吸引上千名業內人士參加的新記錄。X-fest是為期一天的全球性培訓活動，由安富利公司 (NYSE: AVT) 旗下安富利電子元件亞洲 (Avnet Electronics Marketing )主辦，深受FPGA、ARM MCU、DSP和嵌入式系統開發人員歡迎。
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安富利 X-fest FPGA
- 1 引言 PWM整流器不僅可以控制AC/DC 變換性能，而且可實現網側單位功率因數和正弦波電流控制，甚至能使電能 ...
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PWM 整流器 中相序調整
- 1、控制系統概述隨著工業的發展，三坐標測量機越來越顯示出其重要作用。而電機控制系統對三坐標測量機的運行有著非常重要的作用。由于FPGA可以現場可編程，可以實現專用集成電路，能滿足片上系統設計(SOC)的要求，使
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FPGA 三坐標測量機 電機控制系統
- LD7209是一款LED驅動器, 該系列組件能驅動3～8顆WLED背光, 提供38V開路電壓保護,可應用于鋰電供電之小尺寸屏幕背光LED等便攜式產品, 如手機、PDA、、GPS、筆記本電腦及數碼相框。LD7209采用1MHZ高頻PWM開關頻率設計,
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驅動器 LED 調光 PWM LD7209
- 256 級灰度顯示 - 基于FPGA的OLED真彩色顯示設計,摘要利用FPGA 控制模塊，設計了OLED 真彩色動態圖像驅動控制電路。介紹采用FPGA 實現OLED 外圍控制電路和256 級灰度的方法，并分析電路中模塊的作用及整個電路的工作過程。電路系統采用基于Altera 公司的FPGA技術進行
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顯示 彩色 設計 OLED FPGA 基于 級灰度
- 工程師分析實例，帶你走近Xilinx FPGA設計,一.概述 本文主要幫助大家熟悉利用ISE進行Xilinx 公司FPGA 代碼開發的基本流程。主要是幫助初學者了解和初步掌握 ISE 的使用，不需要 FPGA 的開發基礎，所以對每個步驟并不進行深入的討論。 本文介紹的內容從新
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FPGA 設計 Xilinx 走近 分析 實例 工程師
- 采用FPGA與SRAM的大容量數據存儲的設計,1 前言 針對FPGA中內部BlockRAM有限的缺點，提出了將FPGA與外部SRAM相結合來改進設計的方法，并給出了部分VHDL程序。 2 硬件設計 這里將主要討論以Xilinx公司的FPGA(XC2S600E-6fg456)和ISSI公司的SRAM(IS61LV
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存儲 設計 數據 大容量 FPGA SRAM 采用
- 采用上位機與FPGA開發板的光纖通道接口適配器設計,隨著存儲技術的迅速發展，存儲容量得到了迅速的增長，存儲系統的數據傳輸速度成為了主要的瓶頸。光纖的傳輸具有其速度上的優勢，然而，在光纖傳輸要受到光纖通道接口的限制，因此光纖通道應用于高速數據傳輸的一個關
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接口 適配器 設計 通道 光纖 上位 FPGA 開發 采用
- 利用Java良好的移植特性的FPGA可編程嵌入式系統,傳統的嵌入式產品只能實現某種特定的功能，不能滿足用戶可變的豐富多彩的應用需求。為解決這個問題，本文設計并實現了一種使用Java作為軟件平臺的基于FPGA的可編程嵌入式系統，以實現系統對多種本地應用和網絡的支持
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可編程 嵌入式 系統 FPGA 特性 Java 良好 移植 利用
- FPGA全局時鐘資源相關Xilinx器件原語及使用,FPGA全局時鐘資源一般使用全銅層工藝實現，并設計了專用時鐘緩沖與驅動結構，從而使全局時鐘到達芯片內部的所有可配置單元(CLB)、I/O單元(IOB)和選擇性塊RAM(Block Select RAM)的時延和抖動都為最小。為了適應復雜設
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Xilinx 器件 使用 相關 資源 全局 時鐘 FPGA
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