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千兆采樣ADC確保直接RF變頻

　　隨著模數(shù)轉(zhuǎn)換器(ADC)的設(shè)計與架構(gòu)繼續(xù)采用尺寸更小的過程節(jié)點，一種新的千兆赫ADC產(chǎn)品應(yīng)運而生。能以千兆赫速率或更高速率進(jìn)行直接RF采樣且不產(chǎn)生交織偽像的ADC為通信系統(tǒng)、儀器儀表和雷達(dá)應(yīng)用的直接RF數(shù)字化帶來了全新的系統(tǒng)解決方案。　　最先進(jìn)的寬帶ADC技術(shù)可以實現(xiàn)直接RF采樣。就在不久前，唯一可運行在GSPS (Gsample/s)下的單芯片ADC架構(gòu)是分辨率為6位或8位的Flash轉(zhuǎn)換器。這些器件能耗極高，且通常無法提供超過7位的有效位數(shù)(ENOB)，這是由于Flash架構(gòu)的幾何尺寸與功耗限
關(guān)鍵字： ADC RF 轉(zhuǎn)換器 LVDS FPGA

選擇合適的轉(zhuǎn)換器：JESD204B與LVDS對比

　　1 為不同應(yīng)用提供不同選擇　　對于數(shù)據(jù)轉(zhuǎn)換器的高速串行傳輸，不同的應(yīng)用有不同的選擇。十多年來，數(shù)據(jù)轉(zhuǎn)換器制造商一直選擇LVDS作為主要差分信號技術(shù)。盡管有些LVDS應(yīng)用可使用更高的數(shù)據(jù)速率，但目前該市場上的轉(zhuǎn)換器廠商可提供的最大LVDS數(shù)據(jù)速率仍然為0.8至1 Gbps。LVDS技術(shù)一直難以滿足轉(zhuǎn)換器的帶寬要求。LVDS受TIA/EIA 644A規(guī)范控制，這是一項LVDS核心制造商的行業(yè)標(biāo)準(zhǔn)。該規(guī)范可作為設(shè)計人員的最佳實踐指南，提高不同廠商的LVDS發(fā)送器及接收器兼容性。同樣，沒有完全遵守LVDS
關(guān)鍵字： JESD204B LVDS 轉(zhuǎn)換器 FPGA PHY

經(jīng)濟實用的加熱器斷線報警電路

　　1 加熱器斷線報警　　為了保證生產(chǎn)產(chǎn)品的質(zhì)量、提高勞動生產(chǎn)率，為了避免意外的傷害事故，電加熱系統(tǒng)中常常帶有加熱器斷線報警等功能。這些功能可以用專門配備的斷線報警器實現(xiàn)，也可以用集成在調(diào)節(jié)儀表中的專用軟硬件實現(xiàn)。后者具有結(jié)構(gòu)緊湊、占有空間小、費用節(jié)省等優(yōu)點。　　現(xiàn)在生產(chǎn)的智能調(diào)節(jié)儀表常常是帶有諸多報警功能的多功能儀表。在MCU的控制下，這些儀表不僅能接收薄膜按鍵輸入的設(shè)定值或來自傳感器/變送器的多種被測信號，也能經(jīng)演算處理后，顯示這些數(shù)值、輸出PID控制信號或報警信號。常見的報警方式有上限報警、
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實現(xiàn)基于USB3.0技術(shù)的高清攝像頭系統(tǒng)設(shè)計

　　高清圖像質(zhì)量已經(jīng)快速成為現(xiàn)代家庭中多媒體產(chǎn)品的標(biāo)準(zhǔn)配置。在該領(lǐng)域之外的許多應(yīng)用中，更高的分辨率、更好的對比度、更大的色深和更快的幀率也都越來越受歡迎，這些應(yīng)用包括安保、醫(yī)療成像和工廠生產(chǎn)線檢測系統(tǒng)等等。當(dāng)然，盡管增強型成像技術(shù)在不久的將來更加流行似乎是板上釘釘?shù)氖虑椋@將取決于支持更高數(shù)據(jù)傳輸能力的先進(jìn)半導(dǎo)體技術(shù)的發(fā)展。本文將以實例闡述半導(dǎo)體技術(shù)所取得的進(jìn)展。　　雖然USB連接標(biāo)準(zhǔn)開始并沒有引起太多關(guān)注，但從上世紀(jì)90年代中期第一次脫穎而出已經(jīng)改變了很多，它現(xiàn)在已經(jīng)遠(yuǎn)遠(yuǎn)不只是為低數(shù)據(jù)速率的鼠標(biāo)和
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駿龍科技最新物聯(lián)網(wǎng)開發(fā)套件和電機驅(qū)動方案擴展Altera MAX 10 FPGA的應(yīng)用

　　領(lǐng)先的技術(shù)分銷商駿龍科技有限公司發(fā)布了基于Altera MAX® 10的“Mpression Odyssey(奧德賽)”物聯(lián)網(wǎng)開發(fā)套件和電機驅(qū)動方案。Altera的MAX® 10 FPGA在低成本、單芯片、瞬時上電的可編程邏輯器件中提供了先進(jìn)的處理能力，駿龍科技推出的產(chǎn)品進(jìn)一步驗證了MAX® 10 FPGA的卓越性能，并進(jìn)一步豐富了Altera公司的工業(yè)解決方案。　　“Mpression Odyssey(奧德賽)”開發(fā)套件是一
關(guān)鍵字：駿龍科技物聯(lián)網(wǎng) FPGA

瞄準(zhǔn)MCU 華虹設(shè)計欲領(lǐng)軍國產(chǎn)芯片崛起

　　上海華虹集成電路有限責(zé)任公司(華虹設(shè)計)是專業(yè)的智能卡與信息安全芯片解決方案供應(yīng)商，作為IC卡技術(shù)的國內(nèi)領(lǐng)頭羊，華虹設(shè)計是國內(nèi)綜合實力最強的芯片供應(yīng)商，是中國“909 工程”的重要IC設(shè)計公司，公司芯片年出貨量達(dá)6億顆，擁有十多年在智能卡與信息安全芯片的豐富經(jīng)驗。　　經(jīng)歷了與半導(dǎo)體制造業(yè)務(wù)剝離之后，華虹設(shè)計成為了中國電子信息產(chǎn)業(yè)集團(tuán)有限公司(CEC)下屬子公司，更加專注于半導(dǎo)體產(chǎn)品的設(shè)計研發(fā)，并適應(yīng)市場競爭的需要不斷調(diào)整戰(zhàn)略重點。華虹設(shè)計在致力于開發(fā)技術(shù)先進(jìn)、引領(lǐng)市場的智能
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利用FPGA和分解器數(shù)字轉(zhuǎn)換器簡化角度測量

　　1 編碼器和分解器的類型　　編碼器分為增量和絕對兩個基本類別。增量編碼器可以監(jiān)控輪軸上的兩個位置，可以在輪軸每次經(jīng)過這兩個位置時產(chǎn)生A或B脈沖。獨立的外部電動計數(shù)器然后從這些脈沖解讀出轉(zhuǎn)速和旋轉(zhuǎn)方向。雖然適用于眾多應(yīng)用，但是增量式計數(shù)器確實存在某些不足。例如，在輪軸停轉(zhuǎn)情況下，增量編碼器在開始運行之前必須首先通過調(diào)回到某個指定校準(zhǔn)點來實現(xiàn)自身校準(zhǔn)。另外，增量式計數(shù)器易受到電氣干擾的影響，導(dǎo)致發(fā)送到系統(tǒng)的脈沖不準(zhǔn)確，進(jìn)而造成旋轉(zhuǎn)計數(shù)錯誤。不僅如此，許多增量編碼器屬于光電器件，如果對目標(biāo)應(yīng)用有影響，則
關(guān)鍵字：編碼器分解器 RDC FPGA 脈沖

Tcl在Vivado中的應(yīng)用

　　Xilinx的新一代設(shè)計套件 Vivado 相比上一代產(chǎn)品 ISE，在運行速度、算法優(yōu)化和功能整合等很多方面都有了顯著地改進(jìn)。但是對初學(xué)者來說，新的約束語言 XDC 以及腳本語言 Tcl 的引入則成為了快速掌握 Vivado 使用技巧的最大障礙，以至于兩年多后的今天，仍有很多用戶缺乏升級到 Vivado 的信心。　　本文介紹了 Tcl 在 Vivado 中的基礎(chǔ)應(yīng)用，希望起到拋磚引玉的作用，指引使用者在短時間內(nèi)快速掌握相關(guān)技巧，更好地發(fā)揮 Vivado 在 FPGA 設(shè)計中的優(yōu)勢。　　1
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基于瑞薩R7F0C002單片機的JJY數(shù)字電波鐘設(shè)計(上)

　　1 引言　　隨著時代的發(fā)展，人類對于精確的時間越來越重視，像國防、衛(wèi)星、天氣監(jiān)控等系統(tǒng)，需要精確的時間來做資料的備份以及同步的處理。傳統(tǒng)的計時方式難以滿足日益精確的時間要求，融合了微電子技術(shù)、計算機技術(shù)、通訊技術(shù)與現(xiàn)代時頻技術(shù)的電波鐘正是成為合適的選擇。它接收授時中心以無線電長波傳送的標(biāo)準(zhǔn)時間信號，并通過內(nèi)置微處理器解碼處理，從而實現(xiàn)時間自動校準(zhǔn)，使電波鐘表顯示的時間與國家的標(biāo)準(zhǔn)時間保持高度同步。　　鑒于目前我國 BPC 低頻時碼格式尚未公開，我們只能制作接收日本 JJY60 信號的電波鐘表。
關(guān)鍵字：瑞薩 JJY 單片機 R7F0C002 MCU LCD

Altera: FPGA集成硬核浮點DSP

　　1 FPGA浮點運算推陳出新　　以往FPGA在進(jìn)行浮點運算時，為符合IEEE 754標(biāo)準(zhǔn)，每次運算都需要去歸一化和歸一化步驟，導(dǎo)致了極大的性能瓶頸。因為這些歸一化和去歸一化步驟一般通過FPGA中的大規(guī)模桶形移位寄存器實現(xiàn)，需要大量的邏輯和布線資源。通常一個單精度浮點加法器需要500個查找表(LUT)，單精度浮點要占用30%的LUT，指數(shù)和自然對數(shù)等更復(fù)雜的數(shù)學(xué)函數(shù)需要大約1000個LUT。因此隨著DSP算法越來越復(fù)雜，F(xiàn)PGA性能會明顯劣化，對占用80%～90%邏輯資源的FPGA會造成嚴(yán)重的布線擁
關(guān)鍵字： Altera FPGA LUT DSP 數(shù)據(jù)通路

基于GD32 MCU的綠色智能家居

基于綠色節(jié)能的理念，在智能家居模型中加入了蓄電池、太陽能電池板、風(fēng)能發(fā)電機，以GD32 MCU為控制核心，設(shè)計了紅外檢測、人體檢測、光控LED、溫度監(jiān)測和電子鎖等功能，并可通過GSM短信進(jìn)行報警。
關(guān)鍵字：綠色節(jié)能智能家居 GD32 MCU LED 201505

三相SPWM波形發(fā)生器的設(shè)計與仿真

本文提出了一種采用VHDL硬件描述語言設(shè)計新型三相正弦脈寬調(diào)制（SPWM）波形發(fā)生器的方法。該方法以直接數(shù)字頻率合成技術(shù)(DDS)為核心產(chǎn)生三相SPWM信號。并且利用VHDL設(shè)計了死區(qū)時間可調(diào)的死區(qū)時間控制器，解決了傳統(tǒng)的模塊電路等待方法很難產(chǎn)生帶精確死區(qū)時間控制的SPWM信號的問題。該方法在Quartus II 9.1環(huán)境平臺下進(jìn)行了仿真驗證，并將設(shè)計程序下載到DE2-70實驗板進(jìn)行實驗測試，用示波器測試得到了死區(qū)時間可控制的SPWM波形。
關(guān)鍵字： VHDL SPWM DDS 死區(qū)時間 FPGA 201505

聲納圖像動態(tài)范圍擴展與FPGA實現(xiàn)

本文針對成像聲納擴展圖像動態(tài)范圍和增強圖像細(xì)節(jié)的需求，提出了一種基于開方運算的動態(tài)范圍擴展方法。基于課題組研制的多波束成像聲納原理樣機的研制，分析了數(shù)據(jù)動態(tài)范圍壓縮導(dǎo)致圖像細(xì)節(jié)丟失的原因及其對成像質(zhì)量的影響，采用JPL快速平方根近似算法改善了開方運算FPGA實現(xiàn)過程的資源占用和系統(tǒng)延時。最后，對改進(jìn)設(shè)計方案進(jìn)行了實驗驗證，通過多波束成像聲納系統(tǒng)的消聲水池實驗證明了本文動態(tài)范圍擴展方法的有效性和可行性，系統(tǒng)成像質(zhì)量改善明顯，達(dá)到優(yōu)化設(shè)計的預(yù)期目標(biāo)。
關(guān)鍵字：成像聲納動態(tài)范圍平方根 FPGA 波束成像 201505

接收機的中頻處理技術(shù)

本文對數(shù)字中頻信號處理技術(shù)進(jìn)行了研究，采用軟件無線電的設(shè)計思想和解決方案，提出了一種基于“AD+FPGA”的中頻信號處理技術(shù)，在頻譜分析儀及信號分析儀等接收機中應(yīng)用廣泛。
關(guān)鍵字：數(shù)字中頻軟件無線電 AD FPGA 分析儀 201505

無運放的權(quán)電阻網(wǎng)絡(luò)在單片機控制系統(tǒng)中的應(yīng)用(下)

　　接上篇　　編程思路　　對于電阻類數(shù)據(jù)，常用的數(shù)表有電阻數(shù)表、AD數(shù)表。　　1. 電阻數(shù)表，優(yōu)點是直觀，方便后期查驗，與電源電壓無關(guān);缺點和AD值之間需要額外的計算，占用系統(tǒng)時間。　　2. AD數(shù)表，優(yōu)點是MCU只需做比較而無需乘除，與電源電壓無關(guān);缺點是不直觀，需要保存好原始的計算表格以備查驗。　　這里使用第二種AD數(shù)表，我們推導(dǎo)一下AD值與地址設(shè)置值之間的關(guān)系：　　因為并聯(lián)電路和串聯(lián)電路都是線性電路，電源VCC的波動會直接導(dǎo)致輸出電壓波動，所以直接把VCC和Vref連接能
關(guān)鍵字： MCU PCB 電阻 AD數(shù)表 VCC