- 針對固體火箭發動機推進劑藥柱應變量大、高頻振動時應變不易測量的問題，基于FPGA和柔性應變計設計了柔性應變測量裝置。柔性應變計的測量范圍大，可以測量雙向應變，解決了推進劑藥柱應變測量的難題。FPGA具有實時性高、并行運行的優點，解決了多路應變實時采集的難題。該應變測量裝置還可用于其他高分子材料的應變測量。
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推進劑 柔性應變計 FPGA 高頻振動 高速采集 202111
- 1? ?為什么AI/ML發展如此迅速？多年來，人工智能（AI）/機器學習（ML）市場一直以指數級的速度快速增長，其解決方案遍布我們周圍，從機器人和其他機械系統的預測故障算法、電子商務中的購買行為建議、自動駕駛車輛的目標檢測、電子交易中的風險緩解到DNA測序等等，我們身邊有各種各樣的解決方案，示例不勝枚舉。那么，為什么AI/ML發展如此迅速呢？據IDC、Gartner和其他市調機構的分析，全球大約80%的數據是非結構化數據。電子郵件、照片、語音郵件、視頻和許多其他數據源每天都在堆積。無論
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AI 機器學習 FPGA
- BiSS協議是一種高速同步串行通信協議，使用BiSS協議的編碼器有利于提高伺服控制系統的動態性能，在高精度絕對式編碼器中應用廣泛。本文在分析BiSS協議數據幀特點的基礎上，利用FPGA設計了BiSS協議編碼器解碼器，采集了BiSS協議編碼器位置數據和總線波形，通過與DSP聯合使用，基于BiSS協議編碼器對永磁同步電機的動態性能進行了驗證，結果表明該設計的合理性。
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BiSS FPGA 編碼器 DSP 202108
- 5G通信的主要特征包括“高速率、大帶寬”，為了滿足高速率、大帶寬數據的傳輸要求，需要一種存儲技術對數據進行存儲。本文就存儲技術結合DDR4協議，設計了一種DDR4傳輸機制，本研究采用高性能的XCVU9P系列的FPGA芯片作為控制芯片，使用其內部自帶的DDR4 SDRAM（MIG）IP核進行例化核設計。經過驗證，實現在250 MHz時鐘下對DDR4 SDRAM的讀/寫操作，數據無丟失，能夠保證高速率、大帶寬數據正常傳輸，該傳輸機制具有良好的可靠性、適用性及有效性。
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DDR4 高速率 大帶寬 FPGA 202108
- 針對5G毫米波通信宏基站、微基站等設備的研發、生產、預認證、維修保障等測試需求，設計一款可應用于“5G新基建”通信設備產業鏈多環節所需儀表的高效多速率信號接收機處理模塊。采用先進的并行多相濾波技術和任意速率比FFT處理技術，基于FPGA算法平臺實現毫米波5G接收機多路信號接收時域/頻域并行變速率處理邏輯電路，提高5G復雜波形接收機信號解析的實時性。實驗結果表明，該電路能高效完成5G復雜波形接收機信號的時域/頻域解析，適合作為毫米波5G接收機多速率數據處理實施方案，滿足毫米波5G接收機的功能設計要求。
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FPGA 5G 毫米波 接收機 202105
- AD7403是一種Σ-Δ型模數轉換器，廣泛應用于需要電氣隔離的伺服控制電機相電流采集場合。EG4A20BG256是一種國產FPGA，適用于伺服控制系統信號采集﹑接口擴展等應用場景。本文基于EG4A20BG256 FPGA設計了AD7403模數轉換器接口電路，采集永磁同步電機相電流，并與伺服控制電路內霍爾電流傳感器和DSP采樣結果進行了對比。結果表明，EG4A20BG256 FPGA可以通過AD7403模數轉換器實現對永磁同步電機相電流的準確采集。
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AD7403 EG4A20BG256 FPGA DSP 永磁同步電機 202105
- 設計并實現了一種BD/GPS衛星導航信號多通道隔離轉換測量顯示系統。該系統將一路輸入的BD/GPS信號通過功分器轉換為等量的四路隔離輸出信號，經FPGA解析后實時顯示在電腦屏幕上，為BD/GPS信號的使用提供直觀的數據基礎。
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BD/GPS FPGA 功分器 隔離 202107
- 摘要：針對目前BiSS協議編碼器數據讀取多采用FPGA實現的實際情況，文中介紹一種基于XMC4500微控制器的BiSS協議編碼器數據讀取實現方案。采用該方案，可將使用BiSS協議編碼器的伺服系統控制電路常用的DSP+FPGA雙控制器架構方式簡化為XMC4500單控制器方式，在一定程度上降低了硬件成本和開發難度。用該方案采集BiSS協議編碼器數據的實物平臺，使用LabVIEW顯示對讀取的數據，并與電機自帶增量編碼器值進行對比，同時記錄BiSS協議編碼器實際數據波形圖，結果表明，該方案具有較高的采樣速率和較好
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202106 BiSS XMC4500 DSP FPGA LabVIEW
- 隨著移動通信的高速發展，5G NR通信已經進入我們的日常生活，5G系統對信息傳輸制訂了全新標準，基于5G NR的小區搜索相對于長期演進（LTE）而言，對同步信號進行了重新定義。文章詳細分析了5G NR系統的主輔同步信號（PSS&SSS），對其新增內容進行了研究，提出了適用于5G NR系統的小區搜索算法，使用MATLAB軟件對該算法的性能進行了仿真分析，最后在FPGA上實現開發應用。
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5G NR FPGA 小區搜索 PSS SSS 202105
- 邊緣運算主要包含以下四個部分，低時延、AI算力、低功耗以及安全和保密，這四者是邊緣自主非常重要的組成部分，也是邊緣區別于工業和IoT的一個主要特點，也就是用運算資源來支持邊緣的自主，使它能夠獨立于云端。 賽靈思Versal AI Edge系列資深產品線經理 Rehan Tahir賽靈思Versal AI Edge系列高級產品線經理Rehan Tahir指出，當賽靈思在2018年引入Versal ACAP的時候，首先推出的是Versal Core和Prime系列，用于云端和網絡，然后推出了Vers
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賽靈思 FPGA ADAS
- 隨著通信技術的快速發展，5G已經正式商用，5G的6G以下波段對傳輸有很高的要求，在6G以上的毫米波段要求的信號帶寬更大，數據傳輸速率更高，高速大帶寬信號要求基帶信號處理的速度將大大增加，對極高速數據流的實時處理和解析使測試變得更加困難，本文主要是研究與設計毫米波基帶數據的傳輸與實現：前端DA的研究與設計、傳輸鏈路的FPGA實現以及毫米波數據的DSP接收處理過程，最后把實現流程成功應用到5G測試儀表之中，驗證了設計的正確性。
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202104 毫米波 FPGA 基帶數據 DSP
- 作為第四任賽靈思的CEO，上任三年多的Victor Peng在交易后首次面對中國的媒體時，除了總結自己上任三年來的成績之外，更是重點的回應了對合并后企業的愿景
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賽靈思 FPGA AMD
- 引言：本文我們簡單介紹下Xilinx?FPGA管腳物理約束，包括位置（管腳）約束和電氣約束。管腳位置約束： set_property PAKAGE_PIN “管腳編號” ［get_ports “端口名稱”］管腳電平約束： set_property?IOSTANDARD “電壓” ［get_ports “端口名稱”］舉例：set_property IOSTANDARD LVCMOS33 ［get_ports sys_clk］set_property IOSTANDARD LVCMOS33
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xilinx fpga
- 本設計基于FPGA硬件平臺實現了對一個區域場景的入侵檢測與追蹤識別，對檢測到的運動物體作出人與動物的區分，能夠通過無線方式發送警報，且系統檢測具有較高的魯棒性。本系統以FPGA為核心單元，主要由五個模塊構成：OV5640攝像頭模塊，DDR3數據儲存模塊、圖像數據處理模塊、蜂鳥E203 RISC-V SoC片上系統。系統整合與調試結果顯示，本設計在FPGA上采用了合適的算法搭建系統，能對視頻圖像中的運動目標進行實時、準確的識別與追蹤。
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Robei FPGA 動態目標追蹤 實時圖像處理 背景差分法 202103
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