- 摘 要：提出了一種基于會話初始化協議的VoIP系統(包括IP電話終端、SIP服務器和PSTN接入端口)，并對SIF，與PSTN的互聯進行了系統級構建。利用Ahera的SOPC軟核CPU技術和Nios II處理器構建了一個IP電話終端。該設計具有
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電話 接口 設計 IP 技術 軟核 CPU 基于
- Altera公司今天宣布，Altera公司于2009年3月10日在天津大學成立EDA/SOPC聯合實驗室。這是Altera自2004年3月在中國電子科技大學成立首個EDA/SOPC聯合實驗室以來的國內第60所聯合實驗室和培訓中心。該實驗室將為數字邏輯電路、硬件描述語言、微機原理、電視原理、現代數字系統設計等本科或研究生課程的實驗教學以及電子類課程設計提供支持，Altera®公司的FPGA開發環境將成為貫穿天津大學電子工程類專業本科和研究生教育階段的實驗平臺。
作為全球領先的可編程邏輯器件
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Altera FPGA SOPC
- 在高速圖像采集系統中，CPU時鐘資源、I／O端口資源、傳輸單元等都成為系統的瓶頸。本系統采用FPGA+RAM+USB的設計：FPGA硬件采樣模塊，有效降低采樣時延和CPU時鐘資源；獨特的RAM時序控制與讀寫控制分離設計，增加了模塊之間的獨立性，降低了控制的復雜度；USB設計在實現高速率數據傳輸的同時又具有低成本、易安裝等優點。
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FPGA 高速圖像采集 系統設計
- 摘 要：從支持IP VPN的實現方式出發，采用某移動通信公司運營支撐網實例論證的方法，詳細闡述了MPLS―VPN的應用，主要對基于MPLS的IP VPN的結構組成，MPLS IP VPN的工作過程，MPLS―VPN的三種實際部署方案，MPLSVPN的
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應用 分析 VPN IP MPLS 基于
- 實現信號源常用的方法是頻率合成法，其中直接數字頻率合成法是繼直接頻率合成法和間接頻率合成法之后，隨著電子技術迅速發展的第三代頻率合成技術。DDS是一種全數字技術，它從相位概念出發直接合成所需頻率，它具有頻
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Builder FPGA DSP 正弦
- 在實際網絡中,許多不在同一地點的局域網之間需要交互信息。為實現專用無線網與局域網之間的互連,研制具備下述功能的網關。首先,實現IP級互連,即某一局域網的IP數據報經過網關的轉換后可以通過無線網傳到另一網關,再經
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應用 設計 網關 IP 無線 IP網關 串口通信
- 為了實現USB設備之間的直接通信，介紹一款USB 0TG IP核的設計與FPGA驗證。在分析OTG補充規范的基礎上，重點描述了USB OTG IP核的設計原理、模塊劃分以及每個模塊的功能，然后對USBOTG的部分特性進行詳細的闡述，最后給出該IP核在ModelSim中的功能仿真及FPGA驗證結果。結果表明，該IP核具備主機功能和設備功能，可作為一個獨立的IP模塊應用到SoC系統中。
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FPGA 驗證 設計 Core OTG IP USB
- 0 引言 短波信道存在多徑時延、多普勒頻移和擴散、高斯白噪聲干擾等復雜現象。為了測試短波通信設備的性能，通常需要進行大量的外場實驗。相比之下，信道模擬器能夠在實驗室環境下進行類似的性能測試，而且測試費用
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FPGA 高斯白噪聲 方法 序列
- FPGA和DSP之間的“智能配分”可使無線系統設計師獲得最佳性能組合和成本――效能。應用DSP和FPGA組合可使成本降低。對于無線基站，組合有DSP可編程邏輯的系統配分，可促使更大的產品設計和市場成功率。更高數據率的需
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FPGA DSP 無線基站 組合
- 摘 要：根據數字電視條件接收系統的原理，提出一種ECM在 TS層加入、復接和條件接收相互獨立的CAS實現方法。ECM在TS層加入，對于TS層加擾來說，易于實現加擾和解擾同步；復接和條件接收相互分離使條件接收系統實現比
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FPGA 數字電視 條件接收系統
- 本方法在實際應用過程中得到了驗證，能夠穩定地代替軟件行使UWB模塊的配置管理功能，并顯著提高了系統性能，極大方便了Wisair DV9110M的研發應用。
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Wisair 9110M 9110 FPGA
- 本文提出在FPGA芯片內插入多條移位寄存器鏈的方法，可使測試開關盒連線資源的時問比傳統的測試方法和已有的一種方法時間上減少了99％以上，大大降低了測試的時間，降低了測試成本，并且消耗的硬件面積比大約在5％左右，在可接受的范圍內。
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SRAM FPGA 資源 可測性設計
- 25年前，賽靈思(Xilinx)公司發明了FPGA(現場可編程門陣列)。如今，以FPGA為代表的可編程芯片應用已經成為勢不可擋的發展趨勢，尤其在ASSP和傳統ASIC之間出現的市場缺口上，FPGA將開辟出新的領域,而目前席卷全球的金融危機更是成為FPGA迅速發展的催化劑。
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Xilinx FPGA 200903
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