- FPGA/CPLD能做什么呢？可以毫不夸張的講，FPGA/CPLD能完成任何數字器件的功能，上至高性能CPU,下至簡單的74電路，都可以用FPGA/CPLD來實現。FPGA/CPLD如同一張白紙或是一堆積木，工程師可以通過傳統的原理圖輸入法，
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CPLD FPGA
- FPGA的基礎就是數字電路和HDL語言，想學好FPGA的人，建議床頭都有一本數字電路的書，不管是哪個版本的，這個是基礎，多了解也有助于形成硬件設計的思想。在語言方面，建議初學者學習Verilog語言，VHDL語言語法規范嚴格，調試起來很慢，Verilog語言容易上手，而且，一般大型企業都是用Verilog語言。
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賽靈思 FPGA HDL
- 目前以硬件描述語言(Verilog 或 VHDL)所完成的電路設計，可以經過簡單的綜合與布局，快速的燒錄至 FPGA 上進行測試，是現代 IC 設計驗證的技術主流。這些可編輯元件可以被用來實現一些基本的邏輯門電路(比如AND、OR、XOR、NOT)或者更復雜一些的組合功能比如解碼器或數學方程式。在大多數的FPGA里面，這些可編輯的元件里也包含記憶元件例如觸發器(Flip-flop)或者其他更加完整的記憶塊。
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賽靈思 FPGA Verilog
- 何一個從事后看來很成功的新事物從誕生到發展壯大都不可避免地經歷過艱難的歷程并可能成為被研究的案例，FPGA也不例外。
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賽靈思 FPGA XC2064
- ASIC 和 FPGA 具有不同的價值主張，在作出選擇前必須仔細評估。兩種種技術對比。這里介紹了 ASIC 和 FPGA 的優勢與劣勢:
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賽靈思 ASIC FPGA
- 現場可編程門陣列 (FPGA) 是由通過可編程互連連接的可配置邏輯塊 (CLB) 矩陣構成的可編程半導體器件。相對于專為特定設計定制構建的專用集成電路 (ASIC) 而言，FPGA 能通過編程來滿足應用和功能要求。
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賽靈思 FPGA ASIC
- 在調試FPGA電路時要遵循一定的原則和技巧，才能減少調試時間，避免誤操作損壞電路。一般情況下，可以參考以下步驟進行FPGA硬件系統的調試。
（1）首先在焊接硬件電路時，只焊接電源部分。使用萬用表進行測試，排除電
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FPGA 調試 硬件系統 方法
- 本文首先簡略介紹了幾種當前對Virtex 系列FPGA 進行配置的方式和其不足之處， 在此基礎上提出了一種使用微處理器讀取SD 卡中的配置數據，并通過SELECTMAP 接口 對FPGA 進行配置的方案，并輔以電路圖和工作流程圖，以及配置數據在SD 卡中的存儲方 式進行說明。采用此配置方案可以使產品更新只涉及到修改SD 卡中的數據，方便靈活，有 利于降低大規模產品升級時的成本，適用于通信、工控等多個領域。
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Virtex FPGA SD卡 方案
- 1．引言SPI-4.2（System Packet Interface）是 OIF（Optical Internetworking Forum）定義的局部高速總線標準，用于 PHY層芯片到鏈路層芯片的 10Gbps信號傳輸。主要應用有 OC-192 ATM、Packet over SONET/SDH（POS）
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FPGA 4.2 SPI 接口設計
- 萊迪思半導體公司今日宣布發布Lattice Diamond設計軟件的1.4版本，這是適用于萊迪思FPGA產品的設計環境。Lattice Diamond 1.4軟件的用戶將得益于幾大實用的增強功能，使得FPGA設計探索更容易并且縮短產品上市時間。
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萊迪思 FPGA Lattice Diamond 1.4
- Altera公司今天宣布，成功實現28-nm Stratix V GX FPGA與PLX技術公司ExpressLane PCI Express (PCIe) Gen3的互操作。Stratix V GX FPGA具有硬核PCIe Gen3 IP模塊，是目前發售的能夠與PCIe Gen3交換機實現互操作的唯一一款FPGA。
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Altera FPGA
- 全球可編程平臺領導廠商賽靈思公司 (Xilinx, Inc. ) 今天宣布向客戶交付首批 Zynq-7000 可擴展處理平臺 (EPP)，這是其完整嵌入式處理平臺發展戰略的一個重大里程碑，率先為開發人員提供堪比ASIC 的性能與功耗，FPGA 的靈活性以及微處理器的可編程性。
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賽靈思 FPGA Zynq-7000
- 在舞臺機械設備中，吊桿起著重要的傷腦筋。在大型的影劇院，一場演出往往需要調動大量的舞臺背景，有時要控制 ...
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單片機 FPGA 舞臺吊桿控制器
- 摘要 直接序列擴頻通信系統以強抗噪聲、低截獲性和多址通信等特點，在軍事及民用移動通信網絡中得到廣泛應用。文中對直序擴頻的FPGA實現技術進行了研究。以QuartusII為開發工具，建立了一個初步的直接序列擴頻通信系
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實現 FPGA 研究 擴頻
- 1 引言 在數字化飛速發展的今天，人們對微處理器的性能要求也越來越高。作為衡量微處理器 性能的主要標準，主頻和乘法器運行一次乘法的周期息息相關。因此，為了進一步提高微處 理器性能，開發高速高精度的乘法器
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FPGA 流水線 浮點 乘法器設計
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