1 引 言
現場可編程門陣列（FPGA）用硬件電路完成算法的過程，一方面解決了系統的開銷問題，提供了提高系統整體性能的條件，另一方面，由于靜態RAM型的FPGA具備可重構特性，這使得資源利用率得到顯著提高。FPGA既具有通用計算系統的靈活性，又有專用處理系統的性能，對實現高性能信號處理具有很高的應用價值，而且可重構的特性使其可以根據算法來調整相應的通信結構和數據字長。FPGA以其高度的靈活性與硬件的高密度性在通信信號處理中得到了廣泛的應用。
在對Xili
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嵌入式系統 單片機 FPGA 偽碼測距
可編程解決方案領導廠商賽靈思公司（Xilinx）與無錫國家高新技術產業開發區管理委員會今天共同宣布成立無錫國家集成電路設計基地FPGA（現場可編程門陣列）創新中心，并隆重舉行賽靈思正式授權“無錫國家集成電路設計基地—賽靈思聯合實驗室”揭牌儀式。無錫新區管委會副主任朱曉紅以及賽靈思公司研究實驗室高級總監、全球大學計劃負責人Patrick Lysaght等出席了成立大會并為聯合實驗室揭牌。 作為國家級的集成電路設計基地，新的FPGA創新中心的成立以及聯合實驗室的打造，意味著可編程設計在電子設計領域的
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嵌入式系統 單片機 FPGA 無錫 集成電路設計 嵌入式
任何一個從事后看來很成功的新事物從誕生到發展壯大都不可避免地經歷過艱難的歷程并可能成為被研究的案例，FPGA也不例外。1985年，當全球首款FPGA產品——XC2064誕生時，注定要使用大量芯片的PC機剛剛走出硅谷的實驗室進入商業市場，因特網只是科學家和政府機構通信的神秘鏈路，無線電話笨重得像磚頭，日后大紅大紫的Bill Gates正在為生計而奮斗，創新的可編程產品似乎并沒有什么用武之地。 事實也的確如此。最初，FPGA只是用于膠合邏輯，從膠合邏輯到算法
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引 言
隨著計算機技術的發展和廣泛應用，尤其是在工業控制領域的應用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設備之間的連線大為減少，但隨之帶來串／并轉換和位計數等問題，這使串行通信技術比并行通信技術更為復雜。串／并轉換可用軟件實現，也可用硬件實現。用軟件實現串行傳送大多采用循環移位指令將一個字節由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統的性能。更為方便的實現方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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嵌入式系統 單片機 UART FPGA
1 引 言
隨著數字通信和工業控制領域的高速發展，要求專用集成電路（ASIC）的功能越來越強，功耗越來越低，生產周期越來越短，這些都對芯片設計提出了巨大的挑戰，傳統的芯片設計方法已經不能適應復雜的應用需求了。SoC（System on a Chip）以其高集成度，低功耗等優點越來越受歡迎。開發人員不必從單個邏輯門開始去設計ASIC，而是應用己有IC芯片的功能模塊，稱為核（core），或知識產權（IP）宏單元進行快速設計，效率大為提高。CPU 的IP
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嵌入式系統 單片機 RISC CPU FPGA
Altera公司日前宣布為工業自動化應用中的以太網通信協議提供FPGA支持，這些應用包括ProfiNet、Ethernet/IP、Modbus-IDA、EtherCAT、SERCOS III接口和Ethernet Powerlink等。這些關鍵通信協議的知識產權(IP)內核現在可以在Altera低成本Cyclone®系列FPGA中實現。
設計人員利用工業以太網IP內核可以在一塊電路板上實現任何標準，這不但減小了外形尺寸，而且節省了時間。系統OEM能夠以高性價比方式在其自動化產品中增加工業
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工業以太網 FPGA IP 嵌入式 工業控制
摘要：通過模糊自整定PID控制器的設計，本文提出了一種基于VHDL描述、DSP Builder和Modelsim混合仿真、FPGA實現的智能控制器設計及測試新方法。首先，通過MATLAB仿真，得出智能控制器的結構和參數。然后，基于VHDL進行智能控制器的數字化實現及其開環測試。在此基礎上，通過分析一般智能控制器的測試特點，采用DSP Builder構建閉環測試系統，Modelsim運行DSP Builder生成文件來驗證QuartusII中所做VHDL設計的測試方法。實驗表明，該測試方法能有效模擬控制器的
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Altera公司日前宣布為EtherCAT技術協會的EtherCAT協議提供知識產權(IP)支持。此前IP是針對Cyclone® II器件，現在將針對Altera新的低成本、低功耗Cyclone III FPGA。
EtherCAT技術協會執行總監Martin Rostan說：“在競爭非常激烈的工廠自動化設備市場上，企業正在尋找能夠迅速突出產品優勢的新功能和特性。Cyclone III FPGA實現對EtherCAT的支持，使設計人員能夠以高性價比方式，輕松加入實時以太網功能。”
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引 言
隨著計算機技術的發展和廣泛應用，尤其是在工業控制領域的應用越來越廣泛，計算機通信顯的尤為重要。串行通信雖然使設備之間的連線大為減少，但隨之帶來串／并轉換和位計數等問題，這使串行通信技術比并行通信技術更為復雜。串／并轉換可用軟件實現，也可用硬件實現。用軟件實現串行傳送大多采用循環移位指令將一個字節由高位到低位(或低位到高位)一位一位依次傳送，這種方法雖然簡單但速度慢，而且大量占用CPU的時間，影響系統的性能。更為方便的實現方法是用硬件，目前微處理器串行接口常用的LSI 芯片是UART(通用異
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使用這些設計技巧和ISE功能分析工具來控制功耗
新一代 FPGA的速度變得越來越快，密度變得越來越高，邏輯資源也越來越多。那么如何才能確保功耗不隨這些一起增加呢？很多設計抉擇可以影響系統的功耗，這些抉擇包括從顯見的器件選擇到細小的基于使用頻率的狀態機值的選擇等。
為了更好地理解本文將要討論的設計技巧為什么能夠節省功耗，我們先對功耗做一個簡單介紹。
功耗包含兩個因素：動態功耗和靜態功耗。動態功耗是指對器件內的容性負載充放電所需的功耗。它很大程度上取決于 頻率、電壓和負載
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擴頻通信自上世紀50年代中期被美國軍方開始研究以來，一直為軍事通信所獨占，廣泛應用于軍事通信、電子對抗以及導航、測量等各個領域。進入上世紀90年代以后，擴頻通信又開始向各種民用通信領域發展，典型的如CDMA和GPS等。應用最廣的是直接序列擴頻方式(DSSS)。它是將待傳送的信息數據被偽隨機碼調制，實現頻譜擴展后再傳輸，接收端則采用相同的編碼進行解調及相關處理，恢復原始信息數據。
本文采用VHDL語言、Altera公司的集成開發環境QuartusII 6.0和Cyclone系列芯片EPlC3T14
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通訊 無線 網絡 FPGA 無線 通信
引言
目前，用FPGA(現場可編程門陣列)實現FIR(有限沖擊響應)濾波器的方法大多利用FPGA中LUT(查找表)的特點采用DA(分布式算法)或CSD碼等方法，將乘加運算操作轉化為位與、加減和移位操作。這些結構需要占用器件較多的LE(邏輯元件)資源，設計周期長，工作頻率低，實時性差。本文提出一種基于Stratix系列FPGA器件的新的實時高速脈動FIR濾波器的快速實現方法。利 用FGPA集成的DSP(數字信號處理器)乘加模塊定制卷積運算單元，利用VHDL(甚高速集成電路硬件描述語言)元件例化語句快
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現代化生產和科學研究對視頻圖像采集系統的要求日益提高。傳統的圖像采集卡速度慢、處理功能簡單、采用分立元件、電路非常復雜；而且可靠性差、不易調試、不能很好地滿足特殊要求。FPGA(現場可編程門陣列)是專用集成電路中集成度最高的一種，用戶可對FPGA內部的邏輯模塊和I／O模塊重新配置，以實現用戶所需邏輯功能。用戶對FPGA的編程數據放入芯片，通過上電加載到FPGA中，對其進行初始化；也可在線對其編程，實現系統在線重構。基于FPGA技術的圖像采集主要是通過集成的FPGA開發板，使用軟件編程把圖像的采集控制程
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