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        arm+fpga 文章 最新資訊

        用單片機實現SRAM工藝FPGA的加密應用

        •   摘要:首先對采用SRAM工藝的FPGA的保密性和加密方法進行原理分析,然后提出一種實用的采用單片機產生長偽隨機碼實現加密的方法,并詳細介紹具體的電路和程序。     關鍵詞:靜態隨機存儲器(SRAM) 現場可編程門陣列(FPGA) 加密   在現代電子系統設計中,由于可編程邏輯器件的卓越性能、靈活方便的可升級特性,而得到了廣泛的應用。由于大規模高密度可編程邏輯器件多采用SRAM工藝,要求每次上電,對FPGA器件進行重配置,這就使得可以通過監視配置的位數據流,進行克隆
        • 關鍵字: 靜態隨機存儲器(SRAM)  現場可編程門陣列(FPGA)  加密  MCU和嵌入式微處理器  

        基于PXA255的ARM Linux操作系統移植

        • 基于PXA255的ARM Linux操作系統移植,本文以新一代高端嵌入式處理器PXA255為例,進行ARM Linux的移植,闡述了移植中需要解決的關鍵技術,包括:內核的定制、文件系統的創建、設備驅動的移植等。
        • 關鍵字: 操作系統  移植  Linux  ARM  PXA255  基于  

        基于ARM LPC2132的智能電動機保護器設計

        • 基于ARM LPC2132的智能電動機保護器設計,本文介紹的低壓智能電動保護器,采用ARM嵌入式微處理器LPC2132為系統主控芯片,充分利用LPC2132的各種內置功能,簡化了系統設計,具有很高的性價比。
        • 關鍵字: 保護器  設計  電動機  智能  ARM  LPC2132  基于  

        基于CPLD/FPGA的出租車計費器系統的設計實現

        • 1 引言   隨著EDA技術的發展及大規模可編程邏輯器件CPLD/FPGA的出現,電子系統的設計技術和工具發生了巨大的變化,通過EDA技術對CPLD/FP-GA編程開發產品,不僅成本低、周期短、可靠性高,而且可隨時在系統中修改其邏輯功能。本文介紹了一種以Altera公司可編程邏輯器件EP1K30TC144-3為控制核心,附加一定外圍電路組成的出租車計費器系統。   2 系統總體結構   基于CPLD的出租車計費器的組成如圖1所示。各部分主要功能包括:信號輸入模塊對車輪傳感器傳送的脈沖信號進行計數(
        • 關鍵字: 嵌入式系統  單片機  CPLD  FPGA  計費器  嵌入式  

        基于MCU和FPGA靈活設計車載信息娛樂系統

        • 應用MCU+FPGA的設計,軟件和外設硬件都可以在FPGA中變化,整個系統相當于一個很容易進行升級的軟件,改變硬件就像改變軟件一樣簡單。
        • 關鍵字: 信息  娛樂  系統  車載  設計  MCU  FPGA  靈活  基于  

        基于FPGA的發電機組頻率測量計的實現

        • 利用Verilog HDL 硬件描述語言自頂向下的設計方法和QuartusⅡ 軟件,在復雜的可編程邏輯器件(FPGA, Field Programmable Gate Array)中實現了發電機組頻率測量計的設
        • 關鍵字: FPGA  發電機組  測量計  頻率    

        基于FPGA的IDE硬盤接口卡的實現

        • 引言   本文采用FPGA實現了IDE硬盤接口協議。系統提供兩套符合ATA-6規范的IDE接口,一個與普通IDE硬盤連接,另一個與計算機主板上的IDE接口相連。系統采用FPGA實現接口協議,完成接口數據的截獲、處理(在本文中主要是數據加密)和轉發,支持PIO和Ultra DMA兩種數據傳輸模式。下面重點介紹用FPGA實現接口協議的方法。   1 IDE接口協議簡介   1.1 IDE接口引腳定義   IDE(Integrated Drive Electronics)即“電子集成驅動器”,又稱為A
        • 關鍵字: 嵌入式系統  單片機  FPGA  IDE硬盤  ATA-6  嵌入式  

        Actel FPGA 協助LYYN AB的技術平臺提高清晰度

        • Actel 公司宣布專業從事視頻增強技術的瑞典LYYN AB公司已經利用Actel的ProASIC3系列現場可編程門陣列 (FPGA) 器件開發出軟件和硬件視頻處理平臺,此舉進一步顯示了低功耗單芯片FPGA技術所具備的先進創新性。這個解決方案提高了視頻錄像的清晰度,可在雪、霧、水底淤泥和黑暗環境中提供更好的可見度。LYYN的產品主要用于遙控操作車輛 (ROV) 和飛機 (UAV) 以及便攜式設備如水底攝像機和先進的監視系統等。
        • 關鍵字: 嵌入式系統  單片機  Actel  FPGA  LYYN  嵌入式  

        基于ARM的MPEG4視頻解碼器

        • 摘  要  詳細闡述了針對ARM平臺的MPEG4視頻解碼算法的優化方法。實驗數據表明,優化后的解碼器性能得到了全面提升。還結合ARM7TDMI的Easy ARM2200開發平臺,給出了嵌入式MPEG-4視頻解碼的實時實現。關鍵詞  ARM,MPEG4,嵌入系統,視頻解碼器 1  引  言     本文旨在研究基于ARM微處理器的MPEG-4視頻解碼技術,主要應用在手持移動設備中。利用嵌入式系統實現MPEG-4視頻解碼,處
        • 關鍵字: 消費電子  嵌入式系統  單片機  ARM  MPEG4  視頻解碼器  消費電子  

        基于ARM的GPS地面目標跟蹤及報警系統的設計

        • 基于ARM微控制器的嵌入式系統能夠完成所需的各種協議,能夠滿足系統的軟硬件需求。地面目標跟蹤及報警系統整合了GPS、GSM技術,利用GSM的SMS功能實現手持終端和監控中心之間的數據傳送,以實施對目標的實時定位跟蹤。
        • 關鍵字: 跟蹤  報警系統  設計  目標  地面  ARM  GPS  基于  

        艾科瑞德推出最新的基于DSP+FPGA軟件無線電應用解決方案

        •   北京艾科瑞德科技有限公司日前宣布推出面向軟件無線電(Software Defined Radio,SDR)應用的解決方案—FFT-SDR-V4。由于采用了美國德州儀器公司(Texas Instruments,簡稱“TI”)最高運算能力的DSP(TMS320C6416, 1G)和Xinlinx高容量的FPGA (2000萬門),解決了軟件無線電發展中的瓶頸技術—信號處理的運算能力問題。  所謂軟件無線電,就是采用數字信號處理技術,在可編程控制的通用硬件平臺上,利用軟件來定義實現無線電臺的各部分功能:包括
        • 關鍵字: 艾科瑞德  DSP  FPGA  無線電  嵌入式  消費電子  

        多核與多執行緒的嵌入式系統解決方案

        • 在嵌入式裝置中建置多核心(包含同質或異質)以及多執行緒技術,的確能帶來諸多效益,尤其是改進系統效能方面最為明顯。   盡管RISC嵌入式技術所面臨的挑戰越來越多,但是在維持以往嵌入式軟件資源兼容性的前提之下,能夠改善其未來適用性,并且有效提升新系統的效能表現,使其不失為良好的解決方案。   應用決定多核或多緒   多核心與多執行緒在效能表現上有其幫助,但是效能與這些技術的內建其實并沒有絕對關系,會造成這樣的原因主要是應用環境的需求。以手機為例,整合于手機內的SoC芯片雖然是屬于多核心架構的一環,但
        • 關鍵字: 嵌入式系統  單片機  多核  ARM  處理器  嵌入式  

        基于DSP Builder的DDS設計及其FPGA實現

        • 直接數字合成器,是采用數字技術的一種新型頻率合成技術,他通過控制頻率、相位增量的步長,產生各種不同頻率的信號。他具有一系列的優點;較高的頻率分辨率;可以實現快速的頻率切換;在頻率改變時能夠保持相位的連續;很容易實現頻率、相位和幅度的數控調制等。目前可采用專用芯片或可編程邏輯芯片實現DDS[1],專用的DDS芯片產生的信號波形、功能和控制方式固定,常不能滿足具體需要[2]。可編程邏輯器件具有器件規模大、工作速度快及可編程的硬件特點,并且開發周期短,易于升級,因為非常適合用于實現DDS。   1 DDS的
        • 關鍵字: 嵌入式系統  單片機  DSP  Builder  DDS  FPGA  嵌入式  

        基于FPGA的LDPC編碼器設計與實現

        • 引言   低密度奇偶校驗(Low Density Parity Check Code,LDPC)碼是一類具有稀疏校驗矩陣的線性分組碼,不僅有逼近Shannon限的良好性能,而且譯碼復雜度較低, 結構靈活,是近年信道編碼領域的研究熱點,目前已廣泛應用于深空通信、光纖通信、衛星數字視頻和音頻廣播等領域。LDPC碼已成為第四代通信系統(4G)強有力的競爭者,而基于LDPC碼的編碼方案已經被下一代衛星數字視頻廣播標準DVB-S2采納。   編碼器實現指標分析   作為前向糾錯系統的重要部分,設計高速率低復
        • 關鍵字: 嵌入式系統  單片機  LDPC  FPGA  奇偶校驗  嵌入式  

        基于雙Nios II的紅外圖像實時Otsu局部遞歸分割算法設計

        • 摘  要:針對傳統Otsu局部遞歸分割方法很難實時實現的局限性,提出了一種適合現場可編程門陣列(FPGA)中Nios II軟核處理器實現的快速Otsu局部遞歸分割算法,該算法的思路是把一次Otsu分割得到的目標區域作為新的圖像再進行一次Otsu分割,得到的結果作為最終分割閾值.利用并行Nios II和VHDL實現的硬件加速邏輯協同設計保證算法的實時實現。實驗結果表明,在不同的背景下,利用本文設計能夠實時穩定地對目標分割提取,具有較好的魯棒性。 關鍵字:FPGA&nb
        • 關鍵字: 嵌入式系統  單片機  FPGA  Nios  II  0tsu分割  局部遞歸  嵌入式  
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