可編程 文章 最新資訊
在應(yīng)用可編程測控網(wǎng)絡(luò)設(shè)計
- 電子產(chǎn)品的更新?lián)Q代越來越快，怎樣縮短設(shè)計時間，快速推出產(chǎn)品，降低設(shè)計成本和提高系統(tǒng)整體性能是每個設(shè)計人員共同關(guān)心的問題。一種叫做在應(yīng)用可編程(In Application Programming-IAP)的設(shè)計方案應(yīng)運而生，它可以
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應(yīng)用于頻率合成器的寬分頻比CMOS可編程分頻器設(shè)計
- 提出一種應(yīng)用于射頻頻率合成器的寬分頻比可編程分頻器設(shè)計。該分頻器采用脈沖吞吐結(jié)構(gòu)，可編程計數(shù)器和吞脈沖計數(shù)器都采用改進的CMOS源極耦合(SCL)邏輯結(jié)構(gòu)的模擬電路實現(xiàn)，相對于采用數(shù)字電路實現(xiàn)降低了電路的噪聲和減少了版圖面積。同時，對可編程分頻器中的檢測和置數(shù)邏輯做了改進，提高分頻器的工作頻率及穩(wěn)定性。最后，采用TSMC的0．13／μm CMOS工藝，利用Cadence Spectre工具進行仿真，在4．5 GHz頻率下，該分頻器可實現(xiàn)200～515的分頻比，整個功耗不超過19 mW，版圖面積為106 μ
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現(xiàn)場可編程門陣列的結(jié)構(gòu)與設(shè)計
- 現(xiàn)場可編程門陣列的結(jié)構(gòu)與設(shè)計,摘要：現(xiàn)場可編程門陣列（FPGA——Field Programmable Gate Array)是上世紀80年代末發(fā)展起來的新型大規(guī)模集成邏輯器件。它采用高級計算機輔助設(shè)計技術(shù)進行器件的開發(fā)與設(shè)計,其優(yōu)越性大大超過普通TTL集成門
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用AD5370模數(shù)轉(zhuǎn)換器組成的可編程40通道輸出電路
- 本電路采用多通道DAC配置，各組通道具有不同的輸出范圍。它利用AD5370提供40個DAC通道，具有16位分辨率。AD5370經(jīng)過配置，8個通道具有plusmn;10 V的輸出范圍，另外24個通道具有minus;4 V至+8 V的輸出范圍。AD5370是
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基于開關(guān)電容的模擬可編程設(shè)計實現(xiàn)
- 開關(guān)電容電路能把模擬和數(shù)字功能集成在單芯片上，這就是目前的片上系統(tǒng)。傳統(tǒng)的模擬信號處理電路采用持續(xù)時基電路，包括電阻、電容和運算放大器。持續(xù)時基模擬電路使用電阻比、電阻強度或電阻值、電容值等設(shè)置轉(zhuǎn)移
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采用開關(guān)電容實現(xiàn)模擬領(lǐng)域內(nèi)的可編程設(shè)計
- 可擴展性和客戶要求的動態(tài)變化是設(shè)計人員用混合功能組件實施系統(tǒng)所面臨的兩大挑戰(zhàn)。模塊化可編程設(shè)計有助于解決設(shè)計晚期階段不同器件之間設(shè)計方案的移植問題。因此，可編程解決方案相對于固定功能實施方案而言始終是更好的選擇。在模擬領(lǐng)域?qū)嵤┛删幊探鉀Q方案一直非常困難。開關(guān)電容電路的使用非常有助于解決上述困難。開關(guān)電容塊是可編程模擬解決方案的基本構(gòu)建塊。
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