基于FPGA的多通道校準(zhǔn)算法同步實(shí)現(xiàn)
作者：龔廣偉 韓方景 陳凡 國防科技大學(xué)電子科學(xué)與工程學(xué)院(湖南長沙410073) 喬佩 長沙理工大學(xué)(湖南長沙410073)
時間：2009-07-08
來源：電子產(chǎn)品世界
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表1為多通道校準(zhǔn)算法的FPGA資源占用列表，從系統(tǒng)資源占用情況可以看出：多通道校準(zhǔn)算法FPGA實(shí)現(xiàn)過程中，如果再加上前后端處理程序一起編譯，則輸入輸出端口將減少，資源占用也將減少，并不影響系統(tǒng)實(shí)現(xiàn)。其它各種資源占用量都較少，完全符合FPGA設(shè)計要求。
本文引用地址：http://www.104case.com/article/96056.htm
FPGA布局布線后的仿真波形如圖4、圖5所示。
從仿真結(jié)果(圖4，圖5)和ISE 8.2i的綜合報告可知，該校正模塊的最高時鐘頻率達(dá)到102.5MHz。
最后，由MATLAB仿真和FPGA布局布線后仿真得到的權(quán)值，經(jīng)過MATLAB仿真形成新的方向圖，如圖6所示，可以看出，兩種方向圖基本一致。因此，基于FPGA的多通道校準(zhǔn)同步算法的實(shí)現(xiàn)完全符合系統(tǒng)要求。
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