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        利用完全可編程平臺(tái)實(shí)現(xiàn)高效的馬達(dá)控制

        作者: 時(shí)間:2013-11-22 來源:網(wǎng)絡(luò) 收藏

        圖4和圖5即為對(duì)PWM和PFM的FFT(快速傅里葉變換)頻率分析的對(duì)比情況。可以清楚地看到PFM可以消除第三次諧波失真。

        4:脈沖寬度調(diào)制方案產(chǎn)生的諧波。諧波會(huì)導(dǎo)致能量損耗和馬達(dá)振動(dòng)。

        圖4:脈沖寬度調(diào)制方案產(chǎn)生的諧波。諧波會(huì)導(dǎo)致能量損耗和馬達(dá)振動(dòng)。

        圖5:脈沖頻率調(diào)制方案中產(chǎn)生的諧波可分散到所有頻譜上。看不到諧波尖峰。

        圖5:脈沖頻率調(diào)制方案中產(chǎn)生的諧波可分散到所有頻譜上。看不到諧波尖峰。

        實(shí)現(xiàn)方案

        市場(chǎng)上已經(jīng)有用于三相馬達(dá)的磁場(chǎng)定向控制實(shí)現(xiàn)解決方案。除了實(shí)現(xiàn)復(fù)雜的算法,設(shè)計(jì)人員還應(yīng)考慮該實(shí)現(xiàn)方案能否在馬達(dá)運(yùn)行中在SVPWM、正弦PWM和FPM等不同調(diào)制方案間實(shí)時(shí)切換。其他需要考慮的方面有:

        - 使用同一器件控制多軸

        - 集成實(shí)時(shí)網(wǎng)絡(luò)協(xié)議和更新

        - 功能安全設(shè)計(jì)

        要達(dá)到本文描述的性能,可以選用 All Programmable SoC。 All Programmable SoC完美集成了1GHz 雙核 Cortex A9處理器子系統(tǒng)和FPGA架構(gòu)(如圖6所示)。SoC子系統(tǒng)內(nèi)置SPI、I2C、UART、CAN、USB、GigE MAC等常見外設(shè)和接口,以及通用存儲(chǔ)器接口。高帶寬AMBA AXI互聯(lián)用于處理器子系統(tǒng)和FPGA之間的直接連接,以實(shí)現(xiàn)高速數(shù)據(jù)互聯(lián)。此外,Zynq器件采用靈活的IO標(biāo)準(zhǔn),便于連接外部器件。

        圖6: All Programmable SoC由嵌入式雙核Cortex A9處理器子系統(tǒng)(灰色)和可編程FPGA邏輯(黃色)組成,為提供一款終極平臺(tái),可在軟/硬件模塊間實(shí)現(xiàn)無縫互操作性。

        Zynq-7000 AP SoC經(jīng)過精心設(shè)計(jì),在單個(gè)芯片上即可提供一款最佳的平臺(tái)。Cortex A9處理器可用于運(yùn)行網(wǎng)絡(luò)軟件協(xié)議棧、操作系統(tǒng)以及用戶的應(yīng)用代碼。它們均以軟件方式運(yùn)行,可實(shí)現(xiàn)對(duì)器件的總體應(yīng)用管理。對(duì)于算法、調(diào)制實(shí)現(xiàn)方案和供工業(yè)網(wǎng)絡(luò)使用的定制MAC等關(guān)鍵性功能模塊,最好在FPGA架構(gòu)中實(shí)現(xiàn),以便發(fā)揮硬件加速和高速計(jì)算優(yōu)勢(shì)。由于嵌入式處理器和FPGA架構(gòu)集成在單個(gè)器件中,可以靈活選用軟/硬件架構(gòu)。

        圖7:Zynq-7000上的馬達(dá)控制平臺(tái)架構(gòu)樣例。網(wǎng)絡(luò)協(xié)議棧、軟件應(yīng)用、RTOS由A9子系統(tǒng)負(fù)責(zé)執(zhí)行。馬達(dá)控制算法、調(diào)制方案和定制MAC應(yīng)布置在FPGA架構(gòu)中,以獲取實(shí)時(shí)性能。

        圖7:Zynq-7000上的平臺(tái)架構(gòu)樣例。網(wǎng)絡(luò)協(xié)議棧、軟件應(yīng)用、RTOS由A9子系統(tǒng)負(fù)責(zé)執(zhí)行。馬達(dá)控制算法、調(diào)制方案和定制MAC應(yīng)布置在FPGA架構(gòu)中,以獲取實(shí)時(shí)性能。

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