應用EDA仿真技術解決FPGA設計開發中故障的方法
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在仿真環境中復現bug波形如圖5所示。
圖5 ModelSim環境下復現的出錯數據
把圖5和圖1進行比較，可見通過這種方法我們在仿真環境下建立了bug出錯時的環境，得到相同的輸出出錯數據。
③修改程序后在仿真環境驗證修改是否成功
修改程序后，我們只要使用同樣的環境進行仿真，并且有針對性的觀察bug是否解決。本例中出現bug的原因是使用了異步FIFO，改成同步 FIFO后，問題應該就會解決，我們可以通過仿真驗證。修改程序后仿真的波形如圖6所示。
圖6 修改程序后相同條件下的輸出數據
由圖6可見，修改后相同的條件FIFO讀出4個數，說明沒有讀空，符合要求，bug解決。圖7為版本編譯后上板使用SignalTap抓取的信號波形，以作比較。
圖7 修改程序后SignalTap抓的信號
比較后易見，波形完全相同，說明方法可行。
總結
文中描述的方法可針對各種的故障的解決。在故障出現時，只需定位出錯的模塊，這些模塊內嵌一些子模塊也無妨；抓信號時將故障模塊的輸入輸出信號抓出即可；利用輸入信號重建故障環境，若仿真輸出信號和所抓輸出信號相同，說明故障環境建立正確；用這個仿真平臺就可以具體定位是哪個子模塊、哪個信號出錯，而不需要在SignalTap中把這些信號抓出來；并且在修改代碼后可以驗證是否修改成功，節省時間，很明確的證明故障真的被解決了，事半功倍。
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