基于EDMA的FPGA與DSP圖像傳輸的設計與實現
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4 實驗結果
DSP提供給FPGA的時鐘為100 MHz，傳輸一幅320×256的圖像需要約為0．8 ms。傳輸速度較快，可以滿足圖像快速傳輸以及實時處理的要求。TI的開發平臺CCS可以觀察存儲器中的數據，并把收到的存在存儲器中的數據顯示成圖像，從而可以驗證傳輸的正確性以及穩定性。數據源為模擬圖像時，相機拍攝的原始圖像和DSP收到的圖像如圖5和圖6所示。本文引用地址：http://www.104case.com/article/190722.htm
數據源為數字信號時，原始圖像為14位數據，TI的仿真平臺只能顯示8位圖像，所以DSP中收到的圖像數據只能以高8位進行顯示，但會丟掉圖像的一些細節，圖像整體偏暗。由于系統采用的數字圖像由中波紅外熱像儀采集，由于視場差別，原始圖像無法采集。圖7為提取高8位圖像數據顯示的圖像。
圖5～圖7中的圖像經過多次傳輸驗證，沒有出現錯誤的圖像。說明該系統實現的圖像數據傳輸滿足圖像實時處理的速度要求以及可靠性要求。
5 結束語
介紹了一種FPGA向DSP的數據傳輸方法，描述了EDMA的特點以及由其控制的數據傳輸的實現過程。所介紹的方法在開發的實驗平臺上，進行了驗證。文中介紹了FPGA向DSP的傳輸，更改EDMA的源地址與目的地址及相關參數可以實現DSP向FPGA的數據傳輸。
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