無線射頻收發系統硬件設計
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1．1．2 發射工作原理
數字基帶信號從TX DATA引入TRF6900片內，經過直接數字頻率合成器(DDS)調制到中頻，再通過鎖相環(PLL)倍頻到射頻，最后通過功率放大器放大信號后，由PA OUT導出射頻信號，再通過天線發射出去。
1．1．3 串行控制接口工作原理
串行控制接口包括CLOCK，DATA，STOBE三部分，控制著TRF6900內部所有的寄存器，包括DDS參數設定寄存器和其他的控制寄存器。在CLOCK的每一個上升沿，DATA管腳的邏輯值送入24 b的移位寄存器，當STOBE電平被抬高時，設定的參數被送入選定的鎖存器。TRF6900有四個可編程的24 b控制字(A，B，C，D)?？刂谱諥和B分別控制DDS模式0和模式1狀態下輸出信號頻率?？刂谱諧負責鎖相環和DDS模式O的設定。控制字D負責調制和DDS模式1的設定。
1．2數字基帶部分
數字基帶部分基于微型控制器MSP430F1121。通過它將外部的模擬信號轉換為適合TRF6900的數字信號，再配合軟件設計可以很方便地進行智能化轉換。數字基帶部分的硬件電路由RS 232和MSP430F1121組成，如圖1所示。
MSP430F112l微型控制器是一款超低功耗、高性能的16位精簡指令集MCU，主要由以下部分組成：基礎時鐘模塊，包括1個數控振蕩器(DCO)和1個晶體振蕩器；看門狗定時器Watchdog Timer，可用作通用定時器；帶有3個捕捉／比較寄存器的16位定時器Timer_A；2個具有中斷功能的8位并行端口：P1與P2；模擬比較器Comparator A。本文引用地址：http://www.104case.com/article/157502.htm
2 系統參數計算
2．1 鑒相器的參考頻率
鑒相器是PPL構成鎖相環中的單元模塊之一，其輸入的參考頻率是由DDS的輸出信號決定的?；贒SS技術的頻率合成器能很好地滿足各項指標性能，同時也使設計變得簡單。鑒相器輸出頻率的分辨率為：
式中：fpd是鑒相器的最小輸入頻率，也是DDS時鐘頻率fref的2°，即最低有效位的權值。TRF6900 DDS累加器有24位，fpd乘以預標值N(可選擇256或者512)，由它可得出最小頻率的步進值為：
累加器的輸入是24位的用戶串行數據(控制字)，時鐘基準信號作為累加器的工作時鐘信號，兩者決定頻率的分辨率；輸出是一串抽樣斜坡數字脈沖，空號頻率等于時鐘頻率。經過D／A轉換后得到模擬域的正弦信號fo_DSS，它代表基準相位，即作為鑒相器的基準輸入信號。DDS的最終性能主要取決于D／A轉換過程中的量化誤差以及濾波特性。
2．2 晶振時鐘電路及頻率
2．2．1 時鐘電路的設計及參數計算
晶振采用并聯諧振的工作方式，如圖1中23～24腳外圍電路所示。電路總的相移為360°，其中反向器提供180°的相移，R7和C22提供90°的滯后相位，晶振和電容C1也帶來90°的相位滯后。并聯工作的晶振是作為電感用的。晶振接入電容補償相移以滿足振蕩條件。
偏振電阻R1用于設置反相器的偏置點，典型值是Vcc引腳值的二分之一。R1過小，將降低環路增益，破壞網絡反饋條件，典型值是1～5 MΩ?？梢杂^察23引腳的輸出頻率隨電壓的變化情況。如果晶振有過驅動，則增大電壓后，輸出頻率會下降，此時應該微調電阻R2(調高)。注意，R2應該足夠小，以確保振蕩器在小于最小工作電壓的情況下能夠起振。C1和晶振的旁路電容Co及反相器的輸入電容共同構成了晶振的輸入電容。要提供穩定度，晶振的輸入電容典型值可選擇20～30 pF。
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