聲納信號處理中UDP協(xié)議數(shù)據(jù)傳輸研究與設(shè)計(jì)
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外部數(shù)據(jù)從以太網(wǎng)口經(jīng)過物理層傳入到接收端的數(shù)據(jù)緩沖區(qū)RAM中，外部數(shù)據(jù)是UDP格式的數(shù)據(jù)。接收模塊Rx從數(shù)據(jù)緩沖區(qū)RAM中提取數(shù)據(jù)，在提取的過程中，Rx模塊中的應(yīng)用程序?qū)?a class="contentlabel" href="http://www.104case.com/news/listbylabel/label/UDP">UDP格式的數(shù)據(jù)的首部去除，只提取有效載荷部分。根據(jù)UDP數(shù)據(jù)包中的目的端口號，Rx將去UDP格式化的裸數(shù)據(jù)發(fā)送給Link口，完成接收端模塊的功能任務(wù)，其示意圖如圖3所示。本文引用地址：http://www.104case.com/article/155092.htm
1．2 Link模塊設(shè)計(jì)
在發(fā)送過程中，外部數(shù)據(jù)經(jīng)過Link口傳輸給發(fā)送模塊(Tx)進(jìn)行打包處理，然后傳輸至MAC。Link端模塊設(shè)計(jì)如圖4所示。
當(dāng)acki為0時(shí)開始進(jìn)行數(shù)據(jù)傳輸。工作時(shí)，有3個(gè)時(shí)鐘輸入：Link口時(shí)鐘clk和clk270，以及系統(tǒng)本地時(shí)鐘clk4。其中，clk4的頻率是Link口時(shí)鐘的1／4。Link的時(shí)序效果圖如圖5所示，在時(shí)鐘的卜升沿與下降沿進(jìn)行數(shù)據(jù)存寫。雙倍速率的數(shù)據(jù)通過Link后被分為單倍速率的數(shù)據(jù)寫入U(xiǎn)DP發(fā)送端Tx中。從Link出來的數(shù)據(jù)傳入發(fā)送端Tx時(shí)，時(shí)鐘每跳變一次，地址增加一次，發(fā)送端Tx將增加的地址寫入到數(shù)據(jù)緩沖區(qū)RAM中，進(jìn)行打包。
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