- 有多個處理單元的SoC器件目前是產品設計鏈上的重要一環。本文綜合各種因素評估了不同處理單元的優缺點，并通過衛星無線電接收器的設計實例幫助開發人員理解SoC所涉及處理任務之間的復雜平衡并有效掌握系統功能的劃分
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SoC 處理單元 性能
- 基于ARM9和μC／OS-II的SD卡文件系統設計與實現,摘要：主要針對貨車動態稱重系統中大量實時載重數據存取的需求而做的設計。該設計基于ARM9和mu;C／OS-II相結合的軟硬件平臺，實現了一種SD卡文件系統。SD卡的接口電路采用SD總線模式連接，軟件設計基于嵌入式操作系
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系統 設計 實現 文件 SD ARM9 OS-II 基于
- SoC設計之組態性處理器IP介紹,由于半導體工藝進步，相同芯片面積中可以放入愈來愈多的晶體管，致使這10多年來業界開始積極發展所謂的系統單芯片SoC，而可組態性處理器IP概念就像自助餐式的自組拼盤，提供嵌入式系統更寬廣的應用空間hellip;
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IP 介紹 處理器 組態 設計 SoC
- 基于電子記帳控稅終端機設計的片上系統SOC芯片研究,1 引 言
電子記帳控稅終端機屬于高度安全和可靠的產品，關系到信息安全和金融安全，長期使用國外的核心器件將給國家安全帶來嚴重隱患。擁有自主知識產權的嵌入式處理器、專用芯片及其嵌入式操作系統已成為振興我國
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SOC 芯片 研究 系統 設計 電子 記帳 終端機 基于
- Zynq?-7000 EPP 系列器件將處理器的軟件可編程能力與 FPGA 的硬件可編程能力實現完美結合，以低功耗和低成本等系統優勢實現無以倫比的系統性能、靈活性、可擴展性，同時可以加速產品上市進程。 與傳統的 SoC 處理解決方案不同，Zynq-7000 器件的靈活可編程邏輯能實現優化與差異化功能，使設計人員可以根據大部分應用的要求添加外設和加速器。
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SoC Z-7010
- SoC廠商如何在提高復雜器件傳輸速度的同時降低測試成本?隨著先進的集成電路(IC)設計方法和高密度生產技術的使用，半導體廠商能夠把不同的數字和模擬電路集成在極小芯片上，其尺寸之小、功能之全尚無先例，我們稱之為
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SoC 片上芯片 測試方案
- 對基于SoC系統設計的探查,調試復雜電子系統從來都不是一項簡單的工作，但至少是可以實現的。您要找到問題所在。采用您最相信的“示波器”，通過模擬電路到數字轉換，您可以追溯到問題的源頭。然后，編寫測試小程序，檢查驅動和外設
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探查 設計 系統 SoC 基于
- Stratix? II GX是唯一能夠在20個通道上同時支持數據速率高達6.375 Gbps嵌入式收發器的FPGA，滿足了當今前沿應用的帶寬需求。隨著數據速率的提高，電路板設計人員面臨的挑戰也在增加。例如，Stratix II GX收發器支持的
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Stratix II 電路板 方案
- μC／OS-II的多任務系統在SOPC中的硬件實現,本人在教學及科研實驗中，對基于mu;C/OS-II的多任務系統在SOPC中的設計總結出了具體實現方法。經過實踐驗證，該方法簡單、可靠，值得推廣。1 mu;C/OS實時操作系統mu;C/OS-II是一個可移植、可裁剪、占先式、實時的
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硬件 實現 SOPC 系統 任務 OS-II
- 在當今的多媒體系統芯片中整合進經過硅驗證并針對特定音頻功能優化過的音頻IP，有利于降低功耗、減少體積和縮減成本。但隨著下一代設計走向 28nm工藝技術，也隨之會出現新的挑戰。音頻編解碼器中的音頻設計包括了很多
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SoC 音頻編解碼器 設計實現
- SOC時序分析中的跳變點介紹, 跳變點是所有重要時序分析工具中的一個重要概念。跳變點被時序分析工具用來計算設計節點上的時延與過渡值。跳變點的有些不同含義可能會被時序分析工程師忽略。而這在SOC設計后期，也就是要對時序簽字時可能會導致問
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介紹 分析 時序 SOC
- 系統芯片ZSU32在SoC芯片設計中的應用,本文針對中山大學ASIC設計中心自主開發的一款系統芯片ZSU32，以Synopsys公司的Design Compiler為綜合工具，探索了對SoC芯片進行綜合的設計流程和方法，特別對綜合過程的時序約束進行了詳細討論，提出了有效的綜合約束
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芯片 應用 設計 ZSU32 系統 SoC
- 電子產品世界,為電子工程師提供全面的電子產品信息和行業解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
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μC/OS-II GPRS終端 32位RISC
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