fsp:fpga-pcb 文章 最新資訊
基于FPGA的電子密碼鎖的研制
- 介紹在QUATUSII環(huán)境下，采用FPGA可編程邏輯器件開發(fā)的電子密碼鎖，并利用狀態(tài)機(jī)（FSM）實(shí)現(xiàn)鍵盤消抖及系統(tǒng)主控模塊的行為控制，從實(shí)際工程設(shè)計(jì)角度闡述了系統(tǒng)所有模塊及其工作原理、軟件設(shè)計(jì)方法，提出了系統(tǒng)設(shè)計(jì)注意要點(diǎn)。
- 關(guān)鍵字： QUATUSII 密碼鎖 FPGA 狀態(tài)機(jī)
FPGA在航空電子系統(tǒng)中的設(shè)計(jì)應(yīng)用
- 由于競(jìng)爭的壓力和對(duì)飛機(jī)性能無止境的追求，航空電子從簡單、獨(dú)立的設(shè)備發(fā)展到如今以每秒百萬位乃至更快的速度交換信息的高級(jí)智能系統(tǒng)網(wǎng)絡(luò)。這也帶來了必須克服的許多設(shè)計(jì)問題。
- 關(guān)鍵字： 高級(jí)智能系統(tǒng)網(wǎng)絡(luò) 航空電子 FPGA
數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：系統(tǒng)硬件配置方案
- FPGA作可編程器件，可以根據(jù)用戶的需要進(jìn)行現(xiàn)場(chǎng)可編程。系統(tǒng)可采用了JTAG模式和AS模式進(jìn)行FPGA編程配置。
- 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng) JTAG FPGA EPC1441PC8
數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：系統(tǒng)原理框圖
- 本系統(tǒng)采用了兩片SRAM存儲(chǔ)器構(gòu)成乒乓緩沖結(jié)構(gòu)來完成視頻的采集和處理，視頻的采集和輸出部分采用了應(yīng)用廣泛的SAA71XX系列。
- 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng) SRAM存儲(chǔ)器 乒乓緩沖 FPGA
數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：系統(tǒng)工作原理分析
- 如前所述，本系統(tǒng)主要完成對(duì)輸入視頻圖像的兩倍放大。圖像的放大主要是通過插值算法來實(shí)現(xiàn)的，下面詳細(xì)分析如何應(yīng)用雙線性插值算法來實(shí)現(xiàn)倍焦功能。
- 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng) 乘法器 FPGA
有限狀態(tài)機(jī)的FPGA設(shè)計(jì)
- 有限狀態(tài)機(jī)是一種常見的電路，由于時(shí)序電路和組合電路組成，設(shè)計(jì)有限狀態(tài)機(jī)的第一步是確定采用Moore狀態(tài)機(jī)還是采用Mealy狀態(tài)機(jī)。Mealy狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)變不僅和當(dāng)前狀態(tài)有關(guān)，而且和各輸入信號(hào)有關(guān)；Moore狀態(tài)機(jī)的轉(zhuǎn)變只和當(dāng)前狀態(tài)有關(guān)。從電路實(shí)現(xiàn)功能上來講，任何一種都可以實(shí)現(xiàn)同樣的功能。但他們的輸出時(shí)序不同，所以選擇使用哪種狀態(tài)機(jī)是要根據(jù)具體情況來定。
- 關(guān)鍵字： Moore狀態(tài)機(jī) Mealy狀態(tài)機(jī) FPGA
數(shù)字圖像倍焦系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)綜合實(shí)例之：設(shè)計(jì)需求分析與芯片選型
- 在數(shù)字圖像處理和通信、遙感圖像分析、醫(yī)學(xué)成像診斷等應(yīng)用領(lǐng)域，為了便于顯示、觀察或進(jìn)行進(jìn)一步的處理，常常需要對(duì)原始的數(shù)字圖像進(jìn)行特征提取(如邊緣檢測(cè)、邊緣銳化)、噪聲平滑濾波、幾何校正、尺寸縮放等處理，這類圖像處理技術(shù)稱為圖像的預(yù)處理。在實(shí)際應(yīng)用中，圖像的預(yù)處理功能很多可以通過FPGA來實(shí)現(xiàn)。
- 關(guān)鍵字： 數(shù)字圖像倍焦系統(tǒng) 視頻解碼器 FPGA 視頻編碼器 乒乓緩沖區(qū)
H.264/AVC中CAVLC編碼器的硬件設(shè)計(jì)與實(shí)現(xiàn)
- 設(shè)計(jì)了一種H.264標(biāo)準(zhǔn)的CAVLC編碼器，對(duì)原有軟件流程進(jìn)行部分改進(jìn)，提出了并行處理各編碼子模塊的算法結(jié)構(gòu)。
- 關(guān)鍵字： 變長編碼 非零系數(shù)級(jí)編碼 FPGA
FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之：典型實(shí)例-整數(shù)DCT變換的設(shè)計(jì)與實(shí)現(xiàn)
- 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了視頻壓縮標(biāo)準(zhǔn)H.264算法中的整數(shù)DCT變換部分，幫助讀者了解并行流水設(shè)計(jì)技巧在算法優(yōu)化中的作用。
- 關(guān)鍵字： DSP 協(xié)同處理 FPGA 整數(shù)DCT變換 H.264
FPGA/CPLD狀態(tài)機(jī)穩(wěn)定性研究
- 在FPGA/CPLD設(shè)計(jì)中,狀態(tài)機(jī)是最典型、應(yīng)用最廣泛的時(shí)序電路模塊,如何設(shè)計(jì)一個(gè)穩(wěn)定可靠的狀態(tài)機(jī)是我們必須面對(duì)的問題.
- 關(guān)鍵字： 時(shí)序電路 狀態(tài)機(jī) FPGA
FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之：FPGA+DSP協(xié)同平臺(tái)的調(diào)試技巧和注意事項(xiàng)
- 作為雙芯片的協(xié)同系統(tǒng)，調(diào)試的開始階段需要對(duì)每個(gè)芯片進(jìn)行單獨(dú)測(cè)試。這種情況下就需要避免另外一個(gè)芯片對(duì)調(diào)試產(chǎn)生影響，比較好的辦法就是讓它停止工作。
- 關(guān)鍵字： DSP 協(xié)同處理 FPGA 內(nèi)部邏輯分析儀 隔離調(diào)試
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