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LabVIEW FPGA DAQ 自動
軟件無線電的出現，是無線電通信從模擬到數字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無...
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FPGA 軟件無線電平臺
引言 分頻器在CPLD/FPGA設計中使用頻率比較高,盡管目前大部分設計中采用芯片廠家集成的鎖相環資源 ,但是對于要求奇數倍分頻（如3、5等）、小數倍（如2.5、3.5等）分頻、占空比50%的應用場合卻往往不能滿足要求。
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CPLD FPGA 多功能 分頻器
基于DSP和FPGA的調幅廣播信號監測系統, 引言 隨著通信與廣播電視業務的發展，無線電頻譜迅速、大量的被占用，頻道擁擠和相互間干擾日趨嚴重，為了能有效地利用無線電頻譜，減少相互間的干擾，信號監測業務隨之成為必要。調幅廣播信號監測系統是用于實
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信號 監測 系統 廣播 調幅 DSP FPGA 基于 DSP FPGA
Altera 公司 (NASDAQ: ALTR) 今天宣布推出業界首款支持 RapidIO® 2.1 規范的知識產權 (IP) 內核。Altera 的串行 RapidIO IP 內核可支持多達四條通道，每條通道速率為 5.0 GBaud，從而滿足了無線市場日益增長的帶寬和可靠性需求。該 IP 內核專門針對擁有多個嵌入式收發器的 Stratix® IV FPGA 而優化，并得到了Quartus® II 軟件 v9.1 的支持。
RapidIO 2.1 規范在許多應用中均可實
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Altera RapidIO FPGA Quartus
隨著經濟情勢與市場環境的改變,歷經長足發展的可編程邏輯組件(PLD)正憑借著成熟的技術將觸角深入量產型的消費及嵌入式市場,并以更加經濟的開發成本持續搶占傳統ASIC/ASSP市場.
"ASIC/ASSP的商業模式愈來愈難以為繼,"愛特(Actel)公司應用工程師陳冠志指出.巨額的芯片制造成本是首先面臨的關卡."300mm晶圓廠的成本以驚人的速度增長,在45nm節點約需30億美元;而到了32nm節點,估計會達到100億美元."另一方面,全球市場的動蕩情況,也
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Altera FPGA 40nm
全球可編程邏輯解決方案領導廠商賽靈思公司 (Xilinx, Inc. )日前宣布隆重推出EasyPath?-6 FPGA，該產品為高性能 FPGA 進入量產器件提供了六周內即可實現的總成本最低、風險最小的的解決方案， 在所有FPGA降低成本解決方案中轉入量產時間最快。新款 EasyPath FPGA 無最低訂購量限制，讓客戶可根據最終市場需求下訂單，且成本較購買等量的 FPGA 低 35%。
此外，雖然大多數成本降低的方案會讓設計選項受到限制，迫使客戶接受未經優化的部件或封裝， 然而
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Xilinx FPGA EasyPath
基于FPGA的神經網絡實現方法已成為實際實時應用神經網絡的一種途徑。本文就十多年來基于FPGA的ANN實現作一個系統的總結，例舉關鍵的技術問題，給出詳細的數據分析，引用相關的最新研究成果，對不同的實現方法和思想進行討論分析，并說明存在的問題以及改善方法，強調神經網絡FPGA實現的發展方向和潛力及提出自己的想法。另外，還指出基于FPGA實現神經網絡存在的瓶頸制約，最后對今后的研究趨勢作出估計。
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FPGA 人工神經網絡 實現方法
為實現目標識別與跟蹤的應用目的，在基于TMS320DM642的FIFO基礎上擴展存儲空間，提出一種基于FPGA實現SDRAM控制器的方法。分析所用SDRAM的特點和工作原理，介紹FPGA中SDRAM控制器的組成和工作流程，給出應用中讀SDRAM的時序圖。FPGA采用模塊化設計，增強SDRAM控制器的通用性，更方便地滿足實際需求。
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FPGA FIFO
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FPGA BP神經網絡 圖像壓縮 算法
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接口 設計 控制器 通信 同步 串行 三線 PLD CPLD FPGA
設計基于AD7543和FPGA的數／模轉換電路，介紹AD7543的主要特點、封裝形式、引腳功能和工作原理，設計基于AD7543轉換芯片的具體的數／模轉換硬件電路，利用Verilog HDL語言描述AD7543的控制時序，并給出具體的Veril-og HDL代碼及其仿真結果。實踐結果表明，該設計可行，可取代傳統的“CPU+專用的數／模轉換(D／A)芯片”設計結構，可進一步提高系統的可靠性和抗干擾能力。
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7543 FPGA AD 模
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