基于 TI TMSF24xTM/F28xTM DSP 的控制器事件管理器構成了其電動馬達相位控制功能的核心組件。由于基于 DSP 的控制器正在進入一個涉及高性能電子器件的觸發與控制的全新領域,因此 TI 決定開發一種全新的架構。
基于德州儀器 (TI) F24xTM 與 F28xTM 數字信號處理器 (DSP) 的控制器事件管理器模塊在 DSP 中采用可編程邏輯形式,以生成脈寬調制 (PWM) 信號,并主要滿足三相系統的設計要求;不過,由于具有一定靈活性,因此在添加一些軟件之后也可以輕松用于具有
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TI DSP PWM eEVM
可把每個電機控制電路分為驅動電路和控制軟件兩部分。根據電機類型、系統要求和硬/軟件復雜性折衷考慮,電機控制電路的兩部分可以相當簡單或特別復雜。
通常,較高性能系統需要更復雜的硬件。本文給出通常用于控制電機的一些基本電路的軟件構建單元。
驅動軟件:脈寬調制算法
脈寬調制(PWM)是新式數字電機控制的關鍵。調節脈沖寬度,可以有效地控制電機速度,而沒有較大的線性功率級。一些PICmicro MCU器件包含硬件PWM模塊,這些模塊內置在Capture? Compare/PWM(CC
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驅動電路 控制軟件 PWM
引言
電子密碼鎖系統主要由電子鎖體、電子密匙等部分組成,一把電子密匙里能存放多組開鎖密碼,用戶在使用過程中能夠隨時修改開鎖密碼,更新或配制鑰匙里開鎖密碼。一把電子鎖可配制多把鑰匙。語音方面的廣泛應用,使得具有語音播放的電子密碼鎖使用起來更加方便。語音密碼鎖的體積小、保密性能好、使用方便,是用在保險箱、電話或是房門上不可少的部分。
本文介紹的基于FPGA的語音密碼鎖電路具有顯示接口,顯示時可以是明文也可以是密文星號。由于FPGA具有ISP功能,當用戶需要更改時,如增加口令位數和更改口令權限管
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Altera FPGA 語音密碼鎖
高清晰電視(HDTV)視頻內容制作以及這些內容在帶寬受限廣播通道中的傳送技術得到了迅速發展,推動了新的視頻壓縮標準和相關圖像處理應用的進展。
視頻和圖像處理發展趨勢
與視頻和圖像處理相關的HDTV和數字影院等創新技術的發展非常迅速,其推動力量在于圖像采集和顯示分辨率、高級壓縮方法以及視頻智能的跨越式進步。廣播設備的分辨率在過去幾年中有了明顯的提高(HDTV—1920×1080象素和數字影院—4096×1714象素)。
高級壓縮方
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Altera FPGA HDTV
2008年4月3日,北京-全球可編程邏輯解決方案領導廠商賽靈思公司( Xilinx, Inc. (NASDAQ: XLNX) )今天宣布推出Virtex?-5 FXT 器件。這些FPGA器件在業界率先集成了嵌入式PowerPC? 440處理器模塊、高速RocketIO? GTX收發器和專用XtremeDSP? 處理能力。作為65nm Virtex-5系列的第四款平臺,Virtex-5 FXT提供了極高的性能,還可幫助設計人員降低系統成本、縮小板尺寸并減少元件數量
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可編程邏輯 賽靈思 FPGA
OFDM(正交頻分復用)是一種高效的多載波調制技術,其最大的特點是傳輸速率高,具有很強的抗碼間干擾和信道選擇性衰落能力。OFDM最初用于高速MODEM、數字移動通信和無線調頻信道上的寬帶數據傳輸,隨著IEEE802.11a協議、BRAN(Broadband Radio Access Network)和多媒體的發展,數字音頻廣播(DAB)、地面數字視頻廣播((DVB-T)和高清晰度電視((HDTV)都應用了OFDM技術。
OFDM利用離散傅立葉反變換/離散傅立葉變換(IDFT/DFT)代替多載波調
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OFDM FPGA
語音會議和全雙工語音會議
“語音會議”常被稱為“電話會議”,但電話會議只是語音會議的形式之一。實際上,語音會議的用戶終端并不限于電話機,也可以是調度機、會議機、指揮機等各種通信設備的語音終端;語音會議的通信網絡也并不限于普通的二線制PSTN電話網絡,還可以是四線制的語音網絡、專用的無線通信網絡或者有線/無線結合的綜合通信網絡。
在語音會議中,每個與會者都可以收聽會議,但不一定能夠發言。如果與會者要通過申請才能發言,那么習慣上稱其為&ldquo
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Altera FPGA Cyclone
2008年4月3日,北京-全球可編程邏輯解決方案領導廠商賽靈思公司( Xilinx, Inc. (NASDAQ: XLNX) )今天宣布推出Virtex?-5 FXT 器件。這些FPGA器件在業界率先集成了嵌入式PowerPC? 440處理器模塊、高速RocketIO? GTX收發器和專用XtremeDSP? 處理能力。作為65nm Virtex-5系列的第四款平臺,Virtex-5 FXT提供了極高的性能,還可幫助設計人員降低系統成本、縮小板尺寸并減少元件數量。在
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Xilinx FPGA
在技術發展的進程中,某些出現的里程碑式技術甚至引起了發展方向的全盤改變。最初常用的并行打印機端口現在幾乎已經絕跡了。系統結構以8/16/32位并行總線的方式實現硅器件和存儲器之間的互連。傳統的系統背板會定義寬度達64位的并線總線。由于用戶對更高保真度多媒體體驗的需求不斷提升,導致數據率不斷提高,系統數據吞吐量的要求呈現幾何級數的增長。不過,增加并行總線的寬度和時鐘的頻率并不是長期可行的解決方案,因為這種方法本身已經達到了某些技術死角,主要會碰到的問題包括PCB的空間限制、信號噪聲、信號完整性和避免信號
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FPGA
在2004年加入賽靈思公司之前,與大多數人的觀點一樣,我也認為FPGA“非常適用于原型設計,但對于批量DSP系統應用來說,成本太高,功耗太大。”,我原來一直認為,FPGA在成本和功效方面無法滿足今天采用DSP系統架構完成的那些設計的預算要求。然而,沒過多久,我源于“DSP視角”的看法就被大大地并且不可逆轉地改變了。
今天針對DSP優化的高性能FPGA已經在DSP領域扮演著重要的角色。DSP領域的設計工程師逐漸發現他們所處的環境變化十分迅速,標準快速
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FPGA 數字信號處理
2008年3月25日,北京 ——全球可編程解決方案領導廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX)今天宣布推出其ISE® Design Suite10.1版。這一統一的整體解決方案為FPGA邏輯、嵌入式和DSP設計人員提供了賽靈思的整個設計工具產品線,其中的設計工具具有完全的互操作能力。ISE Design Suite 10.1版以平均運行速度快兩倍的特性極大地加快了設計實施速度。因此設計人員可以在一天時間里完成多次反復設計。今天的發布另外一個重
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DSP 嵌入式 FPGA
引言
在設計可編程門陣列(FPGA)電路時,必須極端重視電源問題,從而使最終產品能在所有可能的條件下無缺陷工作并處于最優狀態。FPGA 電路電源有兩項需考慮的問題: FPGA 電路上電要求和電路功耗分析。這篇文章針對這兩方面的要求,討論您可能遇到的問題,以及解決方案。
目前FPGA電路設計所面臨的問題
FPGA電路通常需要多路電源輸入。為優化開機時的電流拖曳,防止鎖死和永久性的電路損壞,同時也為了防止開機接通時的毛刺干擾和降低開機接通的功耗,這些電源輸入必須具有精確的上電序列以及正確
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FPGA 電源
可變長編碼(VLC)是一種無損熵編碼,它廣泛應用于多媒體信息處理等諸多領域。在H.261/263、MPEG1/2/3等國際標準中,VLC占有重要地位。VLC的基本思想是對一組出現概率各不相同的信源符號,采用不同長度的碼字表示,對出現概率高的信源符號采用短碼字,對出現概率低的信源符號采用長碼字。Huffman編碼是一種典型的VLC,其編碼碼字的平均碼長非常接近于數據壓縮的理論極限——熵。
可變長解碼(VLD)是VLC的逆過程,它從一組連續的碼流中提取出可變長碼字,并將之轉換
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VLD 串行解碼 FPGA
fpga-pwm介紹
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