- 摘要：文中設計的均衡濾波器充分利用FPGA內部資源、時間換取空間的方法，在EP1C3系列的FPGA內實現1 024階FIR數字均衡濾波器，并通過重載系數，可實現多種頻率響應的均衡特性、簡易數字均衡濾波器的功能，達到了設計目
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FPGA 音頻 均衡 濾波器設計
- 基于FPGA的語音端點檢測,語音端點檢測就是從背景噪聲中找到語音的起點和終點，其目標是要在一段輸入信號中將語音信號同其他信號(如背景噪聲)分離并且準確地判斷出語音的端點。研究表明，即使在安靜的環境中，一半以上的語音識別系統識別錯誤
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檢測 語音 FPGA 基于
- 為了滿足目前對數據處理速度的需求，設計了一種基于FPGA+DDS的控制系統。根據AD9910的特點設計了控制系統的硬件部分，詳細闡述了電源、地和濾波器的設計。設計了FPGA的軟件控制流程，給出了流程圖和關鍵部分的例程，并對DDS AD9910各個控制寄存器的設置與時序進行詳細說明，最后給出了實驗結果。實驗結果證明輸出波形質量高、效果好。對于頻率源的設計與實現具有工程實踐意義。
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FPGA 9910 AD 控制設計
- 全球可編程邏輯解決方案領先廠商賽靈思公司(NASDAQ:XLNX))今日宣布與全球半導體設計、驗證和制造領域的軟件及 IP 領先廠商Synopsys公司(NASDAQ：SNPS)聯手推出《 FPGA的原型開發方法手冊》(FPMM)，這是一本介紹如何使用 FPGA 作為平臺進行片上系統(SoC)開發的實用指南。FPMM 收錄了眾多公司的設計團隊在設計和驗證方面的寶貴經驗。
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賽靈思 FPGA
- 摘要：以Xilinx的FPGA為例，介紹了FPGA開發系統的電源要求和功耗，并給出了采用線性低壓降（LDO）穩壓器,DC/DC調整器,DC/DC控制器和電源模塊等幾種電源解決方案。 關鍵詞：現場可編程門陣列；電源設計；DC/DC變換器
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系統 電源 設計 研究 開發 FPGA 現場 可編程 陣列 大規模
- 美國國家儀器有限公司(National Instruments，簡稱NI)近日發布了全新NI LabWindows/CVI 2010，該軟件可基于驗證過的ANSI C測試測量軟件平臺，提供更高的開發效率，并簡化FPGA通信的復雜度。此外，NI還發布了LaWindows/CVI 2010 Linux Run-Time模塊和LabWindows/CVI 2010實時模塊，可擴展開發環境至Linux和實時操作系統中。
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NI FPGA
- 低功耗和高帶寬是下一代高端設計的兩個主要需求。對全球范圍多個應用領域的調研表明，以相同甚至更低功耗及成本來實現更大的帶寬已成為大勢所趨。現在應對帶寬不斷增長的技術是演進中的40G和100G系統(以及即將出現的400G系統)。設計下一代FPGA來滿足目前對寬帶和低功耗需求的難度越來越大。
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Altera FPGA
- 摘要：提出了一種基于FPGA并利用Verilog HDL實現的CMI編碼設計方法。研究了CMI碼型的編碼特點，提出了利用Altera公司CycloneⅡ系列EP2C5Q型號FPGA完成CMI編碼功能的方案。在系統程序設計中，首先產生m序列，然后程序
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FPGA CMI 編碼 系統設計
- 摘要：利用FPGA實現時分多址的方法有很多種，但大多數方法都對FPGA芯片資源的占用非常巨大。針對這一問題，提出一種改進型方法來實現時分多址。通過使用FPGA芯片內部的雙口隨機訪問存儲器(雙口RAM)，利用同一塊RAM采
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FPGA 時分 多址 改進型
- 串口傳輸常用于基于FPGA和DSP結構的信號處理板和外部設備之間的數據交換。以GPS RTK定位應用為基礎，針對單個串口全雙工傳輸不足以應對多種數據類型同時輸入輸出的情形，設計并實現了一種面向多串口不同類型數據的傳輸方案。該方案通過增加串口控制寄存器實現單個中斷信號即可控制所有串口，采用乒乓交替讀寫實現數據持續高速輸入。測試表明該方案可獨立對各串口進行配置，可同時實現GPS定位結果、差分GPS修正數據與外界的交換以及用戶控制命令的輸入，并且可減少硬件調試時間，節約硬件資源。
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數據通信 實現 串口 II NIOS 基于
- 摘要：基于FPGA和USB2．0的技術方案，設計了一種高速化和集成化的數據采集系統。該系統是以Altera公司的FPGA芯片EP2C5T144為主控芯片，以Cypress公司的EZ-USB FX2芯片為傳輸手段設計實現的。首先詳細介紹了整體系統的
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FPGA 數據采集系統
- 摘要：激光雷達的發射波及回波信號經光電器件轉換形成的電信號具有脈寬窄，幅度低，背景噪聲大等特點，對其進行低速數據采集存在數據精度不高等問題。同時，A/D轉換器與數字信號處理器直接連接會導致數據傳輸不
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FPGA DSP 雷達 高速數據
- 摘要：為了提高系統的集成度和可靠性，降低功耗和成本，增強系統的靈活性，提出一種采用非常高速積體電路的硬件描述語言(VHDL語言)來設計數字基帶傳輸系統的方法。詳細闡述數字基帶傳輸系統中信號碼型的設計原則，數
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FPGA 數字基帶 傳輸系統
- 市場分析師預測，全球營收排名第二大的可程序化邏輯組件供貨商Altera，有機會在2012年初取代該市場龍頭Xilinx躍上第一大供貨商位置。
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Altera FPGA
- 為達到IRIG-B碼與時間信號輸入、輸出的精確同步，采用現代化靶場的IRIG-B碼編碼和解碼的原理，從工程的角度出發，提出了使用現場可編程門陣列(FPGA)來實現IRIG-B碼編碼和解碼的設計方案和體系結構，設計中會涉及到幾個不同的時鐘頻率，FPGA對時鐘的同步性具有靈活性、效率高、且功耗低。抗干擾性好的特點。結果表明，FPGA能夠確保為從設備提供同源的時鐘基準，使時鐘與信號的延遲控制在200 ns以內，從而得到了IRIG-B碼與時間精確同步的效果。
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IRIG-B FPGA DC 編碼
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