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基于FPGA和USB 2.0的高速CCD聲光信號采集系統(tǒng)
- 系統(tǒng)采用現(xiàn)場FPGA作為硬件設(shè)計(jì)核心，使用Veritog語言。進(jìn)行硬件描述，使系統(tǒng)更靈活，可在線編程，便于擴(kuò)展和升級。這里的CCD驅(qū)動時(shí)序采用狀態(tài)機(jī)與分頻相結(jié)合的新方法，實(shí)際測試驅(qū)動波形穩(wěn)定且沒有毛刺，CCD輸出信號質(zhì)量高。USB應(yīng)用于Slave FIFO高速傳輸模式，滿足了高速CCD聲光信號采集的要求，具有實(shí)時(shí)性、高速、穩(wěn)定、可靠等特點(diǎn)。
- 關(guān)鍵字： USB2.0 CCD FPGA 聲光信號采集
理解FPGA中的壓穩(wěn)態(tài)
- FPGA 設(shè)計(jì)人員可以通過增大tMET ，采用增加同步寄存器時(shí)序余量等設(shè)計(jì)方法來提高系統(tǒng)可靠性，增大亞穩(wěn)態(tài)MTBF。Altera 確定了其 FPGA 的MTBF 參數(shù)，改進(jìn)器件技術(shù)，從而增大了亞穩(wěn)態(tài)MTBF。使用Altera FPGA 的設(shè)計(jì)人員可以利用Quartus II 軟件功能來報(bào)告設(shè)計(jì)的亞穩(wěn)態(tài)MTBF，優(yōu)化設(shè)計(jì)布局以增大MTBF。
- 關(guān)鍵字： 壓穩(wěn)態(tài) MTBF FPGA
ACTEL FPGA在便攜式系統(tǒng)中的應(yīng)用分析
- 在上世紀(jì)最后的十年里，重復(fù)可編程邏輯器件大放異彩，在通信行也得到了廣泛的應(yīng)用，這一時(shí)期FPGA 競爭基本上集中在容量，性能， IO 標(biāo)準(zhǔn)方面。而在便攜應(yīng)用方面因?yàn)镕PGA 的高昂的價(jià)格，驚人的功耗基本上很少應(yīng)用。
- 關(guān)鍵字： Actel 便攜式系統(tǒng) FPGA
FPGA重復(fù)配置和測試的實(shí)現(xiàn)
- 從制造的角度來講，F(xiàn)PGA測試是指對FPGA器件內(nèi)部的邏輯塊、可編程互聯(lián)線、輸入輸出塊等資源的檢測。完整的FPGA測試包括兩步，一是配置FPGA、然后是測試FPGA，配置FPGA是指將FPGA通過將配置數(shù)據(jù)下載編程使其內(nèi)部的待測資源連接成一定的結(jié)構(gòu)，在盡可能少的配置次數(shù)下保證FPGA內(nèi)部資源的測試覆蓋率，配置數(shù)據(jù)稱為TC，配置FPGA的這部分時(shí)間在整個(gè)測試流程占很大比例；測試FPGA則是指對待測FPGA施加設(shè)計(jì)好的測試激勵(lì)并回收激勵(lì)，測試激勵(lì)稱為TS。
- 關(guān)鍵字： 重復(fù)配置 測試 FPGA
目標(biāo)設(shè)計(jì)平臺使基于FPGA的系統(tǒng)開發(fā)易如反掌
- ISE設(shè)計(jì)套件11的全功能版本將作為Virtex-6 FPGA套件的一部分推出，器件支持僅限于Vitex-6 LX240T-FF1156。Spartan-6 FPGA 套件包括ISE設(shè)計(jì)套件11 WebPACK軟件。ISE設(shè)計(jì)套件作為獨(dú)立產(chǎn)品另外提供，可提供全面的器件支持，邏輯版本的起價(jià)為2995美元。客戶可從賽靈思網(wǎng)站免費(fèi)下載 ISE設(shè)計(jì)套件11的全功能30天評估版本。
- 關(guān)鍵字： 目標(biāo)設(shè)計(jì)平臺 Virtex-6 FPGA 系統(tǒng)開發(fā)
FPGA設(shè)計(jì)工具視點(diǎn)
- 作為一個(gè)負(fù)責(zé)FPGA企業(yè)市場營銷團(tuán)隊(duì)工作的人，我不得不說，由于在工藝技術(shù)方面的顯著成就以及硅芯片設(shè)計(jì)領(lǐng)域的獨(dú)創(chuàng)性，F(xiàn)PGA正不斷實(shí)現(xiàn)其支持片上系統(tǒng)設(shè)計(jì)的承諾。隨著每一代新產(chǎn)品的推出，F(xiàn)PGA在系統(tǒng)中具有越來來越多的功能，可作為協(xié)處理器、DSP 引擎以及通信平臺等，在某些應(yīng)用領(lǐng)域甚至還可用作完整的片上系統(tǒng)。
- 關(guān)鍵字： 設(shè)計(jì)工具 DSP FPGA ASSP
依托FPGA開發(fā)高性能網(wǎng)絡(luò)安全處理平臺
- 通過FPGA來構(gòu)建一個(gè)低成本、高性能、開放架構(gòu)的數(shù)據(jù)平面引擎可以為網(wǎng)絡(luò)安全設(shè)備提供性能提高的動力。隨著互聯(lián)網(wǎng)技術(shù)的飛速發(fā)展，性能成為制約網(wǎng)絡(luò)處理的一大瓶頸問題。FPGA作為一種高速可編程器件，為網(wǎng)絡(luò)安全流量處理提供了一條低成本、高性能的解決之道。
- 關(guān)鍵字： 高性能 網(wǎng)絡(luò)安全 FPGA 處理平臺
目標(biāo)設(shè)計(jì)平臺使基于FPGA的系統(tǒng)開發(fā)易如反
- 賽靈思公司在正式發(fā)布新一代旗艦產(chǎn)品高性能Virtex-6和低成本Spartan-6 FPGA時(shí)，首次提出了“目標(biāo)設(shè)計(jì)平臺”的新概念。賽靈思目標(biāo)設(shè)計(jì)平臺包含五個(gè)關(guān)鍵部分：Virtex-6和Spartan-6 FPGA器件、支持和集成業(yè)界成熟設(shè)計(jì)方法的設(shè)計(jì)環(huán)境、采用業(yè)界標(biāo)準(zhǔn)FPGA多層連接器的可擴(kuò)展板和套件、提供接口的IP內(nèi)核和強(qiáng)大的參考設(shè)計(jì)。
- 關(guān)鍵字： 目標(biāo)設(shè)計(jì)平臺 系統(tǒng)開發(fā) FPGA Virtex-6 Spartan-6
基于FPGA的線陣CCD驅(qū)動時(shí)序及模擬信號處理的設(shè)計(jì)
- 基于FPGA設(shè)計(jì)的驅(qū)動電路是可再編程的，與傳統(tǒng)的方法相比，其優(yōu)點(diǎn)是集成度高、速度快、可靠性好。若要改變驅(qū)動電路的時(shí)序，增減某些功能，僅需要對器件重新編程即可，在不改變?nèi)魏斡布那闆r下，即可實(shí)現(xiàn)驅(qū)動電路的更新?lián)Q代。通過對TCDl50lD輸出圖像信號特征的簡要分析，分別闡述了內(nèi)、外2種除噪方法，并給出了相應(yīng)的時(shí)序，再利用Quartus II 7．2軟件平臺對TCDl501D CCD驅(qū)動時(shí)序及AD9826的采樣時(shí)序進(jìn)行了設(shè)計(jì)及結(jié)果仿真，使CCD的驅(qū)動變得簡單且易于處理，這是傳統(tǒng)邏輯電路無法比擬的，對其他CCD時(shí)
- 關(guān)鍵字： CCD驅(qū)動時(shí)序 模擬信號處理 FPGA
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