- 雷達信號的仿真是測試系統中必不可少的。但采用函數/任意波發生器組成測試系統，不僅增加系統成本，而且還給系統軟件設計增加不必要的負擔。為此，提出了一種基于CPLD的雷達仿真信號的實現方案，它能為機載雷達測試系統提供所需的多種典型的重頻脈沖及制導信號。
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雷達信號 任意波發生器 CPLD
- 由于B超中為了增強圖像分辨率，通道都比較多，大多是16、24、48、64甚至更多通道。這些通道電子元器件完全一樣，要求各通道的一致性要好，在裝整機前，最好有測試手段和方法，對所有通道能進行測試，以去除器件本身和焊接電路板中出現的問題，基于此目的，本人設計了B超檢測工裝。
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B超檢測工裝 圖像分辨率 CPLD
- 爆速儀是一種用來測量火藥爆炸速度的儀器,其性能的優劣及穩定性對測速的結果將有直接影響。傳統爆速儀的前端計數電路一般都是采用分立元器件實現,結構擁擠,且保密性不高。為了在滿足爆速儀設計的微型化的同時滿足較高時鐘要求,在爆速儀的前端計數模塊和自檢電路部分的設計中利用CPLD器件代替傳統的分立元器件電路,并利用Qu-artusⅡ軟件對設計進行仿真。
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爆速儀 計數器 CPLD
- 介紹了采用CPLD和Flash器件對FPGA實現快速并行配置，并給出了具體的硬件電路設計和關鍵模塊的內部編程思路。
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FPGA配置 JTAG CPLD
- 隨著軟件產品的廣泛應用，對軟件的知識產權保護也開始重要。軟件產品通過系列號碼加密，每一個軟件均有唯一的產品系列號碼。軟件產品配置加密電路板后，軟件產品和該產品軟件加密板同時售出，用戶在使用時一套軟件要配備一塊加密板，通過控制加密板，就可以保證軟件產品安全。
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知識產權保護 加密電路板 CPLD
- 借助EDA工具軟件設計了一個邏輯控制部件，解決了CPU尋址空間不足、接口功能不全等問題。此基于CPLD的可重構硬件數字平臺具有可移植性，使CPU對外接器件近似透明，在更換其他類型CPU后，僅做少量軟件和硬件修改即可升級成為新系統。
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邏輯控制 EDA CPLD 電子秤
- 今天，大多數的CPLD（復雜可編程邏輯器件）都采用可減少功耗的工作模式，但當系統未使用時，應完全切斷電源以保存電池能量，從而實現很多設計者的終極節能目標。描述了如何在一片CPLD 上增加幾只分立元件，實現一個節省電池能量的系統斷電電路。
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按鍵開關矩陣 系統斷電電路 CPLD
- 在嵌入式系統中，花費大量的中斷源來擴展串口無疑是大量的資源浪費。針對這種情況，為了節省緊張的系統資源，本文提出一種實現高效多串口中斷方案，可以利用單一的中斷源來管理多個擴展串口，并保證多個串口中斷的無漏檢測與服務。
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多串口中斷源 電平轉換 CPLD
- 時鐘脈沖計數器的輸出經過3 線—8 線譯碼器譯碼其輸出信號接到八位數碼管的陰極Vss0、Vss1、Vss2、Vss3、Vss4、Vss5、Vss6、Vss7 端。要顯示的數據信息Ａ～Ｈ中哪一個，通過八選一數據選擇器的地址碼來選擇，選擇出的數據信息經七段譯碼器譯碼接數碼管的a～g 管腳。這樣八個數碼管就可以輪流顯示八個數字，如果時鐘脈沖頻率合適，可實現八個數碼管同時被點亮的視覺效果。
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八位數碼管 共陰極 CPLD
- 傳統的數字電壓表多以單片機為控制核心，采用CPLD進行產品開發，可以靈活地進行模塊配置，大大縮短了開發周期，也有利于數字電壓表向小型化、集成化的方向發展。
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電壓表 控制核心 CPLD
- 文所要設計的是一種脫機型儀表硬件平臺。平臺應可以滿足一般的數據采集的實時性要求，可以靈活的適用于多種不同的應用場合，可實現多種類型信號的采集和處理，結構小巧緊湊，便于現場處理，還能與PC機或其他設備進行通信和交換數據。對此，我們構建了基于DSP和CPLD技術的硬件平臺。
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圖像采集 儀表硬件平臺 CPLD
- SDRAM的讀寫邏輯復雜，最高時鐘頻率達100 MHz以上，普通單片機無法實現復雜的SDRAM控制操作，復雜可編程邏輯器件CPLD具有編程方便，集成度高，速度快，價格低等優點。因此選用CPLD設計SDRAM接口控制模塊，簡化主機對SDRAM的讀寫控制。通過設計基于CPLD的SDRAM控制器接口，可以在STM系列、ARM系列、STC系列等單片機和DSP等微處理器的外部連接SDRAM，增加系統的存儲空間。
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刷新時序 CPLD SDRAM
- CPLD是復雜的PLD，專指那些集成規模大于1000門以上的可編程邏輯器件。它由與陣列、或陣列、輸入緩沖電路、輸出宏單元組成，具有門電路集成度高、可配置為多種輸入輸出形式、多時鐘驅動、內含ROM或FLASH(部分支持在系統編程)、可加密、低電壓、低功耗以及支持混合編程技術等突出特點。而且CPLD的邏輯單元功能強大，一般的邏輯在單元內均可實現，因而其互連關系簡單，電路的延時就是單元本身和集總總線的延時(通常在數納秒至十數納秒)，并且可以預測。所以CPLD比較適合于邏輯復雜、輸入變量多但對觸發器的需求量相對較
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高速 數據采集 CPLD
- 在數字電路設計中，當需要將一輸入的窄脈沖信號展寬成具有一定寬度和精度的寬脈沖信號時，往往很快就想到利用54HC123或54HC4538等單穩態集成電路。這一方面是因為這種專用單穩態集成電路簡單、方便；另一方面是因為對輸出的寬脈沖信號的寬度、精度和溫度穩定性的要求不是很高。當對輸出的寬脈沖信號的寬度、精度和溫度穩定性的要求較高時，采用常規的單穩態集成電路可能就比較困難了。眾所周知，專用單穩態集成電路中的寬度定時元件R、C是隨溫度、濕度等因素變化而變化的，在對其進行溫度補償時，調試過程相當繁瑣，而且，電路工作
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單穩態 脈沖 CPLD
- 為了實現PC機與CPLD的通信，進行了相應的研究。分析了RS-232C通信協議，自定義了數據包傳輸格式。根據UART模塊工作狀態多的特點，應用了有限狀態機理論進行編程實現。為降低誤碼率，應用16倍頻技術，實現了波特率為9 600 bit／s的串口通信。在Quartus II平臺上用VerilogHDL進行編程，并通過了VC編寫程序的數據傳輸的驗證。研究成果為工程上PC機與嵌入式系統數據傳輸的問題提供了一種解決方法。
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有限狀態機 數據包 CPLD
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