- 致力于在電源、安全、可靠和性能方面提供差異化半導體技術方案的領先供應商美高森美公司(Microsemi Corporation)祝賀歐洲太空總署(ESA)、美國國家航空航天局(NASA)和其合作伙伴的羅塞塔號(Rosetta)探測器成功實現了觀測67P/Churyumov-Gerasimenko彗星的任務目標。
超過15,000個美高森美高可靠性創新太空產品，比如跨越多項技術的FPGA、二極管、晶體管和集成電路用于這個長達10年、跨越40億英里的關鍵任務應用中，并且繼續支持該任務進行多種研究項目
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美高森美 FPGA 晶體管
- 通常認為，SOPC是FPGA設計中的雞肋，“棄之可惜，食之無味”。誠然，SOPC一直不是FPGA的主流應用設計，制約主要因素則是性能，因為作為處理器使用時，處理器主頻是其應用范圍的瓶頸(SOPC的軟核處理器一般運行幾十兆到百兆，而一般的嵌入式處理器系統在幾百兆到Ghz的主頻)。但是若因此說成“雞肋”，也確實夸張。廠家推出SOPC的設計，其優點主要有一下幾點，其一：是差異化競爭的需要。其二，擴大應用范圍，爭取更多的軟件工程師能夠從事FPGA設計。其三，可以
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FPGA SOPC
- 從最初的占地170平方的第一代ENIAC計算機開始，計算機開始了不斷集成化、小型化的發展之旅。現今在單一芯片內部已經能夠集處理器，存儲，各型協處理器等，從而形成的強大的單芯片的片上系統(SOC)，而這些片上系統已存在于生活的方方面面。因此FPGA內部支持片上系統，也算不上是新奇的事情了。ALTERA和XILINX已各自推出了各自應用片上系統(FPGA領域稱之為SOPC，因此其片上系統可以根據業務需求來定義)。
只需幾K的資源，就能實現一個SOC的最小系統，對于FPGA工程師來說，沒什么比這個更有
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FPGA SOC NIOSII
- 如果說在PC時代，壟斷PC江湖的是WINTEL(微軟和英特爾)，那么在移動互聯網時代，最具有這個潛質的就是谷歌的andriod操作系統和ARM芯片。基于ARM公司授權的各型ARM處理器，基本上在各型嵌入式終端設備占據了壟斷地位。“背靠大樹好乘涼”，因此，用于作為ARM處理做片上系統互聯的AMBA總線標準亦成為業界應用最廣泛的標準。
AMBA總線事實上為三個總線標準的合集，分別是AHB、ASB、APB。ASB已逐漸被AHB所取代，現在使用最廣泛的為AHB和APB總線，以及最
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FPGA ARM xilinx
- 開創性FPGA軟件供應商Plunify® Pte. Ltd.今日發布其支持Altera 的FPGA和SoC的InTimeTM設計優化軟件。
Plunify的InTime軟件借助于運算資源和機器學習技術，快速地生成解決設計問題的優化策略。
Altera軟件和IP市場總監Alex Grbic說，“我們很高興Plunify能成為我們的合作伙伴。與Plunify這樣的公司合作使我們可以向客戶提供更多相互支持的解決方案。”
Plunify的InTime軟件能為A
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FPGA Altera SoC
- 軟件無線電的出現，是無線電通信從模擬到數字、從固定到移動后，由硬件到軟件的第三次變革。簡單地說，軟件無線電就是一種基于通用硬件平臺，并通 過軟件可提供多種服務的、適應多種標準的、多頻帶多模式的、可重構可編程的無線電系統。軟件無線電的關鍵思想是，將AD(DA)盡可能靠近天線和用軟件來 完成盡可能多的無線電功能。
蜂窩移動通信系統已經發展到第三代，3G系統進入商業運行一方面需要解決不同標準的系統間的兼容性;另一方 面要求系統具有高度的靈活性和擴展升級能力，軟件無線電技術無疑是最好的解決方案。用ASI
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FPGA ASIC
- Altera公司和IBM今天發布了業界第一款基于FPGA的加速平臺，通過IBM的一致性加速器處理器接口(CAPI)，實現FPGA與POWER8 CPU順暢的連接。這一可重新配置的硬件加速器在FPGA和處理器之間有共享虛擬存儲器，顯著提高了高性能計算(HPC)和數據中心應用的系統性能、效率和靈活性。在超級計算2014年度大會上，Altera和IBM展示的幾種POWER8系統能夠使用FPGA實現連續加速。
通過與OpenPOWER基金會一起工作，Altera和IBM開發了非常靈活的異構計算解決方案，
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Altera IBM FPGA
- Analog Devices, Inc. (ADI: NASDAQ) 最近推出一款快速原型制作套件，其可簡化寬動態范圍 GSPA 數據轉換器到 FPGA(現場可編程門陣列)的連接。 數字和模擬設計人員可以采用快速原型制作套件 AD-FMCDAQ2-EBZ ，在主要的 FPGA 平臺(包括 Xilinx 的 UltraScale FPGA，以及 Zynq 用于雷達、儀器儀表、無線電和其它數據采集應用的所有可編程 SoC 器件)上快速地對高速 JEDEC JESD204B SerDes(串行器/解串器)G
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ADI FPGA SoC
- 如果設計中有多個模塊，每個模塊內部有許多寄存器或者存儲塊需要配置或者提供讀出那么實現方式有多種，主要如下：
實現方式一：可以在模塊頂部將所有寄存器引出，提供統一的模塊進行配置和讀出。這種方式簡單是簡單，但是頂層連接工作量較大，并且如果配置個數較多，導致頂層中寄存器的數目也會較多。
實現方式二：通過總線進行連接，為每個模塊分配一個地址范圍。這樣寄存器等擴展就可以在模塊內部進行擴展，而不用再頂層進行過多的頂層互聯。如下圖所示：
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那如果進行總線的選擇，那么有一種
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FPGA AVALON
- 有個笑話說，有個病人感冒了，于是去看醫生，醫生診斷后說，你得了感冒，但是我只會治療肺炎，不如你回家再澆點涼水，把病惡化成肺炎，那我能治了。這個笑話展示了庸醫誤人。但是另一方面，從邏輯上來講，醫生則是一個把未知問題轉化成已知問題的高手。
不說笑話，下面出兩個題目，其分別是
問題1：運用數字電路，如何將一個時鐘域的上升沿，轉換成另一個時鐘域的脈沖信號(單周期信號)。
問題2：運用數字電路，如何將一個時鐘域的脈沖信號(單周期信號)，轉換成另一個時鐘域的上升沿。
可能乍一看，這兩個題目
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FPGA 數字電路
- 當下，最火的學問莫過于《大數據》，大數據的核心思想就是通過科學統計，實現對于社會、企業、個人的看似無規律可循的行為進行更深入和直觀的了解。FPGA的可測性也可以對FPGA內部“小數據”的統計查詢，來實現對FPGA內部BUG的探查。
可測性設計對于FPGA設計來說，并不是什么高神莫測的學問。FPGA的可測性設計的目的在設計一開始，就考慮后續問題調試，問題定位等問題。要了解FPGA可測性設計，只不過要回答幾個問題，那就是：
(1) 設計完成如何進行測試?
(2)
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FPGA JTAG
- 作為FPGA工程師來說，碰到新的問題是設計中最常見的事情了，技術發展趨勢日新月異，所以經常會有新的概念，新的需求，新的設計等待去實現。不是每個通過BAIDU或者GOOGLE都有答案。
因此，新的設計經常會有，那如何實現?
假設，FPGA需要設計一個接口模塊，那我們就需要了解一下幾個問題：
(1) 同步接口還是異步接口模塊;
(2) 有哪些信號，功能是什么?
(3) 信號之間時序關系是什么?
(4) 傳遞的效率能夠達到多少;
(5) 等等!
誰會給予這些答
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FPGA 測試 接口
- 寫在coding之前的那些鐵律
(1)注釋： 好的代碼首先必須要有注釋，注釋至少包括文件注釋，端口注釋，功能語句注釋。
文件注釋：文件注釋就是一個說明文：這通常在文件的頭部注釋，用于描述代碼為那個工程中，由誰寫的，日期是多少，功能描述，有哪些子功能，及版本修改的標示。這樣不論是誰，一目了然。即使不寫文檔，也能知道大概。
接口描述：module的接口信號中，接口注釋描述模塊外部接口，例如AHB接口，和SRAM接口等等。這樣讀代碼的人即可能夠判斷即模塊將AHB接口信號線轉換成SRAM接口
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FPGA coding 時序
- 1 項目背景
1.1 研究背景
LCD顯示屏的應用越來越廣，數量越來越多。LCD顯示屏應用廣泛，無處不在。小到家庭各種電器設備，大到軍事設備。更常見是用于各種公共場合如體育館、廣場等商業用途。給我們傳遞一種更為直觀、生動的信息。從此我們的生活發生了巨大改變。巨大的應用巨大的市場帶來了巨大的商機。傳統的顯示器大多采用控制系統與顯示界面集成在一起的方案，不便于實時管理與有效維護，不便于及時更新;也不便于人親臨惡劣的工作環境下進行人為操控。LED顯示屏用戶迫切需要實現對LED顯示屏的遠程控制。
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FPGA LCD Microblaze
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