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讓XDC時(shí)序與約束為您效力
- 作者：Adam?Taylor?e2v?公司首席工程師?aptaylor@theiet.org 時(shí)序和布局約束是實(shí)現(xiàn)設(shè)計(jì)要求的關(guān)鍵因素。本文是介紹其使用方法的入門讀物。 完成?RTL?設(shè)計(jì)只是?FPGA?設(shè)計(jì)量產(chǎn)準(zhǔn)備工作中的一部分。接下來的挑戰(zhàn)是確保設(shè)計(jì)滿足芯片內(nèi)的時(shí)序和性能要求。為此，您經(jīng)常需要定義時(shí)序和布局約束。我們了解一下在基于賽靈思?FPGA?和?SoC?設(shè)計(jì)系統(tǒng)時(shí)如何創(chuàng)建
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