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Xilinx MIG IP核的研究及大容量數據緩沖區的實現

• 為了使DDR3 SDRAM更方便、多樣地用于工程開發中，本文對XILINX公司DDR3 SDRAM提供的MIG核進行了分析研究，并在此基礎上實現了大容量數據緩沖區的邏輯設計。通過對系統中各模塊的作用及相互間關系的研究，發現該控制器256位接口對工程開發十分不便，通過創建FIFO控制系統和讀寫接口FIFO的方式，將接口轉換為64位。該方案對控制核重新構建并上板測試，均符合高速數據傳輸緩存的要求，使DDR3成為一個大容量且可控的高速FIFO。
• 關鍵字： MIG核  FIFO  DDR3 SDRAM  201608