- 提出了一種基于嵌入式系統的高速、可配置RSA密碼協處理器的ASIC設計方案，可實現256 bit到2 048 bit的RSA加密運算。為了提高運算速度，采用改進的高基模乘算法和流水線結構；為了消除協處理器與內存之間的通信速度瓶頸，使用DMA直接訪問方式；同時，數據輸入輸出都使用雙口存儲體，形成加解密數據流，本文將該加解密協處理器簡稱為SPU（Streaming Processing Unit）。
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加解密協處理器 ASIC設計 蒙哥馬利乘法
- “中國集成電路設計業2012年會暨重慶集成電路跨越發展高峰論壇”于2012年12月06日在重慶隆重召開，本次年會以“開拓創新，發揮優勢，優化產業結構，打造電子信息產業高地”為主題。
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燦芯 SoC ASIC設計
- Synopsys宣布意法半導體在其90nm和65nm 的ASIC設計流程中，應用Design Compiler拓樸繪圖技術，縮短了整個設計時間。意法半導體在其ASIC方法集中應用Design Compiler拓樸繪圖技術，從而消除了設計的反復(Iteration)，實現了內部設計團隊和外部客戶整個設計環節工作的順暢。 在ASIC模式下，設計能否按計劃完成，在很多程度上取決于設計收斂完成前，網表在客戶與ASIC供應商間反復時間的縮短。Design Compil
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ASIC設計 Compiler拓樸繪圖技術 Design ST Synopsys 單片機 嵌入式系統 EDA IC設計
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