- 針對以往全數字鎖相環研究中所存在電路結構復雜、設計難度較大和系統性能欠佳等問題，提出了一種實現全數字鎖相環的新方法。該鎖相環以數字比例積分控制的設計結構取代了傳統的一些數字環路濾波控制方法。應用EDA技術完成系統設計，并進行計算機仿真。仿真結果表明：在一定的頻率范圍內，該鎖相環鎖定時間最長小于15個輸入信號周期，相位抖動小于輸出信號周期的5％，且具有電路結構簡單、環路性能好和易于集成的特點。
- 關鍵字：
比列積分控制 全數字鎖相環 超高速集成電路硬件描述語言 現場可編程門陣列
超高速集成電路硬件描述語言介紹
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