- 隨著快速傅里葉變化(FFT)在信號處理應用領域的廣泛應用，不同場合對硬件實現的 FFT 算法結構提出了多樣化的要求，針對這種需求在硬件編程設計中將 FFT 分割成模塊化的三部分：數據存儲重排模塊、旋轉因子調用模塊、蝶形運算模塊。通過時序調用可組成不同結構的 FFT 處理器，實現流水結構與遞歸結構兩種方案，分別側重于處理速度與資源占用量兩方面的優勢。在FPGA硬件設計中使用 Verilog 語言完成代碼編程，實現了兩種結構的 512 點基 2 算法的快速傅里葉變換，使用 Modelsim 完成功能仿真。與
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FFT 硬件實現 基 2 算法 模塊化設計 流水線結構 遞歸結構 201902
- 著重討論基于FPGA的64點高速FFT算法的實現方法。采用高基數結構和流水線結構，大大提高了FFT處理器的運行速度。同時塊浮點結構的引入，也大幅減少了浮點操作占用FPGA器件的資源數目，兼顧了FPGA高精度、低資源、低功耗的特點。
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高速FFT算法 高基數結構 FPGA 流水線結構
- MSL4163提供1MHz I2C串口，器件包括先進的PWM引擎以及片上EEPROM等。主要用在電視和臺式電腦監視器、醫療、工業儀表和汽車音/視頻顯示器。本文介紹了MSL4163/MSL4164主要特性、方框圖和典型應用電路、級聯連接電路。
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3GPP協議 流水線結構 FPGA
- 摘要：本文介紹了一款高速率、高精度、基于流水線結構的A／D轉換芯片THS1206；并基于紅外成像系統，詳細介紹了該款芯片的基本結構、主要特點、應用要點及軟硬件設計方案。實際測試表明，THS1206較好地實現了紅外成像
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A／D轉換器 流水線結構 紅外成像系統 高數據率
- 摘要：在應用FPGA進行DDS系統設計過程中，選擇芯片的運行速度優化和資源利用優化常常是相互矛盾的，從發展趨勢和運算要求看，系統速度指標的意義比面積指標更趨重要。基于此，介紹了一種流水線結構來優化傳統的相位累
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DDS 流水線結構 多功能 信號發生器
- 提出一種采用三級流水線型結構的9位100 MSPS折疊式A／D轉換器，具體分析了其內部結構。電路使用0．6μm Bipolar工藝實現，由5 V／3．3V雙電源供電，經優化設計后，實現了9位精度。100MSPS的轉換速度，功耗為650mW，差分輸入范圍2．2V。給出了在Cadence Spectre的仿真結果，討論了流水線A／D轉換器設計的關鍵問題。
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MSPS 100 D轉換 流水線結構
- 設計實現了基于FPGA的256點定點FFT處理器。處理器以基-2算法為基礎，通過采用高效的兩路輸入移位寄存器流水線結構，有效提高了碟形運算單元的運算效率，減少了寄存器資源的使用，提高了最大工作頻率，增大了數據吞吐量，并且使得處理器具有良好的可擴展性。詳細描述了具體設計的算法結構和各個模塊的實現。設計采用Verilog HDL作為硬件描述語言，采用QuartusⅡ設計仿真工具進行設計、綜合和仿真，仿真結果表明，處理器工作頻率為72 MHz，是一種高效的FFT處理器IP核。
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FPGA FFT 移位寄存器 流水線結構
- 摘 要： 設計了一種應用于多標準收發器的可重構流水線結構模數轉換器，通過一個重構配置控制信號動態地配置采樣頻率的大小及分辨率的位數，以滿足不同標準及系統的需要。在設計中還采用了共源共柵兩級運放和差分
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可重構 流水線結構 模數轉換器
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