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        EEPW首頁 >> 主題列表 >> 技巧

        LED驅(qū)動設(shè)計5大技巧要領(lǐng)

        • 1、芯片發(fā)熱這主要針對內(nèi)置電源調(diào)制器的高壓驅(qū)動芯片。假如芯片消耗的電流為2mA,300V的電壓加在芯片上面,芯片的功耗為0.6W,當(dāng)然會引起芯片的發(fā)熱。驅(qū)動芯片的最大電流來自于驅(qū)動功率mos管的消耗,簡單的計算公式為
        • 關(guān)鍵字: 要領(lǐng)  技巧  設(shè)計  驅(qū)動  LED  

        漏極電壓及電流的測量技巧

        •  我們將以12 W 通用輸入恒壓適配器為例進行講解,該適配器使用TinySwitchreg;-III 器件設(shè)計而成。  所需設(shè)備  要完成本課程,您需要準備好一個功能完備的電源和一組標準測試設(shè)備。與電力電子裝置配合使用的標準
        • 關(guān)鍵字: 技巧  測量  電流  電壓  

        FPGA/CPLD設(shè)計思想與技巧

        • FPGA/CPLD設(shè)計思想與技巧,  本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧:乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化,都是FPGA/CPLD邏輯設(shè)計的內(nèi)在規(guī)律的體現(xiàn),合理地采用這些設(shè)計思想能在FPGA/CPLD設(shè)計工作中取得事半功倍的效果。 
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        RF電路板分區(qū)設(shè)計中PCB布局布線技巧

        •   今天的蜂窩電話設(shè)計以各種方式將所有的東西集成在一起,這對RF電路板設(shè)計來說很不利。現(xiàn)在業(yè)界競爭非常激烈,人人都在找辦法用最小的尺寸和最小的成本集成最多的功能。模擬、數(shù)字和RF電路都緊密地擠在一起,用來
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        獲取較高的低壓輸出精度小技巧

        •  輸出電壓在不斷下降,而穩(wěn)壓要求卻變得越來越高,對于設(shè)計者來說,適當(dāng)?shù)男〖记煽梢允谷蝿?wù)不像其表面看起來那么難。即使必須要使用1%或更大的容差電阻來進行設(shè)計,我們?nèi)匀豢梢缘玫椒浅>_的輸出電壓。  圖1顯示
        • 關(guān)鍵字: 技巧  精度  輸出  低壓  獲取  

        利用布線技巧提高嵌入式系統(tǒng)PCB的信號完整性

        • 利用布線技巧提高嵌入式系統(tǒng)PCB的信號完整性,針對嵌入式系統(tǒng)PCB高頻環(huán)境引發(fā)的信號完整性問題,提出合理布線來抑制它的方法。通過對各種信號完整性現(xiàn)象的分析,并對傳輸線、過孔以及拐角的電氣特性進行建模說明,歸結(jié)出一些在PCB設(shè)計中利用布線技巧提高信號完整性的方法,具有實際的參考價值。
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        加強ESD保護的技巧

        • 在本文章中,我們將介紹各種技巧,電路板設(shè)計者可以用它們幫助自己實現(xiàn)設(shè)計所需的ESD等級,從而保證所選的ESD保護器件能夠通過在系統(tǒng)ESD測試。  
            圖1  背景  現(xiàn)代電子設(shè)備(從LCD電視到手機)使用的很多芯
        • 關(guān)鍵字: 技巧  保護  ESD  加強  

        數(shù)碼相機電池重組技巧分析

        •  在最開始的半年里,隨著照相機使用時間的延長,有一種不愉快的現(xiàn)象始終纏繞著我。這個現(xiàn)象就是照相機在使用的過程中會突然關(guān)機,我重新開機后又一切回復(fù)正常。剛開始,這個現(xiàn)象出現(xiàn)的概率并不大,后來隨著時間的推
        • 關(guān)鍵字: 分析  技巧  重組  電池  數(shù)碼相機  

        內(nèi)聯(lián)匯編的技巧

        • 內(nèi)聯(lián)匯編的技巧,  有時我們的程序需要一些很高的執(zhí)行效率或者執(zhí)行系統(tǒng)底層的功能模塊,這些關(guān)鍵的部分我們可以采用內(nèi)聯(lián)匯編直接插入?yún)R編指令來達到我們的要求,以下是幾個技巧與大家共同探討.  1.內(nèi)聯(lián)匯編嵌入VC語句:  在VC中內(nèi)
        • 關(guān)鍵字: 技巧  匯編  內(nèi)聯(lián)  

        馬達設(shè)計原理及技巧

        • 現(xiàn)今的可調(diào)速驅(qū)動電路都采用變頻器來調(diào)整輸出電流,以滿足三相馬達的要求。變頻器的形狀大小通常會受到應(yīng)用的限制。在許多情況下,電路板與馬達靠得很近,而馬達構(gòu)造的高度也會受限。另外,所用高功率半導(dǎo)體器件的物
        • 關(guān)鍵字: 技巧  原理  設(shè)計  馬達  

        馬達設(shè)計的技巧

        • 現(xiàn)今的可調(diào)速驅(qū)動電路都采用變頻器來調(diào)整輸出電流,以滿足三相馬達的要求。變頻器的形狀大小通常會受到應(yīng)用的限制。在許多情況下,電路板與馬達靠得很近,而馬達構(gòu)造的高度也會受限。另外,所用高功率半導(dǎo)體器件的物理性質(zhì)和所選封裝的形狀,也要求電路板上有足夠的位置空間。功率半導(dǎo)體開關(guān)工作期間產(chǎn)生的電壓、電流交疊會造成損耗,必須將其消除。雖然功率耗散問題可以通過加設(shè)散熱片而得到改善,但這也會限制半導(dǎo)體器件在電路板上的布局安排。
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        常用FPGA/CPLD四種設(shè)計技巧

        • 常用FPGA/CPLD四種設(shè)計技巧,FPGA/CPLD的設(shè)計思想與技巧是一個非常大的話題,本文僅介紹一些常用的設(shè)計思想與技巧,包括乒乓球操作、串并轉(zhuǎn)換、流水線操作和數(shù)據(jù)接口的同步方法。希望本文能引起工程師們的注意,如果能有意識地利用這些原則指導(dǎo)日
        • 關(guān)鍵字: 技巧  設(shè)計  FPGA/CPLD  常用  

        極低待機功耗適配器的設(shè)計技巧及應(yīng)用方案

        • 電源適配器廣泛應(yīng)用于筆記本電腦、游戲機、打印機、DSL調(diào)制解調(diào)器和手機等領(lǐng)域,應(yīng)用規(guī)模非常龐大。而從人們的使用習(xí)慣來看,這些設(shè)備也有相當(dāng)比例的時間處于輕載或待機(空載)工作模式。因此,“能源之星”等規(guī)范標準
        • 關(guān)鍵字: 應(yīng)用  方案  技巧  設(shè)計  功耗  適配器  待機  

        解決復(fù)雜的PCIe鏈接的技巧

        • 解決復(fù)雜的PCIe鏈接的技巧,PCI Express(PCIe)是一個嵌入式系統(tǒng)普遍采用的接口,提供一些關(guān)鍵的優(yōu)勢包括自動檢測,通道配置,強大的誤差檢測和糾正,高通道到通道的偏差容許量和低功耗。因為該接口的能力和多功能性,設(shè)計師有時需要調(diào)試錯誤的PCIe連接。Reginald介紹了設(shè)計人員改如何去解決這個問題。
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        DC/DC轉(zhuǎn)換器設(shè)計中接地線的布線技巧

        • 在設(shè)計印刷線路板時,設(shè)計工程師都會仔細思考銅線的走線方式和元器件的放置問題。如果沒有充分考慮這兩點,印刷線路板的效率、最大輸出電流、輸出紋波及其它特性都將會受到影響。產(chǎn)生這些影響的兩個主要原因則是地線
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