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        ASIC后端設(shè)計(jì)中的時(shí)鐘樹綜合

        • 摘要:時(shí)鐘樹綜合是當(dāng)今集成電路設(shè)計(jì)中的重要環(huán)節(jié),因此在FFT處理器芯片的版圖設(shè)計(jì)過(guò)程中,為了達(dá)到良好的布局效果,采用時(shí)序驅(qū)動(dòng)布局,同時(shí)限制了布局密度;為了使時(shí)鐘偏移盡可能少,采用了時(shí)鐘樹自動(dòng)綜合和手動(dòng)修改
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        后端設(shè)計(jì)介紹

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