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	位同步時鐘
        

        
	
        
    	
        
    	  	
        
              	
        
                	
        位同步時鐘 文章
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        基于FPGA的提取位同步時鐘DPLL設(shè)計
        
                                                            
          
                    	
        •     在數(shù)字通信系統(tǒng)中，同步技術(shù)是非常重要的，而位同步是最基本的同步。位同步時鐘信號不僅用于監(jiān)測輸入碼元信號，確保收發(fā)同步，而且在獲取幀同步及對接收的數(shù)字碼元進(jìn)行各種處理的過程中也為系統(tǒng)提供了一個基準(zhǔn)
          • 
                    	                        
        • 關(guān)鍵字：
                        FPGA  DPLL  位同步時鐘                            
          • 
                   	
        
                    
        
                
        
                                
        
                    
        一種快速位同步時鐘提取方案及實現(xiàn)
        
                                                            
          
                    	
        • 本文比較了兩種常用位同步提取電路的優(yōu)缺點，在此基礎(chǔ)上提出了一種基于CPLD/FPGA、用于數(shù)字通信系統(tǒng)的新型快速位同步方案。此方案借助Altera的設(shè)計工具設(shè)計了位同步提取電路，并利用FPGA予以實現(xiàn)，同時給出了該電路的仿真試驗波形圖。
          • 
                    	                        
        • 關(guān)鍵字：
                        位同步時鐘  方案                            
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	共2條
	1/1															1								
	
        
		                
        
	               	
        
                
        
        	
        
            
        
        
        
	
        
	
        
  		
        
    		
        
      			
        
          			
        位同步時鐘介紹
        
      			
        
		      	
        
		      			      			      	您好，目前還沒有人創(chuàng)建詞條位同步時鐘!
         
		      	歡迎您創(chuàng)建該詞條，闡述對位同步時鐘的理解，并與今后在此搜索位同步時鐘的朋友們分享。    創(chuàng)建詞條
		      			      	
        
    		
        
  		
        
  		  		  		  		  		        		  		
        
    		
        
      			
        
        			
        熱門主題
        
      			
        
      			
        
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